View source for फ्लिप-फ्लॉप (इलेक्ट्रॉनिक्स)

{{Short description|Electronic circuit with two stable states}}
{{Other uses|फ़्लिप-फ़्लॉप (बहुविकल्पी){{!}}फ़्लिप-फ़्लॉप}}
[[File:Transistor Bistable interactive animated-en.svg|thumb|एनिमेटेड इंटरएक्टिव SR लैच (R 1, R 2 = 1k; R3, R4 = 10k)।]]
इलेक्ट्रॉनिक्स में '''फ्लिप-फ्लॉप''' या लैच इलेक्ट्रॉनिक परिपथ है। जिसमें दो स्टेबल स्टेट होते हैं और इसका उपयोग स्टेट की जानकारी को संग्रहीत करने के लिए बाई स्टेबल मल्टीब्रेटर का उपयोग किया जा सकता है। परिपथ को एक या अधिक नियंत्रण इनपुट पर संचालित सिग्नलबं द्वारा स्टेट को बदलने के लिए बनाया जा सकता है और इसमें एक या दो आउटपुट होंगे। यह सीक्वेंसिअल लॉजिक में मूलभूत भंडारण तत्व है। फ्लिप-फ्लॉप और लैच कंप्यूटर, संचार और अनेक अन्य प्रकार के प्रणालियों में उपयोग किए जाने वाले डिजिटल इलेक्ट्रॉनिक्स प्रणाली के मौलिक निर्माण ब्लॉक हैं।

फ्लिप-फ्लॉप और लैच का उपयोग डेटा भंडारण तत्वों के रूप में किया जाता है। फ्लिप-फ्लॉप उपकरण है। जो डेटा के बिट (बाइनरी डिजिट) को संग्रहीत करता है। इसके दो स्टेटों में से एक का प्रतिनिधित्व करता है और दूसरा शून्य का प्रतिनिधित्व करता है। इस प्रकार के डेटा स्टोरेज का उपयोगस्टेट (कंप्यूटर साइंस) के भंडारण के लिए किया जा सकता है और इस प्रकार के परिपथ को इलेक्ट्रॉनिक्स में सीक्वेंसिअल लॉजिक के रूप में वर्णित किया गया है। जब परिमित-स्टेट मशीन में उपयोग किया जाता है, तब आउटपुट और अगली स्टेट न केवल इसके वर्तमान इनपुट पर, किंतु इसकी वर्तमान स्टेट (और इसलिए पिछले इनपुट) पर भी निर्भर करती है। इसका उपयोग पल्स की गिनती के लिए भी किया जा सकता है और कुछ संदर्भ समय सिग्नल के लिए वैरिएबल टाइम्ड इनपुट सिग्नल को सिंक्रनाइज़ करने के लिए भी किया जा सकता है।

फ्लिप-फ्लॉप या तब स्तर-ट्रिगर (एसिंक्रोनस, पारदर्शी या अपारदर्शी) या एज-ट्रिगर (सिंक्रोनस, या क्लॉक सिग्नल) हो सकते हैं। फ्लिप-फ्लॉप शब्द ने ऐतिहासिक रूप से उदारतापूर्वक दोनों स्तर-ट्रिगर और एज-ट्रिगर परिपथ के लिए संदर्भित किया है। जो गेट्स का उपयोग करके डेटा को संग्रहीत करते हैं। आधुनिक लेखकों ने फ्लिप-फ्लॉप शब्द को विशेष रूप से किनारे-ट्रिगर भंडारण तत्वों के लिए और लैच को लेवल-ट्रिगर वाले तत्वों के लिए सुरक्षित रखा है। अस्पष्टता से बचने के लिए "एज-ट्रिगर" और "लेवल-ट्रिगर" शब्दों का उपयोग किया जा सकता है।

जब लेवल-ट्रिगर लैच इनेबल होता है। तब यह पारदर्शी हो जाता है, किन्तु एज-ट्रिगर फ्लिप-फ्लॉप का आउटपुट केवल क्लॉक-एज पर बदलता है (या तब धनात्मक या ऋणात्मक जा रहा है)।<ref name="pedroni" /><ref name="ee42" /><ref name="Roth, Charles H 1995">{{cite book |last=Roth |first=Charles H. Jr. |chapter=Latches and Flip-Flops |title=Fundamentals of Logic Design |edition=4th |publisher=PWS |date=1995 |isbn=9780534954727}}</ref>

विभिन्न प्रकार के फ्लिप-फ्लॉप और लैच एकीकृत सर्किट के रूप में सामान्यतः प्रति चिप अनेक तत्वों के साथ उपलब्ध हैं। उदाहरण के लिए 74HC75 7400 श्रृंखला में चार गुनी पारदर्शी लैच है।

== इतिहास ==
[[File:Eccles-Jordan trigger circuit flip-flip drawings.png|right|thumb|200px|एक्ल्स और जॉर्डन पेटेंट से फ्लिप-फ्लॉप स्कीमैटिक्स ने 1918 को दायर किया, एक को धनात्मक प्रतिक्रिया पथ के साथ एम्पलीफायरों k-कैस्केड के रूप में खींचा गया और दूसरा सममित क्रॉस-युग्मित जोड़ी के रूप में]]
प्रथम इलेक्ट्रॉनिक फ्लिप-फ्लॉप का आविष्कार 1918 में ब्रिटिश भौतिक विज्ञानी विलियम एक्लेस (भौतिक विज्ञानी) और एफ डब्ल्यू जॉर्डन द्वारा किया गया था।<ref>{{cite patent|country=GB|number=148582|pubdate=1920-08-05|title=Improvements in ionic relays|inventor1-last=Eccles|inventor1-first=William Henry|inventor2-last=Jordan|inventor2-first=Frank Wilfred}}
</ref><ref>See:
*  {{cite journal |first=W.H. |last=Eccles  |first2=F.W. |last2=Jordan |date=19 September 1919 |url=https://archive.org/details/electricaljourna83lond#page/298/mode/2up |title=A trigger relay utilizing three-electrode thermionic vacuum tubes |journal=The Electrician |volume=83 |page=298}}
*  Reprinted in:  {{cite journal |first=W.H. |last=Eccles  |first2=F.W. |last2=Jordan |date=December 1919 |url=https://babel.hathitrust.org/cgi/pt?id=mdp.39015021318277;view=1up;seq=165 |title=A trigger relay utilizing three-electrode thermionic vacuum tubes |journal=The Radio Review |volume=1 |issue=3 |pages=143–6}}
*  Summary in:  {{cite book |first=W.H. |last=Eccles  |first2=F.W. |last2=Jordan |date=1919 |chapter-url=https://archive.org/stream/reportofbritisha20adva#page/270/mode/2up |chapter=A trigger relay utilising three electrode thermionic vacuum tubes |title=Report of the Eighty-seventh Meeting of the British Association for the Advancement of Science:  Bournemouth:  1919, September 9–13 |pages=271–2}}</ref> इसे प्रारंभ में एक्लेस-जॉर्डन ट्रिगर परिपथ कहा जाता था और इसमें दो सक्रिय तत्व (वैक्यूम ट्यूब) सम्मिलित थे।<ref>{{cite book |first1=Emerson W. |last1=Pugh |first2=Lyle R. |last2=Johnson |first3=John H. |last3=Palmer |title=IBM's 360 and early 370 systems |url=https://archive.org/details/ibms360early370s0000pugh |url-access=registration |date=1991 |publisher=MIT Press |isbn=978-0-262-16123-7 |page=[https://archive.org/details/ibms360early370s0000pugh/page/10 10]}}</ref> इस डिजाइन का उपयोग 1943 के ब्रिटिश कोलोसस कंप्यूटर में किया गया था<ref>{{Citation | last = Flowers |first= Thomas H. |author-link=Tommy Flowers |url=http://www.ivorcatt.com/47c.htm | title =The Design of Colossus |journal=Annals of the History of Computing |volume=5 |issue=3 |year= 1983|page=249 |doi=10.1109/MAHC.1983.10079|s2cid= 39816473 }}</ref> और इस प्रकार के परिपथ और उनके ट्रांजिस्टर किए गए संस्करण एकीकृत परिपथ की प्रारम्भ के पश्चात भी कंप्यूटर में सामान्य थे, चूँकि लॉजिक गेट्स से बने फ्लिप-फ्लॉप भी वर्तमान सामान्य हैं।<ref>{{cite book |first=Earl D. |last=Gates |title=Introduction to electronics |url=https://books.google.com/books?id=IwC5GIA0cREC |edition=4th |date=2000 |publisher=Delmar Thomson (Cengage) Learning |isbn=978-0-7668-1698-5 |page=299}}</ref><ref>
{{cite book
 |first1=Max |last1=Fogiel
 |first2=You-Liang |last2=Gu
 |title=The Electronics problem solver, Volume 1
 |url=https://books.google.com/books?id=6oXuRAAACAAJ
 |edition=revised |date=1998
 |publisher=Research & Education Assoc.
 |isbn=978-0-87891-543-9
 |page=1223
}}</ref> प्रारंभिक फ्लिप-फ्लॉप को ट्रिगर परिपथ या मल्टीविब्रेटर के रूप में विभिन्न रूप से जाना जाता था।

पी एल लिंडले के अनुसार, यूएस जेट प्रोपल्शन लेबोरेटरी के इंजीनियर नीचे दिए गए फ्लिप-फ्लॉप प्रकार (SR डी टी जेके) को पहली बार मॉन्टगोमरी फिस्टर द्वारा कंप्यूटर डिजाइन पर 1954 के यूसीएलए पाठ्यक्रम में चर्चा की गई थी और फिर उनके सामने दिखाई दिए।डिजिटल कंप्यूटरों के लॉजिकल डिजाइन बुक करें।<ref>{{cite journal |first=P.L. |last=Lindley |date=August 1968 |journal=[[EDN (magazine)|EDN]] |title=letter dated June 13, 1968}}</ref><ref>
{{cite book
 |title = Logical Design of Digital Computers.
 |first=Montgomery |last=Phister
 |publisher = Wiley
 |year = 1958
 |page = 128
 |isbn=9780608102658 |url = https://books.google.com/books?id=Ri1IAAAAIAAJ
}}</ref> लिंडले उस समय एल्ड्रेड नेल्सन के अनुसार ह्यूजेस एयरक्राफ्ट में कार्य कर रहे थे, जिन्होंने फ्लिप-फ्लॉप के लिए जेके शब्द गढ़ा था, जो दोनों इनपुट्स ( लॉजिकल) पर होने पर स्टेटों को बदल दिया था। अन्य नामों को फिस्टर द्वारा बनाया गया था। वह नीचे दी गई कुछ परिभाषाओं से थोड़ा भिन्न होते हैं। लिंडले बताते हैं कि उन्होंने एल्ड्रेड नेल्सन से जेके फ्लिप-फ्लॉप की कहानी सुनी, जो ह्यूजेस एयरक्राफ्ट में कार्य करते समय इस शब्द के लिए उत्तरदायी है। उस समय ह्यूजेस में उपयोग में फ्लिप-फ्लॉप सभी प्रकार के थे। जिन्हें जे-के के रूप में जाना जाता था। लॉजिकल प्रणाली को डिजाइन करने में नेल्सन ने फ्लिप-फ्लॉप इनपुट्स को पत्र प्रदान किये हैं। जो निम्नानुसार हैं: #1:A & B, #2: C & D, #3: E & F, #4: G & H, #5:J & K। नेल्सन ने 1953 में दिए गए पेटेंट आवेदन में नोटेशन ''j''-इनपुट और k-इनपुट का उपयोग किया।<ref>{{cite patent|country=US|number=2850566|title=High-speed printing system|pubdate=1958-09-02|assign1=[[Hughes Aircraft Co.]]|inventor1-last=Nelson|inventor1-first=Eldred C.|quote = Each flip-flop or bistable multivibrator includes two input terminals, hereinafter termed the j-input and the k-input terminals, respectively, and two output terminals for producing complementary bivalued electrical output signals hereinafter termed Q and Qbar, respectively. Signals applied separately to the j-input and k-input terminals set the flip-flop to conduction states corresponding to the binary values one and zero, respectively, while signals applied simultaneously to both input terminals trigger or change the conduction state of the flip-flop.}}</ref>


== कार्यान्वयन ==
[[File:TTL flip-flop.svg|thumb|right|200px|द्विध्रुवी जंक्शन ट्रांजिस्टर पर आधारित कन्वेंशनल (सरल) फ्लिप-फ्लॉप परिपथ]]
पारदर्शी या अतुल्यकालिक कुंडी को क्रॉस-युग्मित इनवर्टिंग तत्वों की जोड़ी के साथ बनाया जा सकता है। वैक्यूम ट्यूब, द्विध्रुवी ट्रांजिस्टर, फील्ड इफ़ेक्ट ट्रांजिस्टर, इनवर्टर और इनवर्टिंग लॉजिक गेट्स आदि सभी का उपयोग पार्शियल परिपथ में किया गया है।<ref name="pedroni">{{cite book|first=Volnei A. |last=Pedroni |title=Digital electronics and design with VHDL |url=https://books.google.com/books?id=-ZAccwyQeXMC |date=2008 |publisher=Morgan Kaufmann |isbn=978-0-12-374270-4 |page=329}}</ref> <ref name="ee42">[http://rfic.eecs.berkeley.edu/ee100/pdf/lect24.pdf Latches and Flip Flops] (EE 42/100 Lecture 24 from Berkeley)  ''"...Sometimes the terms flip-flop and latch are used interchangeably..."''</ref>

क्लॉक्ड फ्लिप-फ्लॉप विशेष रूप से सिंक्रोनस प्रणाली के लिए डिज़ाइन किए गए हैं। ऐसे उपकरण समर्पित क्लॉक सिग्नल (जिसे क्लॉकिंग, पल्सिंग या स्ट्रोबिंग के रूप में जाना जाता है) के ट्रांजीशन को छोड़कर अपने इनपुट को अनदेखा कर देते हैं। क्लॉकिंग के कारण फ्लिप-फ्लॉप या तब बदल जाता है या ट्रांजीशन के समय इनपुट सिग्नल के मूल्यों के आधार पर अपने आउटपुट सिग्नल को बनाए रखता है। कुछ फ्लिप-फ्लॉप क्लॉक के बढ़ते किनारे पर आउटपुट बदलते हैं और अन्य फल्लिंग एज पर भी आउटपुट बदलते है।

चूँकि प्राथमिक प्रवर्धन चरण विपरीत होते हैं, इसलिए आवश्यक गैर-इनवर्टिंग एम्पलीफायर बनाने के लिए दो लेवल्स को क्रमिक रूप से (कैस्केड के रूप में) जोड़ा जा सकता है। इस कॉन्फ़िगरेशन में प्रत्येक एम्पलीफायर को अन्य इनवर्टिंग एम्पलीफायर के लिए सक्रिय इनवर्टिंग फीडबैक नेटवर्क के रूप में माना जा सकता है। इस प्रकार दोनों चरण गैर-इनवर्टिंग लूप में जुड़े हुए हैं, चूँकि परिपथ आरेख सामान्यतः सममित क्रॉस-युग्मित जोड़ी के रूप में खींचा जाता है (दोनों चित्र प्रारभ में एक्लेस-जॉर्डन पेटेंट में प्रस्तुत किए गए हैं)।

== फ्लिप-फ्लॉप प्रकार ==
फ्लिप-फ्लॉप को सामान्य प्रकारों में विभाजित किया जा सकता है: '''SR''' (सेट-रिसेट), '''D''' (डेटा या डिले<ref>
{{cite book
 |first=Sajjan G. |last=Shiva
 |title=Computer design and architecture
 |url=https://books.google.com/books?id=kKQFttdG7hcC
 |edition=3rd
 |year=2000
 |publisher=CRC Press
 |isbn=978-0-8247-0368-4
 |page=81
}}</ref>), '''T''' (टॉगल) और '''JK'''। किसी विशेष प्रकार के व्यवहार को वर्णित किया जा सकता है। जिसे विशेषता समीकरण कहा जाता है, जो अगले (अर्थात अगली क्लॉक पल्स के पश्चात) आउटपुट प्राप्त करता है, {{math|<VAR>Q</VAR><SUB>next</SUB>}} इनपुट सिग्नल (S) और वर्तमान आउटपुट <math>Q</math> के संदर्भ में प्रयोग होता है।

=== सिंपल सेट-रेसेट लैच ===

बिल्डिंग ब्लॉक के रूप में स्टेटिक गेट्स का उपयोग करते समय सबसे मौलिक लैच सरल ''SR'' लैच है। जहां S और R सेट और रिसेट के लिए खड़े होते हैं। इसका निर्माण क्रॉस-युग्मित नोर गेट या एनएएनडी गेट लॉजिक गेट्स की जोड़ी से किया जा सकता है। संग्रहीत बिट आउटपुट चिह्नित Q पर उपस्थित है।

==== SR NOR लैच ====
[[File:R-S mk2.gif|thumb|right|'''SR''' लैच का एनीमेशन, जो क्रॉस-युग्मित और न ही गेट्स की जोड़ी से निर्मित है। लाल और काले अर्थ लॉजिकल '1' और '0' क्रमशः।]]
[[File:SRLatch-lowres.gif|thumbnail|एनिमेटेड RS लैच। ब्लैक एंड व्हाइट का अर्थात लॉजिकल '1' और '0' है।{{ordered list
 | list_style=margin:0; list-style-position:inside;
 | list-style-type=upper-alpha
 | 1=S = 1, R = 0: सेट
 | 2=S = 0, R = 0: होल्ड
 | 3=S = 0, R = 1: रिसेट
 | 4=S = 1, R = 1: अनुमति नहीं
}}
प्रतिबंधित संयोजन (D) से (A) से ट्रांजीशन अस्टेबल स्टेट की ओर जाता है।]]
जबकि S और R इनपुट दोनों कम हैं, प्रतिक्रिया Q और {{overline|Q}} निरंतर स्टेट में आउटपुट के साथ बनाए रखता है। यदि S (सेट) को उच्च स्पंदित किया जाता है, जबकि R (रिसेट) कम आयोजित किया जाता है। तब Q आउटपुट को उच्च स्तर पर रखा जाता है और जब S के कम पर लौटता है, तब Q आउटपुट को उच्च स्तर पर रखा जाता है। इसी प्रकार यदि R को उच्च स्पंदित किया जाता है, जबकि S को कम रखा जाता है, तब Q आउटपुट को कम करने के लिए वाध्य किया जाता है और जब R कम पर लौटता है, तब कम रहता है।

: {| class="wikitable" style="text-align:center;"
|+ SR लैच ऑपरेशन<ref name="Roth, Charles H 1995"/>
|-
! colspan="4" |  [[State transition table|विशेषता सारिणी]] 
! colspan="4" | [[Excitation table|एक्सिटेसन सारिणी]]
|-
! S !! R !! Q<sub>next</sub> !! Action
! Q !! Q<sub>next</sub> !! S !! R
|-
| 0 || 0 || Q || होल्ड स्टेट
| 0 || 0 || 0 || {{n/a|X}}
|-
| 0 || 1 || 0 || रिसेट
| 0 || 1 || 1 || 0
|-
| 1 || 0 || 1 || सेट
| 1 || 0 || 0 || 1
|-
| 1 || 1 || {{n/a|X}} || अनुमति नही
| 1 || 1 || {{n/a|X}} || 0
|}
नोट: X का अर्थ है कि अन्य आवश्यकतानहीं है अर्थात 0 या 1 मान्य मान है।

R = S = 1 संयोजन को 'प्रतिबंधित संयोजन' या 'निषिद्ध स्टेट' कहा जाता है क्योंकि दोनों न ही गेट्स के रूप में फिर आउटपुट शून्य, यह लॉजिकल समीकरण Q = '''not''' 'Q' को विच्छेदित करता है। यह संयोजन परिपथ में भी अनुचित है। जहां दोनों इनपुट साथ कम हो सकते हैं (अर्थात रखने के लिए प्रतिबंधित से ट्रांजीशन)। गेट्स (रेस की स्टेट) के मध्य प्रसार समय संबंधों के आधार पर आउटपुट 1 या 0 पर लॉक होगा।[[File:SR NOR Latch How to Work Ver1 Dong-Gyu Jang 20200309.png|alt=| अंगूठा | कैसे एक एसआर और न ही कुंडी काम करता है।]]प्रतिबंधित संयोजन को दूर करने के लिए, कोई भी इनपुट में गेट जोड़ सकता है। जो<code>(S, R) = (1, 1)</code> गैर-प्रतिबंधित संयोजनों में से एक के लिए परिवर्तित होगा। वो हो सकता है:

* Q = 1 (1, 0)- ''S'' (डोमिनेटेड) के रूप में संदर्भित किया गया
* Q = 0 (0, 1)- ''R'' (डोमिनेटेड) के रूप में संदर्भित किया गया

यह लगभग प्रत्येक प्रोग्रामेबल लॉजिक कंट्रोलर में किया जाता है।
* स्टेट रखें (0, 0) ''E''-लैच के रूप में संदर्भित

वैकल्पिक रूप से, प्रतिबंधित संयोजन आउटपुट को टॉगल करने के लिए बनाया जा सकता है। परिणाम JK लैच प्राप्त होता है।

SR लैच के लिए विशेषता समीकरण है:
: <math>Q_\text{next} = \bar{R}Q + \bar{R}S</math> या <math>Q_\text{next} = \bar{R}(Q + S).</math><ref>
{{cite book
 |last1=Langholz |first1=Gideon
 |first2=Abraham |last2=Kandel
 |first3=Joe L. |last3=Mott
 |title=Foundations of Digital Logic Design
 |url=https://books.google.com/books?id=4sX9fTGRo7QC
 |date=1998
 |publisher=World Scientific
 |isbn=978-981-02-3110-1
 |page=344
}}</ref>
अन्य अभिव्यक्ति है:
: <math>Q_\text{next} = S + \bar{R}Q</math> साथ <math>SR = 0</math><ref>[https://www.ee.usyd.edu.au/tutorials/digital_tutorial/part3/fl-types.htm "Summary of the Types of Flip-flop Behaviour"]. Retrieved on 16 April 2018.</ref>


===={{overline|SR}} NAND लैच ====
[[File:SR Flip-flop Diagram.svg|thumb|right|{{overline|SR}} क्रॉस-युग्मित NAND गेट से निर्मित लैच।]]
नीचे दिखाया गया परिपथ मूल NAND लैच है। इनपुट सामान्यतः सेट और रीसेट के लिए क्रमशः ''S'' और R प्रदान किए जाते हैं क्योंकि NAND इनपुट को सामान्य रूप से लॉचिंग 1 को प्रभावित करने से बचने के लिए लॉजिक 1 होना चाहिए, इनपुट को इस परिपथ (या सक्रिय कम) में विपरीत माना जाता है।

परिपथ नियंत्रित इनपुट सिग्नलन को बदलने के पश्चात भी अपनी लॉजिकल स्टेट को याद रखने और बनाए रखने के लिए प्रतिक्रिया का उपयोग करता है। जब ''S'' और R इनपुट दोनों उच्च होते हैं, तब प्रतिक्रिया पिछले स्टेट में Q आउटपुट को बनाए रखती है।
{|
|-
|
{| class="wikitable"
 |+ {{overline|SR}} लैच ऑपरेशन
 |-
 ! {{overline|S}} !! {{overline|R}} !!कार्य
 |-
 | 0 || 0 || Q = 1, {{overline|Q}} = 1; अनुमति नहीं
 |-
 | 0 || 1 || Q = 1
 |-
 | 1 || 0 || Q = 0
 |-
 | 1 || 1 || कोई परिवर्तन नहीं
|}
| [[File:Inverted SR latch symbol.png|frame|प्रत्येक के लिए प्रतीक {{overline|SR}} NAND की लैच]]
|}

==== SR AND-OR लैच ====
[[File:RS-and-or-flip-flop.png|thumb|SR AND-OR हल्के रंग का अर्थात लॉजिकल '1' और गहरे हरे रंग का अर्थ लॉजिकल '0' है। लैच वर्तमान में होल्ड मोड (कोई परिवर्तन नहीं) में है।]]
शिक्षण दृष्टिकोण से क्रॉस-युग्मित घटकों (ट्रांजिस्टर, गेट्स, ट्यूब आदि) की जोड़ी के रूप में तैयार किए गए SR लैच को अधिकांशतः प्रारंभिक लोगो के लिए समझना कठिन होता है। क्रॉस-कपलिंग के स्थान पर एकल प्रतिक्रिया लूप के रूप में लैच को खींचने के लिए सरल उपाय है।निम्नलिखित SR लैच है। जो AND गेट के साथ इन्वर्टर (लॉजिक गेट) इनपुट और OR गेट के साथ बनाया गया है। ध्यान दें कि इन्वर्टर को लैच कार्यक्षमता के लिए आवश्यक नहीं है, किंतु दोनों इनपुट को उच्च सक्रिय बनाने के लिए है।
: {| class="wikitable"
|+ SR AND-OR लैच ऑपरेशन
|-
! S !! R !! कार्य
|-
| 0 || 0 || कोई परिवर्तन नहीं
|-
| 1 || 0 || Q = 1
|-
| {{n/a|X}} || 1 || Q = 0
|}
ध्यान दें कि SR AND-OR लैच का लाभ है कि S = 1, R = 1 अच्छी प्रकार से परिभाषित है। SR AND-OR लैच के उपरोक्त संस्करण में यह S सिग्नल पर R सिग्नल को प्राथमिकता देता है। यदि S से अधिक R की प्राथमिकता की आवश्यकता है, तब यह आउटपुट Q को AND गेट के आउटपुट के स्थान पर आउटपुट OR को कनेक्ट करके प्राप्त किया जा सकता है।

SR AND-OR लैच को समझना सरल है क्योंकि दोनों गेटों की विभिन्नता को समझाया जा सकता है। जब S या R सेट नहीं किया जाता है, तब OR गेट और AND गेट दोनों होल्ड मोड में होते हैं अर्थात उनका आउटपुट फीडबैक लूप से इनपुट है। जब इनपुट S = 1 तब OR गेट का आउटपुट 1 हो जाता है, फीडबैक लूप (सेट मोड) से अन्य इनपुट की देखरेख किए बिना ही प्रयोग किया जाता है। जब इनपुट R = 1 तब AND गेट का आउटपुट 0 हो जाता है, तब फीडबैक लूप (रीसेट मोड) से अन्य इनपुट की देखरेख किए बिना ही प्रयोग करते है और चूंकि आउटपुट Q सीधे AND गेट के आउटपुट से जुड़ा हुआ है, इसलिए R की प्राथमिकता S है। क्रॉस-युग्मित गेट के रूप में खींची गई कुंडी कम सहज लग सकती है क्योंकि गेट का व्यवहार दूसरे गेट के साथ जुड़ा हुआ प्रतीत होता है।

ध्यान दें कि SR AND-OR लैच को SR में बदल दिया जा सकता है और न ही लॉजिक परिवर्तनों का उपयोग करके लैच या गेट के आउटपुट को इनवर्ट करना और गेट का दूसरा इनपुट और इन दो जोड़े गए इनवर्टर के मध्य विपरीत Q आउटपुट को कनेक्ट करना; डी मॉर्गन के नियम.के अनुसार दोनों इनपुट AND के साथ और NOR गेट के सामान्तर होने वाले गेट के साथ प्रयोग होता है।

==== JK लैच ====
JK लैच, JK फ्लिप-फ्लॉप की तुलना में बहुत कम अधिकांशतः उपयोग किया जाता है। JK लैच निम्न स्टेट सारणी का अनुसरण करती है।

: {| class=wikitable
|+ JK लैच ट्रुथ टेबल
|-
! J !! K !! Q<sub>next</sub> !! कमेंट
|-
| 0 || 0 || Q                || कोई परिवर्तन नहीं
|-
| 0 || 1 || 0                || रिसेट
|-
| 1 || 0 || 1                || सेट
|-
| 1 || 1 || {{overline|Q}}   || टॉगल
|}
इसलिए JK लैच, SR लैच है। जो 11 के इनपुट संयोजन को पास करने पर इसके आउटपुट (0 और 1 के मध्य दोलन) को टॉगल करने के लिए बनाई जाती है।<ref>{{cite book |first1=Diederich |last1=Hinrichsen |first2=Anthony J. |last2=Pritchard |chapter=Example 1.5.6 (R–S latch and J–K latch) |title=Mathematical Systems Theory I: Modelling, State Space Analysis, Stability and Robustness |date=2006 |publisher=Springer |isbn=9783540264101|pages=63–64 |chapter-url=https://books.google.com/books?id=u4JYt7OdptYC&pg=PA63}}</ref> JK फ्लिप-फ्लॉप के विपरीत, JK लैच के लिए 11 इनपुट संयोजन बहुत उपयोगी नहीं है क्योंकि कोई क्लॉक नहीं है, जो टॉगलिंग को निर्देशित करती है।<ref>{{cite book |first=Hassan A. |last=Farhat |title=Digital design and computer organization |volume=1 |url=https://books.google.com/books?id=jwZZcgAACAAJ |year=2004 |publisher=CRC Press |isbn=978-0-8493-1191-8 |page=274}}</ref>


=== गेटेड लैच और नियमानुसार पारदर्शिता ===
लैच को पारदर्शी होने के लिए डिज़ाइन किया गया है।अर्थात् इनपुट सिग्नल परिवर्तन आउटपुट में शीघ्र परिवर्तन का कारण बनते हैं।अतिरिक्त लॉजिक को साधारण पारदर्शी लैच में जोड़ा जा सकता है, जिससे इसे गैर-पारदर्शी या अपारदर्शी बनाया जा सके, जब किसी अन्य इनपुट (इनेबल इनपुट) को मुखर नहीं किया जाता है। जब अनेक पारदर्शी लैच एक-दूसरे का अनुसरण करते हैं, तब इनेबल सिग्नल का उपयोग करते हुए सिग्नल उन सभी के माध्यम से प्रचार कर सकते हैं। चूँकि पारदर्शी-लो (या अपारदर्शी-उच्च) लैच के साथ पारदर्शी-उच्च लैच का पालन करके मास्टर-स्लेव फ्लिप-फ्लॉप संचालित किया जाता है।

==== गेटेड SR लैच ====
[[File:NAND Gated SR Latch.png|thumb|NAND गेटेड SR लैच (SR फ्लिप-फ्लॉप)। विपरीत इनपुट पर ध्यान दें।]]
[[File:SR (Clocked) Flip-flop Diagram.svg|frame|गेटेड SR लैच परिपथ आरेख AND गेट गेट्स (बाएं पर) और न ही NOR गेट्स (दाएं) से निर्मित।]]
सिंक्रोनस SR लैच (संभवतः क्लॉक की गई SR फ्लिप-फ्लॉप) को 'विपरीत' SR लैच (या 'डायरेक्ट' SR लैच के लिए दूसरे स्तर और गेट्स के दूसरे स्तर के NAND गेट्स को जोड़कर बनाया जा सकता है।

वैकल्पिक रूप से गेटेड SR लैच (नॉन-इनवर्टिंग इनेबल के साथ) SR लैच में दूसरे स्तर के AND गेट्स जोड़कर बनाया जा सकता है।

E हाई (ट्रू करने में इनेबल) के साथ सिग्नल इनपुट गेट्स के माध्यम से एनकैप्सुलेटेड लैच से गुजर सकते हैं। (0, 0) = को छोड़कर सभी सिग्नल संयोजनों को छोड़कर, फिर शीघ्र (Q, {{overline|Q}}) आउटपुट उत्पन्न करता है अर्थात लैच पारदर्शी है।

E- लो (फाल्स को इनेबल करें) के साथ लैच संवृत है (अपारदर्शी) और स्टेट में रहता है। यह अंतिम बार छोड़ दिया गया था, जब E-उच्च था।

इनेबल इनपुट सभवतः क्लॉक सिग्नल होता है, किन्तुअधिक बार पढ़ने या लिखने वाला स्ट्रोब होता है। जब इनेबल इनपुट क्लॉक सिग्नल होता है, तब लैच को लेवल-सेंसिटिव (क्लॉक सिग्नल के स्तर पर) कहा जाता है, जैसा कि नीचे दिए गए फ्लिप-फ्लॉप जैसे एज-सेसिटिव के विपरीत होता है।

{| style="text-align:center; margin:1em auto 1em auto;"
|- style="vertical-align: center;"
|
{| class="wikitable" style="text-align:center; margin:1em auto 1em auto;"
 |+ Gated SR latch operation
 |-
 ! width="40" | E/C !! कार्य
 |-
 | 0 || कोई कार्य 
 |-
 | 1 ||नॉन-क्लॉक्ड SR लैच के समान
|}
| [[File:Gated SR flip-flop Symbol.svg|frame|गेटेड SR लैच के लिए प्रतीक]]
|}

==== गेटेड D लैच ====
यह लैच इस तथ्य का लाभ उठाती है कि दो सक्रिय इनपुट संयोजनों (01 और 10) में गेटेड SR लैच में, R S का पूरक है। इनपुट NAND चरण दो D इनपुट स्टेटों (0 और 1) को इन दो इनपुट में अगले के लिए संयोजन {{overline|SR}} डेटा इनपुट सिग्नल को इनवर्ट करके लैच परिवर्तित करता है। इनेबल सिग्नल की निम्न स्टेट निष्क्रिय 11 संयोजन का उत्पादन करती है। इस प्रकार गेटेड D-लैच को इनपुट सिंक्रोनस SR लैच के रूप में माना जा सकता है। यह कॉन्फ़िगरेशन प्रतिबंधित इनपुट संयोजन के अनुप्रयोग को रोकता है। इसे पारदर्शी लैच, डेटा लैच या बस गेटेड लैच के रूप में भी जाना जाता है। इसमें डेटा इनपुट और इनेबल सिग्नल (संभवतः क्लॉक या नियंत्रण का नाम) होता है। पारदर्शी शब्द इस तथ्य से आता है कि जब इनेबल इनपुट प्रारभहोता है, तब सिग्नल परिपथ के माध्यम से सीधे इनपुट D से आउटपुट Q तक फैलता है। गेटेड D-लैच भी 'लेवल-सेंसिटिव' हैं, जो कि स्तर के संबंध में क्लॉक या इनेबल सिग्नल है। 

पारदर्शी लैच सामान्यतः I/O पोर्ट या अतुल्यकालिक प्रणालियों में या सिंक्रोनस दो-चरण प्रणालियों (सिंक्रोनस प्रणाली जो दो-चरण क्लॉक का उपयोग करते हैं) के रूप में उपयोग की जाती हैं, जहां विभिन्न क्लॉक लेवल पर कार्य करने वाली दो लैच मास्टर-स्लेव फ्लिप-फ्लॉप के समान डेटा पारदर्शिता को रोकती हैं।

नीचे दी गई ट्रुथ सारणी से पता चलता है कि जब इनेबल/क्लॉक इनपुट 0 है, तब D इनपुट का आउटपुट पर कोई प्रभाव नहीं पड़ता है। जब E/C अधिक होता है, तब आउटपुट D के सामान्तर होता है।
{| style="text-align:center; margin:1em auto 1em auto;"
|-
|
{| class="wikitable" style="text-align:center; margin:1em auto 1em auto;"
 |+ Gated D latch truth table
 |-
 ! width=40 | E/C
 ! width=40 | D
 | rowspan=4 |
 ! width=40 | Q
 ! width=40 | {{overline|Q}}
 ! width=80 | Comment
 |-
 | 0 || {{n/a|X}} || Q<sub>prev</sub> || {{overline|Q}}<sub>prev</sub> || कोई परिवर्तन नहीं
 |-
 | 1 || 0 || 0 || 1 || रिसेट
 |-
 | 1 || 1 || 1 || 0 || सेट
|}
| [[File:Transparent Latch Symbol.svg|frame|गेटेड D लैच के लिए प्रतीक]]
|}

<gallery class="center" mode="packed" heights="150px">
File:D-Type Transparent Latch.svg|alt=Schematic diagram|A gated D latch based on an {{overline|SR}} NAND latch
File:D-type Transparent Latch (NOR).svg|A gated D latch based on an SR NOR latch
File:GatedDLatch-lowres.gif|An animated gated D latch.  Black and white mean logical '1' and '0', respectively.{{ordered list | list_style=margin:0; list-style-position:inside; | list-style-type=upper-alpha | 1= D = 1, E = 1: set | 2= D = 1, E = 0: hold | 3= D = 0, E = 0: hold | 4= D = 0, E = 1: reset}}
File:Multiplexer-based latch using transmission gates.svg|A gated D latch in [[pass transistor logic]], similar to the ones in the CD4042 or the CD74HC75 integrated circuits.
</gallery>


==== अर्ल लैच ====
क्लासिक गेटेड लैच डिजाइनों में कुछ अवांछनीय विशेषताएं हैं।<ref name="kogge">{{cite book| last = Kogge| first = Peter M.| title = The Architecture of Pipelined Computers| year = 1981| publisher = McGraw-Hill| isbn = 0-07-035237-2| pages = 25–27 }}</ref> उन्हें डबल-रेल लॉजिक या इन्वर्टर की आवश्यकता होती है। इनपुट-टू-आउटपुट प्रसार तीन गेट डिले तक ले जा सकता है। इनपुट-टू-आउटपुट प्रसार स्थिर नहीं है। कुछ आउटपुट दो गेट डिले लेते हैं, जबकि अन्य तीन लेते हैं।

डिजाइनरों ने विकल्पों की खोज की।<ref>
{{Cite journal
 |last= Cotten
 |first= L. W.
 |title= Circuit Implementation of High-Speed Pipeline Systems
 |journal= AFIPS Proc. Fall Joint Computer Conference
 |pages= 489–504
 |year= 1965
 |doi=10.1145/1463891.1463945 
|s2cid= 15955626
 }}</ref> सफल विकल्प अर्ल लैच है। इसके लिए केवल एक ही डेटा इनपुट की आवश्यकता होती है, और इसका आउटपुट निरंतर दो गेट डिले लेता है। इसके अतिरिक्त अर्ल लैच के दो गेट स्तर, कुछ स्थितियों में, लेच को चलाने वाले परिपथ के अंतिम दो गेट स्तरों के साथ विलय कर सकते हैं क्योंकि अनेक सामान्य कम्प्यूटेशनल परिपथ में परत होती है, जिसके पश्चात एएन और परत उनके अंतिम दो स्तरों के रूप में होती है। लैच फलन को विलय करने से कोई अतिरिक्त गेट डिले के साथ लैच को संचालित किया जा सकता है।<ref name=kogge/> मर्ज का सामान्रयतः पाइपलाइन वाले कंप्यूटरों के डिजाइन में उपयोग किया जाता है और मूल रूप से जॉन जी अर्ल द्वारा विकसित किया गया था, जिससे उस उद्देश्य के लिए आईबीएम प्रणाली/360 मॉडल 91 में उपयोग किया जा सके।<ref>
{{Cite journal
 |last= Earle
 |first= John G.
 |title= Latched Carry-Save Adder
 |journal= IBM Technical Disclosure Bulletin
 |volume= 7
 |issue= 10
 |date= March 1965
 |pages= 909–910
}}</ref>

अहैजार्ड मुक्त है।<ref name="omondi">
{{cite book| last = Omondi| first = Amos R.| title = The Microarchitecture of Pipelined and Superscalar Computers| url = https://books.google.com/books?id=Pf2ZbKM2-5MC| date = 1999 | publisher = Springer| isbn = 978-0-7923-8463-2| pages = 40–42
}}</ref> यदि मध्य NAND गेट को छोड़ दिया जाता है, तब किसी को ध्रुवीयता पकड़ की लैच मिलती है, जिसका सामान्यतः उपयोग किया जाता है क्योंकि यह लो लॉजिक की मांग करता है।<ref name="omondi" /><ref name="kunkel">
{{Cite journal
 |first1= Steven R. |last1= Kunkel
 |first2= James E. |last2= Smith
 |title= Optimal Pipelining in Supercomputers
 |pages= 404–411 [406]
 |journal= ACM SIGARCH Computer Architecture News
 |volume= 14
 |issue= 2
 |date= May 1986
 |publisher= ACM
 |issn=0163-5964
 |citeseerx=10.1.1.99.2773
 |doi= 10.1145/17356.17403
|s2cid= 2733845
 }}</ref> चूँकि यह मेटास्टेबिलिटी के लिए अतिसंवेदनशील है।जानकर क्लॉक के सिग्नल को तिरछा करने से खतरे से बच सकते हैं।<ref name="kunkel" /><gallery class="center" mode="packed" heights="250px">
File:SVG Earle Latch.svg|Earle latch uses complementary enable inputs: enable active low (E_L) and enable active high (E_H)
File:EarleLatch-lowres.gif|An animated Earle latch.  Black and white mean logical '1' and '0', respectively.{{ordered list | list_style=margin:0; list-style-position:inside; | list-style-type=upper-alpha | 1= D = 1, E_H = 1: set | 2= D = 0, E_H = 1: reset | 3= D = 1, E_H = 0: hold}}
</gallery>


=== D फ्लिप-फ्लॉप ===

[[File:D-Type Flip-flop.svg|frame|right|D फ्लिप-फ्लॉप प्रतीक]]
D फ्लिप-फ्लॉप का व्यापक रूप से उपयोग किया जाता है। इसे डेटा या विलंब फ्लिप-फ्लॉप के रूप में भी जाना जाता है।

D फ्लिप-फ्लॉप क्लॉक चक्र के निश्चित भाग (जैसे क्लॉक के बढ़ते किनारे) पर डी-इनपुट के मूल्य को कैप्चर करता है। यह कैप्चर किया गया मूल्य Q आउटपुट बन जाता है। अन्य समय में आउटपुट Q नहीं बदलता है।<ref>[http://www.play-hookey.com/digital/sequential/d_nand_flip-flop.html The D Flip-Flop<!-- Bot generated title -->]</ref><ref>{{Cite web |url=http://www.ee.usyd.edu.au/tutorials/digital_tutorial/part2/flip-flop02.html |title=Edge-Triggered Flip-flops |access-date=2011-12-15 |archive-url=https://web.archive.org/web/20130908211358/http://www.ee.usyd.edu.au/tutorials/digital_tutorial/part2/flip-flop02.html |archive-date=2013-09-08 |url-status=dead }}</ref> D फ्लिप-फ्लॉप को मेमोरी सेल, शून्य-ऑर्डर होल्ड, या एनालॉग डेली लाइन के रूप में देखा जा सकता है।<ref>[http://ieeexplore.ieee.org/xpls/abs_all.jsp?arnumber=4051207&tag=1 A Survey of Digital Computer Memory Systems]</ref>

ट्रुथ टेबल:
: {| class="wikitable" style="text-align:center;"
|-
! क्लॉक       !! D !! Q<sub>next</sub>
|-
| राईजिंग एज || 0 || 0
|-
|राईजिंग एज
| 1 || 1
|-
|नॉन-राईजिंग 
|| {{n/a|X}} || Q
|}
(X बिना देखभाल की स्थिति को प्रदर्शित करता है, जिसका अर्थ है कि सिग्नल अप्रासंगिक है)

आईसीएस में अधिकांश D-टाइप फ्लिप-फ्लॉप में सेट या रीसेट स्टेट (जो D और क्लॉक इनपुट को अनदेखा करता है) के लिए बाध्य होने की क्षमता होती है, जो कि SR फ्लिप-फ्लॉप की प्रकार है। सामान्यतः अवैध S = R = 1 स्टेट D-टाइप फ्लिप-फ्लॉप में हल की जाती है। S = R = 0 सेट करना फ्लिप-फ्लॉप को ऊपर वर्णित के रूप में व्यवहार करता है। यहाँ अन्य संभावित S और R कॉन्फ़िगरेशन के लिए ट्रुथ सारणी है:

: {| class="wikitable" style="text-align:center;" width="150"
! colspan="4" | इनपुट !! colspan="2" | आउटपुट
|-
! S !! R !! D !! > !! Q !! {{overline|Q}}
|-
| 0 || 1 || {{n/a|X}} || {{n/a|X}} || 0 || 1
|-
| 1 || 0 || {{n/a|X}} || {{n/a|X}} || 1 || 0
|-
| 1 || 1 || {{n/a|X}} || {{n/a|X}} || 1 || 1
|}

[[File:4 Bit Shift Register 001.svg|thumb|right| सीरियल-इन, पैरेलल-आउट (SIPO) शिफ्ट रजिस्टर]]
यह फ्लिप-फ्लॉप बहुत उपयोगी हैं, क्योंकि वह शिफ्ट रजिस्टरों के लिए आधार बनाते हैं, जो अनेक इलेक्ट्रॉनिक उपकरणों का अनिवार्य भाग हैं। D-टाइप पारदर्शी लैच पर D फ्लिप-फ्लॉप का लाभ यह है कि D इनपुट पिन पर सिग्नल को उस क्षण पर अतिक्रमण कर लिया जाता है, जब फ्लिप-फ्लॉप को देखा जाता है और पश्चात में D इनपुट पर परिवर्तनों को अगली क्लॉक की घटना तक इग्नोर कर दिया जाएगा।। यह अपवाद यह है कि कुछ फ्लिप-फ्लॉप में रीसेट सिग्नल इनपुट होता है, जो Q (शून्य से) रीसेट करेगा और क्लॉक के साथ या तब एसिंक्रोनस या सिंक्रोनस हो सकता है।

उपरोक्त परिपथ क्लॉक के प्रत्येक सक्रिय ट्रांजीशन पर रजिस्टर की सामग्री को दाईं ओर, बिट स्टेट में बदल देता है। इनपुट X को बाईं ओर की स्टेट में स्थानांतरित कर दिया जाता है।

==== मौलिक पॉजिटिव-एज-ट्रिगर D फ्लिप-फ्लॉप ====

{{multiple image
 | header = A few different types of edge triggered D flip‑flops
 | align = right

 | image1 = Edge triggered D flip flop.svg
 | alt1 = A positive-edge-triggered D flip-flop
 | caption1 = A positive-edge-triggered D flip-flop

 | image2 = Edge triggered D flip flop with set and reset.svg
 | alt2 = A positive-edge-triggered D flip-flop with set and reset
 | caption2 = A positive-edge-triggered D flip-flop with set and reset
}}
इस परिपथ<ref>[http://focus.ti.com/lit/ds/symlink/sn7474.pdf SN7474 TI datasheet]</ref> SR NAND लैच द्वारा कार्यान्वित दो लेवल्स से युक्त होते है| इनपुट चरण (बाईं ओर दो लैच) आउटपुट चरण (दाईं ओर एकल लैच) के लिए सही इनपुट सिग्नल सुनिश्चित करने के लिए क्लॉक और डेटा सिग्नल को संसाधित करते हैं। यदि क्लॉक कम है, तब इनपुट चरण के दोनों आउटपुट सिग्नल डेटा इनपुट की देखरेख किए बिना उच्च हैं; आउटपुट लैच अप्रभावित है और यह पिछले स्टेट को संग्रहीत करती है। जब क्लॉक सिग्नल निम्न से उच्च तक बदलता है, तब केवल आउटपुट वोल्टेज (डेटा सिग्नल के आधार पर) कम हो जाता है और आउटपुट लेच को सेट/रीसेट करता है। यदि D = 0, कम आउटपुट कम हो जाता है। यदि D = 1, उपरोक्त आउटपुट कम हो जाता है। यदि क्लॉक सिग्नल उच्च रहता है, तब आउटपुट डेटा इनपुट की देखरेख किए बिना अपने स्टेटों को रखते हैं और आउटपुट लैच को संबंधित अवस्था में रहने के लिए बाध्य करते हैं क्योंकि इनपुट लॉजिकल ज़ीरो (आउटपुट स्टेज का) सक्रिय रहता है, जबकि क्लॉक अधिक है। इसलिए आउटपुट लैच की भूमिका केवल डेटा को संग्रहीत करने के लिए है, जबकि क्लॉक निम्न है।

परिपथ gated डी लैच से निकटता से संबंधित है क्योंकि दोनों परिपथ आउटपुट के लिए दो डी इनपुट स्टेटों (0 और 1) को दो इनपुट संयोजनों (01 और 10) में परिवर्तित करते हैं {{overline|SR}} डेटा इनपुट सिग्नल को इनवर्ट करके लेच (दोनों परिपथ दो पूरक में एकल डी सिग्नल को विभाजित करते हैं {{overline|S}} तथा {{overline|R}} सिग्नल)।अंतर यह है कि गेटेड डी लैच में सरल NAND लॉजिकल फाटकों का उपयोग किया जाता है जबकि धनात्मक-किनारे-ट्रिगर डी फ्लिप-फ्लॉप में {{overline|SR}} इस उद्देश्य के लिए NAND लैच का उपयोग किया जाता है।इन लैच की भूमिका कम वोल्टेज ( लॉजिकल शून्य) का उत्पादन करने वाले सक्रिय आउटपुट को लॉक करना है;इस प्रकार धनात्मक-एज-ट्रिगर डी फ्लिप-फ्लॉप को भी  गेटेड डी लैच के रूप में माना जा सकता है, जिसमें इनपुट गेट्स हैं।

==== मास्टर-स्लेव एज-ट्रिगर D फ्लिप-फ्लॉप ====
[[File:Negative-edge triggered master slave D flip-flop.svg|thumb|right|300px|मास्टर-स्लेव डी फ्लिप-फ्लॉप।यह इनेबल इनपुट के गिरने वाले किनारे पर प्रतिक्रिया करता है (सामान्यतः क्लॉक)]]
[[File:D-Type Flip-flop Diagram.svg|thumb|right|300px|मास्टर-स्लेव D फ्लिप-फ्लॉप का कार्यान्वयन जो क्लॉक के बढ़ते किनारे पर ट्रिगर होता है]]
मास्टर-स्लेव डी फ्लिप-फ्लॉप श्रृंखला में दो गेटेड D लैच को जोड़कर और उनमें से एक को इनेबल इनपुट को इनवर्ट करके बनाया जाता है। इसे मास्टर-स्लेव कहा जाता है क्योंकि मास्टर लैच के आउटपुट वैल्यू Q को नियंत्रित करती है और मास्टर लैच को अपने मूल्य को पकड़ने के लिए बाध्य करती है, जब भी स्लेव लैच इनेबल होती है क्योंकि स्लेव लैच सदैव मास्टर लैच से अपने नए मूल्य की कॉपी करती है और इसके मूल्य को बदल देती है। केवल मास्टर लैच और क्लॉक सिग्नल के मूल्य में बदलाव के उत्तर में प्राप्त होता है।

पॉजिटिव एज वाले ट्रिगर मास्टर-स्लेव D फ्लिप-फ्लॉप के लिए, जब क्लॉक सिग्नल निम्न होता है (लॉजिकल 0) पहले या मास्टर D लैच (विपरीत क्लॉक सिग्नल) द्वारा देखा जाने वाला इनेबल (लॉजिकल 1) उच्च होता है। यह मास्टर लैच को इनपुट मान को संग्रहीत करने की अनुमति देता है, जब क्लॉक सिग्नल ट्रांजीशन निम्न से उच्च तक ट्रांजीशन करता है। जिस प्रकार क्लॉक सिग्नल उच्च (0 से 1) हो जाता है पहले लैच का विपरीत इनेबल कम (1 से 0) हो जाता है और मास्टर लैच के इनपुट पर देखा गया मान लॉक हो जाता है। लगभग एक साथ क्लॉक सिग्नल के साथ निम्न से उच्च (0 से 1) से दूसरे या स्लेव D लैच ट्रांजीशनों के दो बार विपरीत इनेबल करता है। यह सिग्नल को क्लॉक के बढ़ते किनारे पर वर्तमान लॉक किए गए मास्टर लैच से स्लेव लैच से निकलने की अनुमति देता है। जब क्लॉक सिग्नल निम्न (1 से 0) पर लौटता है, तब स्लेव लैच का आउटपुट लॉक हो जाता है और क्लॉक के अंतिम बढ़ते किनारे पर देखा गया मान आयोजित किया जाता है, जबकि मास्टर लैच अगले राइजिंग क्लॉक एज की तैयारी में नए मूल्यों को स्वीकार करना प्रारंभ कर देती है ।

परिपथ में बाईं ओर के इन्वर्टर को हटाने से D-टाइप फ्लिप-फ्लॉप बनता है, जो क्लॉक सिग्नल के गिरने वाले किनारे पर स्ट्रोब करता है। यह इस प्रकार की ट्रुथ सारणी है:

: {|class="wikitable" style="text-align:center;"
|-
! D !! Q !! > !! Q<sub>next</sub>
|-
| 0 || {{n/a|X}} || फालिंग || 0
|-
| 1 || {{n/a|X}} ||फालिंग
| 1
|}


==== डुअल-एज-ट्रिगर D फ्लिप-फ्लॉप ====
[[File:D-Type Flip-flop dual Diagram.svg|thumb|right|150px|ड्यूल-एज-ट्रिगर D फ्लिप-फ्लॉप का कार्यान्वयन]]
फ्लिप-फ्लॉप जो क्लॉक के बढ़ते और गिरते किनारे पर नया मान पढ़ते हैं, उन्हें डुअल-एज-ट्रिगर फ्लिप-फ्लॉप कहा जाता है। इस प्रकार के फ्लिप-फ्लॉप को दो सिंगल-एज-ट्रिगर D-टाइप फ्लिप-फ्लॉप और मल्टीप्लेक्स का उपयोग करके बनाया जा सकता है। जैसा कि छवि में दिखाया गया है।

[[File:D-Type Flip-flop dual.svg|frame|right|ड्यूल कोर -ट्रिगर D फ्लिप-फ्लॉप का परिपथ प्रतीक]]


==== एज-ट्रिगर डायनेमिक D स्टोरेज एलिमेंट ====
[[File:True single-phase edge-triggered flip-flop with reset.svg|thumb|300px|right|रीसेट के साथ  डायनेमिक एज-ट्रिगर फ्लिप-फ्लॉप का सीएमओएस आईसी कार्यान्वयन]]
D फ्लिप-फ्लॉप के लिए कुशल कार्यात्मक विकल्प को गतिशील परिपथ (जहां सूचना केपासिटेंस में संग्रहीत किया जाता है) के साथ बनाया जा सकता है ,जब तक कि यह अधिकांशतः पर्याप्त नहीं होता है। जबकि ट्रुथ फ्लिप-फ्लॉप नहीं है, इसे वर्तमान समय में भी इसकी कार्यात्मक भूमिका के लिए फ्लिप-फ्लॉप कहा जाता है। जबकि मास्टर-स्लेव D तत्व को क्लॉक के किनारे पर ट्रिगर किया जाता है। इसके घटक प्रत्येक क्लॉक के स्तर से ट्रिगर होते हैं। एज-ट्रिगर D फ्लिप-फ्लॉप क्योंकि इसे कहा जाता है, तथापि यह ट्रुथ फ्लिप-फ्लॉप नहीं है और मास्टर-स्लेव गुण नहीं है।

एज-ट्रिगर D फ्लिप-फ्लॉप को अधिकांशतः डायनेमिक लॉजिक (डिजिटल इलेक्ट्रॉनिक्स) का उपयोग करके एकीकृत उच्च गति वाले संचालन में संचालित किया जाता है। इसका अर्थ यह है कि डिजिटल आउटपुट को पैरासाइट डिवाइस कैपेसिटेंस पर संग्रहीत किया जाता है, जबकि डिवाइस ट्रांजीशन नहीं कर रहा है। डायनेमिक फ्लिप फ्लॉप का यह डिज़ाइन भी सरल रीसेटिंग को इनेबल बनाता है क्योंकि रीसेट ऑपरेशन को केवल एक से अधिक आंतरिक नोड्स का निर्वहन करके किया जा सकता है। सामान्य गतिशील फ्लिप-फ्लॉप विविधता सही एकल-चरण क्लॉक (टीएसपीसी) प्रकार है, जो कम शक्ति और उच्च गति पर फ्लिप-फ्लॉप ऑपरेशन करता है। चूँकि डायनेमिक फ्लिप-फ्लॉप सामान्यतः स्थिर या कम क्लॉक की गति पर कार्य नहीं करेंगे। पर्याप्त समय को देखते हुए लीकेज पथ पैरासाइट कैपासिटेन्स को डिस्चार्ज कर सकते हैं, जिससे फ्लिप-फ्लॉप को अमान्य स्टेटों में प्रवेश करने का कारण बन सके।

=== T फ्लिप-फ्लॉप ===
[[File:T-Type Flip-flop.svg|frame|right|T-टाइप फ्लिप-फ्लॉप के लिए परिपथ प्रतीक]]
यदि T इनपुट अधिक है, तब T फ्लिप-फ्लॉप स्टेट (टॉगल) बदलता है<ref>{{cite web |title=Understanding the T Flip-Flop |url=https://www.oemsecrets.com/articles/understanding-the-t-flip-flop |website=oemsecrets.com |access-date=29 April 2021 |ref=Toggle}}</ref> जब भी क्लॉक इनपुट को स्ट्रोब किया जाता है। यदि T इनपुट कम है, तब फ्लिप-फ्लॉप पिछले मान रखता है। इस व्यवहार को विशेषता समीकरण द्वारा वर्णित किया गया है:

: <math>Q_\text{next} = T \oplus Q = T\overline{Q} + \overline{T}Q</math> (XOR गेट ऑपरेटर का विस्तार)

और ट्रुथ सारणी में वर्णित किया जा सकता है:
: {| class="wikitable" style="text-align:center;"
|+ T फ्लिप-फ्लॉप ऑपरेशन<ref name="manokime">
 {{cite book
  | last1=Mano | first1=M. Morris
  | last2=Kime | first2=Charles R.
  | title = Logic and Computer Design Fundamentals, 3rd Edition
  | year = 2004
  | publisher = Pearson Education International
  | location = Upper Saddle River, NJ, USA
  | isbn = 0-13-191165-1
  | pages = 283
 }}</ref>
|-
! colspan="4" |  [[State transition table|विशेषता सारणी]]
! colspan="5" | [[Excitation table|एक्ससिटेसन सारणी]]
|-
! <math>T</math> !! <math>Q</math> !! <math>Q_\text{next}</math> !!टिप्पणी
! <math>Q</math> !! <math>Q_\text{next}</math> !! <math>T</math> !!टिप्पणी
|-
| 0 || 0 || 0 ||होल्ड स्थिति (कोई क्लॉक नहीं)
| 0 || 0 || 0 ||कोई परिवर्तन नहीं 
|-
| 0 || 1 || 1 ||होल्ड स्थिति (कोई क्लॉक नहीं)
| 1 || 1 || 0 ||कोई परिवर्तन नहीं 
|
|-
| 1 || 0 || 1 || टॉगल
| 0 || 1 || 1 ||पूरक
|-
| 1 || 1 || 0 || टॉगल
| 1 || 0 || 1 ||पूरक
|}
जब T उच्च आयोजित किया जाता है, तब टॉगल फ्लिप-फ्लॉप क्लॉक की आवृत्ति को दो से विभाजित करता है, यदि क्लॉक की आवृत्ति 4 मेगाप्रत्येक्ट्ज है, तब फ्लिप-फ्लॉप से प्राप्त आउटपुट आवृत्ति 2 मेगाप्रत्येक्ट्ज होगी। फीचर द्वारा इस विभाजन में विभिन्न प्रकार के डिजिटल काउंटर (डिजिटल) S में एप्लिकेशन है। T फ्लिप-फ्लॉप भी JK फ्लिप-फ्लॉप का उपयोग करके बनाया जा सकता है (जम्मू-कश्मीर पिनके साथ जुड़े हुए हैं और T के रूप में कार्य करते हैं) या D फ्लिप-फ्लॉप (T इनपुट XOR Q<sub>previous</sub> D इनपुट को चलाता है)।

=== JK फ्लिप-फ्लॉप ===

[[File:JK Flip-flop (Simple) Symbol.svg|frame|right|धनात्मक-एज-ट्रिगर JK फ्लिप-फ्लॉप के लिए परिपथ प्रतीक]]
[[File:JK timing diagram.svg|thumb|right|JK फ्लिप-फ्लॉप टाइमिंग आरेख]]
JK फ्लिप-फ्लॉप J = K = 1 स्टेट को फ्लिप या टॉगल कमांड के रूप में व्याख्या करके SR फ्लिप-फ्लॉप (J: सेट, K: रिसेट) के व्यवहार को बढ़ाता है। विशेष रूप से, संयोजन K = 1,K = 0 फ्लिप-फ्लॉप सेट करने के लिए एक कमांड है। संयोजन J = 0, K = 1 फ्लिप-फ्लॉप को रीसेट करने के लिए कमांड है और संयोजन j = k = 1 फ्लिप-फ्लॉप को टॉगल करने के लिए एक कमांड है, अर्थात इसके आउटपुट को इसके वर्तमान मूल्य के लॉजिकल पूरक में बदलें। J = k = 0 सेट करना वर्तमान स्टेट को बनाए रखता है। D फ्लिप-फ्लॉप को संश्लेषित करने के लिए k के पूरक के सामान्तर k सेट करें (इनपुट J इनपुट D के रूप में कार्य करेगा)। इसी प्रकार T फ्लिप-फ्लॉप को संश्लेषित करने के लिए, जे के सामान्तर k सेट करें। JK फ्लिप-फ्लॉप इसलिए सार्वभौमिक फ्लिप-फ्लॉप है क्योंकि इसे SR फ्लिप-फ्लॉप, D फ्लिप-फ्लॉप या K रूप में कार्य करने के लिए या T फ्लिप-फ्लॉप कॉन्फ़िगर किया जा सकता है 

JK फ्लिप-फ्लॉप का विशिष्ट समीकरण है:
: <math>Q_\text{next} = J\overline Q + \overline KQ</math>
और यह ट्रुथ सारणी है:
: {|class="wikitable" style="text-align:center;"
|+ JK ट्रुथ ऑपरेशन सारणी<ref name="manokime" />
|-
! colspan="4" |  [[State transition table|विशेषता सारणी]]
! colspan="5" | [[Excitation table|एक्ससिटेसन सारणी]]
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! J !! K !!टिप्पणी
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== टाइमिंग विचार ==

=== टाइमिंग पैरामीटर ===
[[File:FF Tsetup Thold Toutput.svg|thumb|right|फ्लिप-फ्लॉप सेटअप, होल्ड और क्लॉक-टू-आउटपुट टाइमिंग पैरामीटर]]
इनपुट को एपर्चर के रूप में जाना जाने वाला क्लॉक के बढ़ते किनारे के पास की अवधि में स्थिर रखा जाना चाहिए। लिली-पैड पर मेंढक की फोटो लेने की कल्पना करें।<ref name="harris">{{cite book|last1=Harris|first1=S|last2=Harris|first2=D|title=Digital Design and Computer Architecture - ARM Edition|date=2016|publisher=Morgan Kaufmann, Waltham, MA|isbn=978-0-12-800056-4}}</ref> मान लीजिए कि मेंढक फिर पानी में कूद जाता है। यदि आप मेंढक की फोटो लेते हैं क्योंकि यह पानी में कूदता है, तब आपको पानी में कूदने वाले मेंढक की धुंधली फोटो मिलेगी। यह स्पष्ट नहीं है कि मेंढक किस स्टेट में था। किन्तु यदि आप फोटो लेते हैं, जबकि मेंढक निरंतर पैड पर (या पानी में निरंतर है) बैठता है। आपको स्पष्ट फोटो मिलेगी। उसी प्रकार फ्लिप-फ्लॉप के इनपुट को फ्लिप-फ्लॉप के एपर्चर के समान स्थिर रखा जाना चाहिए।

सेटअप समय न्यूनतम समय है, जब डेटा इनपुट को क्लॉक की घटना से पहले स्थिर रखा जाना चाहिए, जिससे डेटा को क्लॉक द्वारा तेजी से सैंपल लिया जाए।

होल्ड टाइम समय की न्यूनतम राशि है, जिसे डेटा इनपुट क्लॉक की घटना के पश्चात स्थिर रखा जाना चाहिए, जिससे डेटा को क्लॉक द्वारा तेजी से सैंपल लिया जाए।

एपर्चर सेटअप और होल्ड टाइम का योग है। डेटा इनपुट को इस समय के समान स्थिर रखा जाना चाहिए।<ref name="harris"/>

रिकवरी का समय न्यूनतम समय है, जब एसिंक्रोनस सेट या रीसेट इनपुट क्लॉक की घटना से पहले निष्क्रिय होना चाहिए, जिससे डेटा को क्लॉक द्वारा तेजी से सैंपल लिया जाए। एसिंक्रोनस सेट या रीसेट इनपुट के लिए रिकवरी समय डेटा इनपुट के लिए सेटअप समय के समान है।

रिमूवल का समय कम से कम समय की राशि है, जो कि एसिंक्रोनस सेट या रीसेट इनपुट क्लॉक की घटना के पश्चात निष्क्रिय होना चाहिए। जिससे डेटा को क्लॉक द्वारा तेजी से सैंपल लिया जाए। एसिंक्रोनस सेट या रीसेट इनपुट के लिए हटाने का समय डेटा इनपुट के लिए होल्ड टाइम के समान है।

एसिंक्रोनस इनपुट (सेट, रीसेट) पर संचालित लघु आवेगों को रिकवरी-रिमूवल की अवधि के अंदर पूर्णरूपेण संचालित नहीं किया जाना चाहिए, अन्यथा यह पूर्णरूपेण अनिश्चित हो जाता है कि फ्लिप-फ्लॉप उचित स्थिति में परिवर्तित हो जाएगा या नहीं। दूसरी स्थिति में जहां एसिंक्रोनस सिग्नल केवल संक्रमण करता है, जो पुनर्प्राप्ति/हटाने के समय के मध्य होता है। अंततः फ्लिप-फ्लॉप उचित स्थिति में परिवर्तित हो जाएगा, लेकिन आउटपुट पर बहुत ही छोटी कमी दिखाई दे सकती है या नहीं। यह सिंक्रोनस इनपुट सिग्नल पर निर्भर करता है। इस दूसरी स्थिति का परिपथ डिज़ाइन के लिए महत्व हो भी सकता है और नहीं भी।

सेट और रीसेट (और अन्य) सिग्नल या तब सिंक्रोनस या एसिंक्रोनस हो सकते हैं और इसलिए इसे सेटअप/होल्ड या रिकवरी/रिमूवल टाइम के साथ चित्रित किया जा सकता है और सिंक्रोनसिटी फ्लिप-फ्लॉप के डिजाइन पर बहुत निर्भर है।
 
सेटअप/होल्ड और रिकवरी/रिमूवल समय के मध्य सिंक्रोनसअधिकांशतः आवश्यक होता है। जब बड़े परिपथ के समय को सत्यापित करते हैं क्योंकि सिंक्रोनस सिग्नल सिंक्रोनस सिग्नल की तुलना में कम महत्वपूर्ण पाए जा सकते हैं। सिंक्रोनस परिपथ डिजाइनरों को स्वतंत्र रूप से इस प्रकार के सिग्नलबं के लिए सत्यापन की स्टेट को परिभाषित करने की क्षमता प्रदान करता है।

=== मेटास्टेबिलिटी ===
{{main |इलेक्ट्रॉनिक्स में मेटास्टेबिलिटी}}

फ्लिप-फ्लॉप्स इलेक्ट्रॉनिक्स में मेटास्टेबिलिटी नामक समस्या के अंतर्गत हैं। जो तब हो सकता है जब दो इनपुट, जैसे डेटा और क्लॉक या क्लॉक और रीसेट, लगभग एक ही समय में बदल रहे हैं। जब उचित समय लिमिट के अंदर आर्डर स्पष्ट नहीं होता है, तब परिणाम यह होता है कि आउटपुट अप्रत्याशित रूप से व्यवहार कर सकता है, एक स्टेट या दूसरे स्टेट में व्यवस्थित होने में सामान्य से अनेक गुना अधिक समय लग सकता है या यहां तक कि व्यवस्थित होने से पहले अनेक बार दोलन भी कर सकता है। सैद्धांतिक रूप से स्थापित होने का समय बाध्य नहीं है। कंप्यूटर प्रणाली में यह मेटास्टेबिलिटी डेटा या प्रोग्राम क्रैश का कारण बन सकती है। यदि स्टेट किसी अन्य परिपथ के मूल्य का उपयोग करने से पहले स्थिर नहीं है। विशेष रूप से यदि दो भिन्न लॉजिकल पथ फ्लिप-फ्लॉप के आउटपुट का उपयोग करते हैं, तब एक पथ इसे 0 के रूप में परिवर्तित कर सकता है और दूसरे को 1 के रूप में जब यह स्थिर स्टेट में स्थापित नहीं किया है और मशीन को असंगत स्टेट में डाल दिया है।<ref>
{{cite journal
 | journal = IEEE Transactions on Computers
 | title = Anomalous Behavior of Synchronizer and Arbiter Circuits
 | first1 = Thomas J. |last1 = Chaney
 | author2-link = Charles Molnar | first2 = Charles E. | last2 = Molnar
 | volume = C-22
 | issue = 4
 | pages = 421–422
 | issn = 0018-9340
 | doi = 10.1109/T-C.1973.223730
 | date = April 1973
| s2cid = 12594672
 }}</ref>

फ्लिप-फ्लॉप में मेटास्टेबिलिटी को यह सुनिश्चित करके बचा जा सकता है कि डेटा और नियंत्रण इनपुट को क्लॉक की पल्स से पहले और पश्चात में निर्दिष्ट अवधि के लिए मान्य और स्थिर रखा गया है, जिसे सेटअप समय क्रमश (t<sub>su</sub>) और होल्ड टाइम (t<sub>h</sub>) कहा जाता है। इन समयों को डिवाइस के लिए डेटा शीट में निर्दिष्ट किया जाता है और सामान्यतः कुछ नैनोसेकंड और आधुनिक उपकरणों के लिए कुछ सौ पिकोसेकंड के मध्य होते हैं। फ्लिप-फ्लॉप के आंतरिक संगठन के आधार पर शून्य (या ऋणात्मक) सेटअप के साथ उपकरण का निर्माण करना या समय की आवश्यकता को रोकना संभव है, किन्तु दोनों एक साथ नहीं संभव हो सकते है।

दुर्भाग्य से सेटअप को पूरा करना और मानदंडों को पकड़ना सदैव संभव नहीं होता है क्योंकि फ्लिप-फ्लॉप वास्तविक समय के सिग्नल से जुड़ा हो सकता है। जो डिजाइनर के नियंत्रण के पश्चात किसी भी समय बदल सकता है। इस स्थिति में सबसे अच्छा डिजाइनर कर सकता है कि परिपथ की आवश्यक विश्वसनीयता के आधार पर निश्चित स्तर तक त्रुटि की संभावना को कम करना है। मेटास्टेबिलिटी को दबाने के लिए विधि श्रृंखला में दो या अधिक फ्लिप-फ्लॉप को कनेक्ट करना है। जिससे प्रत्येक का आउटपुट अगले के डेटा इनपुट को फीड करे और सभी डिवाइस सामान्य क्लॉक साझा करें। इस पद्धति के साथ मेटास्टेबल घटना की संभावना को नगण्य मूल्य तक कम किया जा सकता है, किन्तु कभी शून्य तक नहीं किया जा सकता है। मेटास्टेबिलिटी की संभावना शून्य के पास हो जाती है क्योंकि श्रृंखला में जुड़े फ्लिप-फ्लॉप की संख्या बढ़ जाती है। कैस्केड किए जाने वाले फ्लिप-फ्लॉप की संख्या को "रैंकिंग" कहा जाता है। "दोहरी-रैंक वाली" फ्लिप फ्लॉप (श्रृंखला में दो फ्लिप फ्लॉप) सामान्य स्थिति है।

जैसा कि मेटास्टेबल-कठोर फ्लिप-फ्लॉप उपलब्ध हैं, जो सेटअप को कम करके कार्य करते हैं और जितना संभव हो उतना समय पकड़ते हैं। किन्तु यहां तक कि ये समस्या को पूर्णरूपेण समाप्त नहीं कर सकते हैं। ऐसा इसलिए है क्योंकि मेटास्टेबिलिटी परिपथ डिजाइन की बात से अधिक है। जब क्लॉक और डेटा में ट्रांजीशन समय के साथ बंद हो जाते हैं, तब फ्लिप-फ्लॉप को यह निर्धारित करने के लिए बाध्य किया जाता है कि पहले कौन सी घटना हुई थी। चूँकि तेजी से डिवाइस बनाया जाता है और सदैव संभावना होती है कि इनपुट इवेंट के साथ इतने पास होंगे कि यह पता नहीं लगा सकता है कि पहले कौन सा हुआ था। इसलिए पूर्णरूपेण मेटास्टेबल-प्रूफ फ्लिप-फ्लॉप का निर्माण करना लॉजिकल रूप से असंभव है। फ्लिप-फ्लॉप को संभवतः अधिकतम समय के लिए विशेषता दी जाती है (अधिकतम समय वह निर्दिष्ट प्रकरण के अनुसार मेटास्टेबल रहेंगे)। इस स्थिति में दो क्रम वाले फ्लिप-फ्लॉप जो अधिकतम अनुमति मेटास्टेबिलिटी समय की तुलना में धीमे होते हैं, एसिंक्रोनस (जैसे बाहरी) सिग्नल के लिए उचित कंडीशनिंग प्रदान करेंगे।

=== प्रसार विलंब ===
फ्लिप-फ्लॉप के लिए महत्वपूर्ण समय मूल्य क्लॉक-टू-आउटपुट विलंब (डेटा शीट में सामान्य प्रतीक t<sub>CO</sub> है), जो कि फ्लिप-फ्लॉप समय है। जो क्लॉक के किनारे के पश्चात अपना आउटपुट बदलने के लिए लेता है। उच्च-से-निम्न ट्रांजीशन (t<sub>PHL</sub>) के लिए समय संभवतः निम्न-से-उच्च (t<sub>PHL</sub>) ट्रांजीशन के लिए समय से भिन्न होता है।

जब फ्लिप-फ्लॉप्स को कैस्केडिंग करते हैं, जो एक ही क्लॉक (शिफ्ट रजिस्टर में) साझा करते हैं। तब यह सुनिश्चित करना महत्वपूर्ण है कि t<sub>CO</sub> पूर्ववर्ती फ्लिप-फ्लॉप होल्ड टाइम निम्नलिखित फ्लिप-फ्लॉप (t<sub>h</sub>) में से अधिक लंबा है, इसलिए सफल फ्लिप-फ्लॉप के इनपुट पर उपस्थित डेटा को क्लॉक के सक्रिय किनारे के पश्चात ठीक से स्थानांतरित किया जाता है। t<sub>CO</sub> और t<sub>h</sub> के मध्य यह संबंध सामान्यतः गारंटी दी जाती है कि क्या फ्लिप-फ्लॉप भौतिक रूप से समान हैं। इसके अतिरिक्त सही ऑपरेशन के लिए यह सत्यापित करना सरल है कि क्लॉक की अवधि को इनके योग t<sub>su</sub> + t<sub>h</sub> से अधिक होना चाहिए।

== सामान्यीकरण ==
फ्लिप-फ्लॉप को कम से कम दो प्रकारों से सामान्यीकृत किया जा सकता है। उन्हें 1-ऑफ-2 के स्थान पर 1-ऑफ-N बनाकर और उन्हें दो से अधिक स्थितियों के साथ लॉजिक में अनुकूलित करके 1-में-3 एन्कोडिंग या बहु-मूल्यवान टर्नरी लॉजिक के विशेष स्थितियों में ऐसे तत्व को फ्लिप-फ्लैप-फ्लॉप के रूप में संदर्भित किया जा सकता है।<ref>Often attributed to [[Don Knuth]] (1969) (see {{cite book| author = Midhat J. Gazalé| title = Number: from Ahmes to Cantor| url = https://books.google.com/books?id=WO1gQYIrG24C| year = 2000| publisher = Princeton University Press| isbn = 978-0-691-00515-7| page = 57 }}), the term ''flip-flap-flop'' actually appeared much earlier in the computing literature, for example,
{{cite book
 |title = The design and application of a "flip-flap-flop" using tunnel diodes (Master's thesis)
 |first = Edward K. |last = Bowdon
 |publisher = University of North Dakota
 |year = 1960
 |url = https://books.google.com/books?id=0pA7AAAAMAAJ&q=flip-flap-flop+core
}}, and in 
{{cite journal
 |journal = Electronics and Power
 |title = The ternary computer
 |last=Alexander |first=W.
 |volume = 10
 |issue = 2
 |publisher = IET
 |pages = 36–39
 |date = Feb 1964
 |url = https://scholar.google.com/scholar?gcx=c&q=alexander+flip-flap-flop&um=1&ie=UTF-8&hl=en&sa=N&tab=ws
 |doi = 10.1049/ep.1964.0037
}}
</ref>

इस प्रकार कन्वेंशनल फ्लिप-फ्लॉप में दो कोम्प्लिमेंट्री आउटपुट में से उच्च है। यह N आउटपुट के साथ मेमोरी तत्व के लिए सामान्यीकृत किया जा सकता है, जिनमें से एक ठीक है (वैकल्पिक रूप से, जहां वास्तव में N से निम्न है)। इसलिए आउटपुट सदैव एक-गर्म (क्रमशः एक-ठंडा) प्रतिनिधित्व होता है। निर्माण कन्वेंशनल क्रॉस-युग्मित फ्लिप-फ्लॉप के समान है। प्रत्येक आउटपुट जब उच्च अन्य सभी आउटपुट को रोकता है।<ref>{{cite web |url=http://www.goldenmuseum.com/1411FlipFlap_engl.html |title=Ternary "flip-flap-flop" |access-date=2009-10-17 |archive-url=https://web.archive.org/web/20090105193858/http://www.goldenmuseum.com/1411FlipFlap_engl.html |archive-date=2009-01-05 |url-status=dead }}</ref> वैकल्पिक रूप से अधिक या कम कन्वेंशनल फ्लिप-फ्लॉप का उपयोग किया जा सकता है, प्रति आउटपुट एक या अतिरिक्त सर्किटरी के साथ यह सुनिश्चित करने के लिए कि एक समय में केवल एक ही सही हो सकता है।<ref>{{cite patent|country=US|number=6975152|pubdate=2005-12-13|title=Flip flop supporting glitchless operation on a one-hot bus and method|assign1=[[Advanced Micro Devices Inc.]]|inventor1-last=Lapidus|inventor1-first=Peter D.}}</ref>

कन्वेंशनल फ्लिप-फ्लॉप का एक और सामान्यीकरण बहु-मूल्यवान लॉजिक के लिए मेमोरी एलिमेंट है। इस स्थिति में मेमोरी एलिमेंट लॉजिक में से एक को बनाए रखता है। जब तक कि नियंत्रण इनपुट परिवर्तन को प्रेरित नहीं करते हैं।<ref>
{{cite journal
 |title=Flip-Flops for Multiple-Valued Logic
 |last1=Irving |first1=Thurman A. |last2=Shiva |first2=Sajjan G. |last3=Nagle |first3=H. Troy
 |journal=IEEE Transactions on Computers
 |date=March 1976
 |volume=C-25
 |issue=3
 |pages=237–246
 |doi=10.1109/TC.1976.5009250
|s2cid=34323423 }}</ref> इसके अतिरिक्त बहु-मूल्यवान क्लॉक का उपयोग भी किया जा सकता है। जिससे नए संभावित क्लॉक ट्रांजीशन हो सकते हैं।<ref>
{{cite journal
 |title=Research into ternary edge-triggered JKL flip-flop
 |journal=Journal of Electronics (China)
 |volume=8
 |issue=3 |date=July 1991
 |doi=10.1007/BF02778378
 |pages=268–275
 |last1=Wu |first1=Haomin  |author2=Zhuang Nan
|s2cid=61275953
 }}</ref>



== यह भी देखें ==
{{Commons category|Flip-flops}}
* लेटचिंग रिले
* पल्स ट्रांजीशन डिटेक्टर
* स्टेटिक रैंडम-एक्सेस मेमोरी
* सैंपल एंड होल्ड
* श्मिट ट्रिगर

==संदर्भ==
{{Reflist|30em}}


==इस पृष्ठ में गुम आंतरिक लिंक की सूची==


==बाप्रत्येकी संबंध==
{{wikibooks|Digital Circuits/Flip-Flops}}
* [http://teahlab.com/Multivibrators_FlipFlop/ FlipFlop Hierarchy] {{Webarchive|url=https://web.archive.org/web/20150408221630/http://teahlab.com/Multivibrators_FlipFlop/ |date=2015-04-08 }}, shows interactive flipflop circuits.
* [http://www.allaboutcircuits.com/vol_4/chpt_10/6.html The J-K Flip-Flop]
*{{cite web |first=Ken |last=Shirriff |title=Reverse-engineering a 1960s hybrid flip flop module with X-ray CT scans |date=August 2022 |url=http://www.righto.com/2022/08/lumafield-flip-flop.html}}

{{Digital electronics}}
{{Authority control}}

{{DEFAULTSORT:Flip-Flop (Electronics)}}[[Category: 1918 में कंप्यूटर से संबंधित परिचय]]
[[Category: डिजिटल इलेक्ट्रॉनिक्स]]
[[Category: इलेक्ट्रॉनिक इंजीनियरिंग]]
[[Category: डिजिटल सिस्टम]]
[[Category: लॉजिक गेट्स]]
[[Category: कंप्यूटर मेमोरी]]


[[Category: Machine Translated Page]]
[[Category:Created with V14 On 10/09/2022]]
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