रुकावट विलंबता: Difference between revisions

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कंप्यूटिंग में, '''अंतराय प्रसुप्ति''' एक अंतराय अनुरोध (आईआरक्यू) की शुरुआत और संबंधित अंतराय सर्विस नेमका (आईएसआर) की शुरुआत के बीच के विलंब को संदर्भित करती है।<ref name="Yiu_2016_Latency"/>कई प्रचालन तंत्रों के लिए, जैसे ही उपकरणों का [[इंटरप्ट हैंडलर|अंतराय हैंडलर]] निष्पादित होता है, उपकरणों की सर्विस हो जाती है। अंतराय प्रसुप्ति [[माइक्रोप्रोसेसर|सूक्ष्मसंसाधित्र]] डिज़ाइन, [[ बाधा नियंत्रक |अंतराय नियंत्रक]], [[अंतराय आच्छदन]] और [[प्रचालन तंत्र]] (ओएस) के अंतराय हैंडलिंग तरीकों से प्रभावित हो सकती है।<ref>{{Cite journal|last=Lin|first=Feng|last2=Ashley|first2=David T.|last3=Burke|first3=Michael J.|last4=Heymann|first4=Michael|date=1999|title=इंटरप्ट लेटेंसी संगतता समस्या का एक हाइब्रिड सिस्टम समाधान|journal=SAE Transactions|volume=108|pages=2112–2125|jstor=44733861|issn=0096-736X}}</ref>
कंप्यूटिंग में, इंटरप्ट लेटेंसी एक इंटरप्ट रिक्वेस्ट (IRQ) के शुरू होने और संबंधित इंटरप्ट सर्विस रूटीन (ISR) के शुरू होने के बीच की देरी को संदर्भित करता है।<ref name="Yiu_2016_Latency"/>कई [[ऑपरेटिंग सिस्टम]] के लिए, जैसे ही डिवाइस के [[इंटरप्ट हैंडलर]] को निष्पादित किया जाता है, डिवाइस की सर्विस की जाती है। इंटरप्ट लेटेंसी [[माइक्रोप्रोसेसर]] डिज़ाइन, [[ बाधा नियंत्रक ]], इंटरप्ट#मास्किंग और ऑपरेटिंग सिस्टम (OS) के इंटरप्ट हैंडलिंग तरीकों से प्रभावित हो सकती है।<ref>{{Cite journal|last=Lin|first=Feng|last2=Ashley|first2=David T.|last3=Burke|first3=Michael J.|last4=Heymann|first4=Michael|date=1999|title=इंटरप्ट लेटेंसी संगतता समस्या का एक हाइब्रिड सिस्टम समाधान|journal=SAE Transactions|volume=108|pages=2112–2125|jstor=44733861|issn=0096-736X}}</ref>
 
 
== पृष्ठभूमि ==
== पृष्ठभूमि ==
इंटरप्ट लेटेंसी, [[THROUGHPUT]] और प्रोसेसर उपयोग के बीच आमतौर पर एक ट्रेड-ऑफ होता है। माइक्रोप्रोसेसर और ऑपरेटिंग सिस्टम डिज़ाइन की कई तकनीकें जो इंटरप्ट लेटेंसी में सुधार करती हैं, थ्रूपुट को कम करती हैं और प्रोसेसर के उपयोग को बढ़ाती हैं। तकनीकें जो थ्रूपुट को बढ़ाती हैं, इंटरप्ट लेटेंसी को बढ़ा सकती हैं और प्रोसेसर के उपयोग को बढ़ा सकती हैं। अंत में, प्रोसेसर के उपयोग को कम करने की कोशिश करने से इंटरप्ट लेटेंसी बढ़ सकती है और थ्रूपुट कम हो सकता है।
आमतौर पर अंतराय प्रसुप्ति, [[थ्रूपुट]] और संसाधित्र उपयोग के मध्य एक ट्रेड-बंद होता है। [[सीपीयू]] और [[ओएस]] डिजाइन की कई तकनीकें जो अंतराय प्रसुप्ति में सुधार करती हैं, थ्रूपुट को कम करती हैं और संसाधित्र के उपयोग को बढ़ाती हैं। तकनीकें जो थ्रूपुट को बढ़ाती हैं, थ्रूपुट बढ़ाने वाली तकनीकें अंतराय प्रसुप्ति और संसाधित्र उपयोग को बढ़ा सकती हैं। अंत में, संसाधित्र उपयोग को कम करने का प्रयास करने से अंतराय प्रसुप्ति बढ़ सकती है और थ्रूपुट कम हो सकता है।


न्यूनतम व्यवधान विलंबता काफी हद तक व्यवधान नियंत्रक सर्किट और इसके विन्यास द्वारा निर्धारित की जाती है। वे इंटरप्ट लेटेंसी में घबराहट को भी प्रभावित कर सकते हैं, जो सिस्टम के [[रीयल-टाइम कंप्यूटिंग]] | रीयल-टाइम [[ निर्धारण (कंप्यूटिंग) ]] को अत्यधिक प्रभावित कर सकता है। Intel APIC आर्किटेक्चर भारी मात्रा में इंटरप्ट लेटेंसी [[ घबराना ]] उत्पन्न करने के लिए जाना जाता है।{{citation needed|date=November 2015}}
न्यूनतम अंतराय प्रसुप्ति मुख्य रूप से [[अंतराय नियंत्रक]] परिपथ और उसके विन्यास द्वारा निर्धारित की जाती है। वे अंतराय प्रसुप्ति में आकंप को भी प्रभावित कर सकते हैं, जो तंत्र की [[वास्तविक समय अनुसूचि]] को काफी प्रभावित कर सकता है। [[इंटेल एपीआईसी आर्किटेक्चर]] भारी मात्रा में अंतराय प्रसुप्ति[[ घबराना | आकंप]] उत्पन्न करने के लिए जाना जाता है।{{citation needed|date=November 2015}}


अधिकतम इंटरप्ट लेटेंसी काफी हद तक उन तरीकों से निर्धारित होती है जो OS इंटरप्ट हैंडलिंग के लिए उपयोग करता है। उदाहरण के लिए, अधिकांश प्रोसेसर कोड के महत्वपूर्ण वर्गों की सुरक्षा के लिए प्रोग्राम को इंटरप्ट को अक्षम करने की अनुमति देते हैं, इंटरप्ट हैंडलर के निष्पादन को रोकते हैं। इस तरह के एक महत्वपूर्ण खंड के निष्पादन के दौरान, सभी बाधित हैंडलर जो एक महत्वपूर्ण खंड के भीतर सुरक्षित रूप से निष्पादित नहीं हो सकते हैं, अवरुद्ध हैं (वे सभी महत्वपूर्ण वर्गों के बाहर निकलने के बाद इंटरप्ट हैंडलर को पुनरारंभ करने के लिए आवश्यक न्यूनतम जानकारी को बचाते हैं)। इसलिए ब्लॉक किए गए इंटरप्ट के लिए इंटरप्ट लेटेंसी को [[ महत्वपूर्ण अनुभाग ]] के अंत तक बढ़ा दिया जाता है, साथ ही समान और उच्च प्राथमिकता वाले किसी भी इंटरप्ट को ब्लॉक के स्थान पर आने पर रोक दिया जाता है।
अधिकतम अंतराय प्रसुप्ति व्यापक रुप से उन तरीकों से निर्धारित होती है जो ओएस अंतराय हैंडलिंग के लिए उपयोग करता है। उदाहरण के लिए, अधिकांश संसाधित्र प्रोग्राम को कोड के [[महत्वपूर्ण अनुभागों]] की सुरक्षा के लिए, अंतराय हैंडलर के निष्पादन को रोकते हुए, अंतराय को अक्षम करने की अनुमति देते हैं। ऐसे महत्वपूर्ण अनुभागों के निष्पादन के दौरान, सभी अंतराय हैंडलर जो एक महत्वपूर्ण अनुभाग के भीतर सुरक्षित रूप से निष्पादित नहीं कर सकते हैं, उन्हें अवरुद्ध कर दिया जाता है (वे सभी महत्वपूर्ण अनुभागों के बाहर निकलने के बाद अंतराय हैंडलर को पुनरारंभ करने के लिए आवश्यक न्यूनतम जानकारी सुरक्षित करते हैं)। इसलिए किसी अवरुद्ध अंतरायन के लिए अंतराय प्रसुप्ति को [[ महत्वपूर्ण अनुभाग |महत्वपूर्ण अनुभाग]] के अंत तक बढ़ा दिया जाता है, साथ ही समान और उच्च प्राथमिकता वाले किसी भी अंतराय को जो खंडक के स्थान पर आने के दौरान आते है।


कई कंप्यूटर सिस्टमों को कम इंटरप्ट विलंबता की आवश्यकता होती है, विशेष रूप से [[ अंतः स्थापित प्रणाली ]] जिन्हें रीयल-टाइम में सिस्टम मशीनरी को नियंत्रित करने की आवश्यकता होती है। कभी-कभी ये सिस्टम [[रीयल-टाइम ऑपरेटिंग सिस्टम]] (आरटीओएस) का उपयोग करते हैं। एक आरटीओएस यह वादा करता है कि उपनेमकाओं के निष्पादन के बीच निर्दिष्ट अधिकतम समय से अधिक समय नहीं गुजरेगा। ऐसा करने के लिए, RTOS को यह भी गारंटी देनी चाहिए कि इंटरप्ट लेटेंसी कभी भी पूर्वनिर्धारित अधिकतम से अधिक नहीं होगी।
कई कंप्यूटर तंत्रों को कम अंतराय प्रसुप्ति की आवश्यकता होती है, विशेष रूप से [[ अंतः स्थापित प्रणाली |अंतः स्थापित तंत्र]] जिन्हें वास्तविक समय में मशीनरी को [[नियंत्रित]] करने की आवश्यकता होती है। कभी-कभी ये तंत्र [[रीयल-टाइम ऑपरेटिंग सिस्टम|वास्तविक समय प्रचालन तंत्र]] (आरटीओएस) का उपयोग करते हैं। आरटीओएस यह संकेत करता है कि [[उपनेमका]] के निष्पादन के मध्य एक निर्दिष्ट अधिकतम समय से अधिक समय नहीं गुजरेगा। ऐसा करने के लिए, आरटीओएस को यह भी गारंटी देनी होगी कि अंतराय प्रसुप्ति कभी भी पूर्वनिर्धारित अधिकतम से अधिक नहीं होगी।


== विचार ==
== विचार ==
उन्नत इंटरप्ट नियंत्रक [[संदर्भ स्विच]] के दौरान ओवरहेड को कम करने और प्रभावी इंटरप्ट विलंबता के लिए हार्डवेयर सुविधाओं की भीड़ को लागू करते हैं। इनमें निम्न विशेषताएं शामिल हैं:
उन्नत अंतराय नियंत्रक [[संदर्भ स्विच]] और प्रभावी अंतराय प्रसुप्ति के दौरान ओवरहेड (उपरिव्यय) को कम करने के लिए कई हार्डवेयर विशेषताओं को लागू करते हैं। इनमें निम्न विशेषताएं सम्मिलित हैं:


* नॉन-इंटरप्टिबल निर्देशों के माध्यम से न्यूनतम जिटर<ref name="Yiu_2016_Latency"/>* मेमोरी सिस्टम के लिए जीरो वेट स्टेट्स<ref name="Yiu_2016_Latency"/>* स्विचेबल रजिस्टर बैंक<ref name="Yiu_2016_Latency"/>* टेल चेनिंग<ref name="Yiu_2016_Latency"/>* आलसी स्टैकिंग<ref name="Yiu_2016_Latency"/>* देरी से आगमन<ref name="Yiu_2016_Latency"/>* पॉप प्रीमेशन<ref name="Yiu_2016_Latency"/>* स्लीप-ऑन-एग्जिट फीचर<ref name="Yiu_2016_Latency"/>
* गैर-अंतरायनीय अनुदेशों के माध्यम से न्यूनतम आकंप<ref name="Yiu_2016_Latency"/>
*मेमोरी तंत्र के लिए शून्यांक प्रतीक्षा स्थिति<ref name="Yiu_2016_Latency" />
*स्विच करने योग्य रजिस्टर बैंक<ref name="Yiu_2016_Latency" />
*पश्च श्रंखलन<ref name="Yiu_2016_Latency" />
*लेज़ी चितीयन (स्टैकिंग)<ref name="Yiu_2016_Latency" />  
*विलंब से आगमन<ref name="Yiu_2016_Latency" />
*पॉप प्रीएम्पशन<ref name="Yiu_2016_Latency" />
*स्लीप-ऑन-एग्जिट विशेषता <ref name="Yiu_2016_Latency" />


साथ ही, ऐसी कई अन्य विधियाँ हैं जिनका उपयोग हार्डवेयर किसी स्थिति में दिए गए व्यवधान विलंबता को सहनीय बनाने के लिए कम रुकावट विलंबता के लिए आवश्यकताओं को कम करने में मदद के लिए कर सकता है। इनमें बफ़र्स और [[प्रवाह नियंत्रण (डेटा)]]डेटा) शामिल हैं। उदाहरण के लिए, अधिकांश नेटवर्क कार्ड ट्रांसमिट और रिसीव [[रिंग बफर]], इंटरप्ट रेट लिमिटिंग और हार्डवेयर फ्लो कंट्रोल को लागू करते हैं। बफ़र्स डेटा को तब तक संग्रहीत करने की अनुमति देते हैं जब तक कि इसे स्थानांतरित नहीं किया जा सकता है, और प्रवाह नियंत्रण नेटवर्क कार्ड को बफ़र भर जाने पर डेटा को हटाए बिना संचार को रोकने की अनुमति देता है।
इसी प्रकार, ऐसे कई अन्य तरीके हैं जिनका उपयोग हार्डवेयर किसी स्थिति में दिए गए अंतराय प्रसुप्ति को उचित बनाने के लिए छोटी अंतराय प्रसुप्ति की आवश्यकताओं को कम करने में मदद के लिए कर सकता है। इनमें चयक (बफ़र्स) और [[प्रवाह नियंत्रण (डेटा)|प्रवाह नियंत्रण]] सम्मिलित हैं। उदाहरण के लिए, अधिकांश नेटवर्क कार्ड संचरण और [[रिंग बफर|रिंग चयक]], अंतरायन दर सीमक और हार्डवेयर प्रवाह नियंत्रण को लागू करते हैं। चयक डेटा को तब तक संग्रहीत करने की अनुमति देते हैं जब तक कि इसे स्थानांतरित नहीं किया जा सकता है, और प्रवाह नियंत्रण नेटवर्क कार्ड को चयक पूर्ण हो जाने पर डेटा को हटाए बिना संचार को रोकने की अनुमति देता है।


आधुनिक हार्डवेयर इंटरप्ट रेट लिमिटिंग को भी लागू करता है। यह हार्डवेयर को उत्पन्न होने वाली प्रत्येक बाधा के बीच एक प्रोग्राम करने योग्य न्यूनतम समय की प्रतीक्षा करके [[ रुकावट तूफान ]] या [[ live ]] को रोकने में मदद करता है। इंटरप्ट रेट लिमिटिंग सर्विसिंग में लगने वाले समय की मात्रा को कम कर देता है, जिससे प्रोसेसर को उपयोगी कार्य करने में अधिक समय लगता है। इस समय से अधिक होने पर सॉफ्ट (रिकवरेबल) या हार्ड (नॉन-रिकवरेबल) त्रुटि होती है।
आधुनिक हार्डवेयर अंतरायन दर सीमक को भी लागू करता है। इससे हार्डवेयर को उत्पन्न होने वाले प्रत्येक अंतरायन के मध्य प्रोग्रामन योग्य न्यूनतम समय तक प्रतीक्षा करने से[[ रुकावट तूफान | अंतराय स्टॉर्म]] या [[ live |लाइव-लॉक]] को रोकने में मदद मिलती है। अंतराय दर सीमित करने से अंतराय की सर्विसिंग में लगने वाला समय कम हो जाता है, जिससे संसाधित्र को उपयोगी कार्य करने में अधिक समय व्यतीत करने की अनुमति मिलती है। इस समय से अधिक होने पर अस्पष्ट (पुनःप्राप्य) या स्पष्ट (गैर-पुनःप्राप्य) त्रुटि उत्पन्न होती है।


== यह भी देखें ==
== यह भी देखें ==
* [[ उन्नत [[प्रोग्रामेबल इंटरप्ट कंट्रोलर]] ]] (APIC)
* [[उन्नत]] [[प्रोग्रामेबल इंटरप्ट कंट्रोलर|प्रोग्रामयोग्य अंतराय नियंत्रक]] (एपीआईसी)
* [[ईथरनेट प्रवाह नियंत्रण]]
* [[ईथरनेट प्रवाह नियंत्रण]]
* IEEE 802.3 (प्रवाह नियंत्रण के लिए 802.3x पॉज़ फ़्रेम)
* [[IEEE 802.3]] (प्रवाह नियंत्रण के लिए 802.3x पॉज़ (विश्राम) फ़्रेम)
* [[ इंटर-प्रोसेसर रुकावट ]] (IPI)
* [[ इंटर-प्रोसेसर रुकावट | इंटर-संसाधित्र अंतराय]] (आईपीआई)
* [[बाधा डालना]]
* [[बाधा डालना|अंतरायन]]
* इंटरप्ट हैंडलर
* [[अंतराय हैंडलर]]
* [[ गैर-नकाबपोश व्यवधान ]] (NMI)
* [[ गैर-नकाबपोश व्यवधान | गैर-आच्छादनशील अंतरायन]] (एनएमआई)
* प्रोग्रामेबल इंटरप्ट कंट्रोलर (PIC)
* [[प्रोग्रामन योग्य अंतराय नियंत्रक]] (पीआईसी)
* [[प्रतिक्रिया समय (प्रौद्योगिकी)]]
* [[प्रतिक्रिया समय (प्रौद्योगिकी)|अनुक्रिया समय (तकनीकी)]]
* [[विलंबता (इंजीनियरिंग)]]
* [[विलंबता (इंजीनियरिंग)|प्रसुप्ति (इंजीनियरिंग)]]
* विलंबता (इंजीनियरिंग) # कंप्यूटर हार्डवेयर और ऑपरेटिंग सिस्टम
* [[विलंबता (इंजीनियरिंग)|कंप्यूटर हार्डवेयर और प्रचालन तंत्र प्रसुप्ति]]


==संदर्भ==
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Latest revision as of 20:16, 5 July 2023

कंप्यूटिंग में, अंतराय प्रसुप्ति एक अंतराय अनुरोध (आईआरक्यू) की शुरुआत और संबंधित अंतराय सर्विस नेमका (आईएसआर) की शुरुआत के बीच के विलंब को संदर्भित करती है।[1]कई प्रचालन तंत्रों के लिए, जैसे ही उपकरणों का अंतराय हैंडलर निष्पादित होता है, उपकरणों की सर्विस हो जाती है। अंतराय प्रसुप्ति सूक्ष्मसंसाधित्र डिज़ाइन, अंतराय नियंत्रक, अंतराय आच्छदन और प्रचालन तंत्र (ओएस) के अंतराय हैंडलिंग तरीकों से प्रभावित हो सकती है।[2]

पृष्ठभूमि

आमतौर पर अंतराय प्रसुप्ति, थ्रूपुट और संसाधित्र उपयोग के मध्य एक ट्रेड-बंद होता है। सीपीयू और ओएस डिजाइन की कई तकनीकें जो अंतराय प्रसुप्ति में सुधार करती हैं, थ्रूपुट को कम करती हैं और संसाधित्र के उपयोग को बढ़ाती हैं। तकनीकें जो थ्रूपुट को बढ़ाती हैं, थ्रूपुट बढ़ाने वाली तकनीकें अंतराय प्रसुप्ति और संसाधित्र उपयोग को बढ़ा सकती हैं। अंत में, संसाधित्र उपयोग को कम करने का प्रयास करने से अंतराय प्रसुप्ति बढ़ सकती है और थ्रूपुट कम हो सकता है।

न्यूनतम अंतराय प्रसुप्ति मुख्य रूप से अंतराय नियंत्रक परिपथ और उसके विन्यास द्वारा निर्धारित की जाती है। वे अंतराय प्रसुप्ति में आकंप को भी प्रभावित कर सकते हैं, जो तंत्र की वास्तविक समय अनुसूचि को काफी प्रभावित कर सकता है। इंटेल एपीआईसी आर्किटेक्चर भारी मात्रा में अंतराय प्रसुप्ति आकंप उत्पन्न करने के लिए जाना जाता है।[citation needed]

अधिकतम अंतराय प्रसुप्ति व्यापक रुप से उन तरीकों से निर्धारित होती है जो ओएस अंतराय हैंडलिंग के लिए उपयोग करता है। उदाहरण के लिए, अधिकांश संसाधित्र प्रोग्राम को कोड के महत्वपूर्ण अनुभागों की सुरक्षा के लिए, अंतराय हैंडलर के निष्पादन को रोकते हुए, अंतराय को अक्षम करने की अनुमति देते हैं। ऐसे महत्वपूर्ण अनुभागों के निष्पादन के दौरान, सभी अंतराय हैंडलर जो एक महत्वपूर्ण अनुभाग के भीतर सुरक्षित रूप से निष्पादित नहीं कर सकते हैं, उन्हें अवरुद्ध कर दिया जाता है (वे सभी महत्वपूर्ण अनुभागों के बाहर निकलने के बाद अंतराय हैंडलर को पुनरारंभ करने के लिए आवश्यक न्यूनतम जानकारी सुरक्षित करते हैं)। इसलिए किसी अवरुद्ध अंतरायन के लिए अंतराय प्रसुप्ति को महत्वपूर्ण अनुभाग के अंत तक बढ़ा दिया जाता है, साथ ही समान और उच्च प्राथमिकता वाले किसी भी अंतराय को जो खंडक के स्थान पर आने के दौरान आते है।

कई कंप्यूटर तंत्रों को कम अंतराय प्रसुप्ति की आवश्यकता होती है, विशेष रूप से अंतः स्थापित तंत्र जिन्हें वास्तविक समय में मशीनरी को नियंत्रित करने की आवश्यकता होती है। कभी-कभी ये तंत्र वास्तविक समय प्रचालन तंत्र (आरटीओएस) का उपयोग करते हैं। आरटीओएस यह संकेत करता है कि उपनेमका के निष्पादन के मध्य एक निर्दिष्ट अधिकतम समय से अधिक समय नहीं गुजरेगा। ऐसा करने के लिए, आरटीओएस को यह भी गारंटी देनी होगी कि अंतराय प्रसुप्ति कभी भी पूर्वनिर्धारित अधिकतम से अधिक नहीं होगी।

विचार

उन्नत अंतराय नियंत्रक संदर्भ स्विच और प्रभावी अंतराय प्रसुप्ति के दौरान ओवरहेड (उपरिव्यय) को कम करने के लिए कई हार्डवेयर विशेषताओं को लागू करते हैं। इनमें निम्न विशेषताएं सम्मिलित हैं:

  • गैर-अंतरायनीय अनुदेशों के माध्यम से न्यूनतम आकंप[1]
  • मेमोरी तंत्र के लिए शून्यांक प्रतीक्षा स्थिति[1]
  • स्विच करने योग्य रजिस्टर बैंक[1]
  • पश्च श्रंखलन[1]
  • लेज़ी चितीयन (स्टैकिंग)[1]
  • विलंब से आगमन[1]
  • पॉप प्रीएम्पशन[1]
  • स्लीप-ऑन-एग्जिट विशेषता [1]

इसी प्रकार, ऐसे कई अन्य तरीके हैं जिनका उपयोग हार्डवेयर किसी स्थिति में दिए गए अंतराय प्रसुप्ति को उचित बनाने के लिए छोटी अंतराय प्रसुप्ति की आवश्यकताओं को कम करने में मदद के लिए कर सकता है। इनमें चयक (बफ़र्स) और प्रवाह नियंत्रण सम्मिलित हैं। उदाहरण के लिए, अधिकांश नेटवर्क कार्ड संचरण और रिंग चयक, अंतरायन दर सीमक और हार्डवेयर प्रवाह नियंत्रण को लागू करते हैं। चयक डेटा को तब तक संग्रहीत करने की अनुमति देते हैं जब तक कि इसे स्थानांतरित नहीं किया जा सकता है, और प्रवाह नियंत्रण नेटवर्क कार्ड को चयक पूर्ण हो जाने पर डेटा को हटाए बिना संचार को रोकने की अनुमति देता है।

आधुनिक हार्डवेयर अंतरायन दर सीमक को भी लागू करता है। इससे हार्डवेयर को उत्पन्न होने वाले प्रत्येक अंतरायन के मध्य प्रोग्रामन योग्य न्यूनतम समय तक प्रतीक्षा करने से अंतराय स्टॉर्म या लाइव-लॉक को रोकने में मदद मिलती है। अंतराय दर सीमित करने से अंतराय की सर्विसिंग में लगने वाला समय कम हो जाता है, जिससे संसाधित्र को उपयोगी कार्य करने में अधिक समय व्यतीत करने की अनुमति मिलती है। इस समय से अधिक होने पर अस्पष्ट (पुनःप्राप्य) या स्पष्ट (गैर-पुनःप्राप्य) त्रुटि उत्पन्न होती है।

यह भी देखें

संदर्भ

  1. 1.0 1.1 1.2 1.3 1.4 1.5 1.6 1.7 1.8 Yiu, Joseph (2016-04-01). "A Beginner's Guide on Interrupt Latency - and Interrupt Latency of the Arm Cortex-M processors". Arm Community. Archived from the original on 15 June 2019. Retrieved 2019-06-15.
  2. Lin, Feng; Ashley, David T.; Burke, Michael J.; Heymann, Michael (1999). "इंटरप्ट लेटेंसी संगतता समस्या का एक हाइब्रिड सिस्टम समाधान". SAE Transactions. 108: 2112–2125. ISSN 0096-736X. JSTOR 44733861.