चार्ज-पंप फेज-लॉक लूप: Difference between revisions

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फ़ाइल:CP-PLL.pdf|अंगूठा|दाहिना|500px|चार्ज-पंप PLL
चार्ज-पंप [[चरण बंद लूप|चरण -लॉक लूप]] (सीपी-पीएलएल) चरण-आवृत्ति डिटेक्टर और वर्गाकार तरंग संकेतों के साथ चरण-लॉक लूप का एक संशोधन है।<ref>{{cite patent |country= USA|number=US3714463A |status= |title=Digital frequency and/or phase detector charge pump |pubdate=1973-01-30 |gdate= |fdate= |pridate=1971-01-04 |inventor=Jon M. Laune |invent1= |invent2= |assign1= |assign2= |class= |url=https://patents.google.com/patent/US3714463A}}</ref> सीपी-पीएलएल आने वाले संकेतों के चरण को त्वरित रूप से लॉक करने की अनुमति देता है, जिससे कम स्थिर स्थिति चरण त्रुटि प्राप्त होती है।<ref name="Gardner-1980">{{cite journal |author = F. Gardner  |author-link=Floyd M. Gardner
 
चार्ज-पंप [[चरण बंद लूप]] (CP-PLL) फेज-लॉक लूप का एक संशोधन है
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|title = चार्ज-पंप चरण-लॉक लूप| journal = IEEE Transactions on Communications | volume = 28 |issue=11 | pages = 1849–1858| year = 1980|doi=10.1109/TCOM.1980.1094619
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== चरण-आवृत्ति डिटेक्टर (पीएफडी) ==
== चरण-आवृत्ति डिटेक्टर (पीएफडी) ==
फाइल: फेज-फ्रीक्वेंसी-डिटेक्टर.पीडीएफ|थंब|राइट|500पीएक्स|फेज-फ्रीक्वेंसी डिटेक्टर डायनामिक्स
फाइल: चरण-फ्रीक्वेंसी-डिटेक्टर.पीडीएफ|थंब|राइट|500पीएक्स|चरण-फ्रीक्वेंसी डिटेक्टर डायनामिक्स


चरण-आवृत्ति डिटेक्टर (पीएफडी) संदर्भ (रेफरी) और नियंत्रित (वीसीओ) संकेतों के अनुगामी किनारों से शुरू होता है।
चरण-आवृत्ति डिटेक्टर (पीएफडी) संदर्भ (रेफरी) और नियंत्रित (वीसीओ) संकेतों के अनुगामी किनारों से शुरू होता है।पीएफडी का आउटपुट सिग्नल <math>i(t)</math> केवल तीन अवस्थाएँ हो सकती हैं: 0, <math>+I_p</math>, और <math>-I_p</math>. संदर्भ सिग्नल का पिछला किनारा पीएफडी को उच्च स्थिति में स्विच करने के लिए मजबूर करता है,
पीएफडी का आउटपुट सिग्नल <math>i(t)</math> केवल तीन अवस्थाएँ हो सकती हैं: 0, <math>+I_p</math>, और <math>-I_p</math>.
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जब तक कि यह पहले से ही राज्य में न हो <math>+I_p</math>.
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वीसीओ सिग्नल का पिछला किनारा पीएफडी को निचले राज्य में स्विच करने के लिए मजबूर करता है,
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जब तक कि यह पहले से ही राज्य में न हो <math>-I_p</math>.
यदि दोनों अनुगामी किनारे एक ही समय में होते हैं, तो पीएफडी शून्य हो जाता है।


==सीपी-पीएलएल == के गणितीय मॉडल
==सीपी-पीएलएल == के गणितीय मॉडल
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|title = Analysis of a charge-pump pll: A new model  
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और फिर एन. कुज़नेत्सोव एट अल द्वारा परिष्कृत किया गया। 2019 में।<ref name= Kuznetsov-2019-JDECP>{{cite journal |author = N. Kuznetsov, M. Yuldashev, R. Yuldashev, M. Blagov, E. Kudryashova, O. Kuznetsova, and T. Mokaev  
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| journal = Differential Equations and Control Processes | volume = 1 | pages = 109–120 | url=https://diffjournal.spbu.ru/pdf/19107-jdecp-kuznetsov.pdf| year = 2019}}</ref> वीसीओ अधिभार को ध्यान में रखते हुए सीपी-पीएलएल का बंद फॉर्म गणितीय मॉडल में व्युत्पन्न हुआ है।<ref name=KuznetsovYYBKKM-2020>{{cite journal |author = N. Kuznetsov, M. Yuldashev, R. Yuldashev, M. Blagov, E. Kudryashova, O. Kuznetsova, T. Mokaev |title = Charge pump phase-locked loop with phase-frequency detector: closed form mathematical model| issue=1468 | year = 2020 |volume = 1901|arxiv = 1901.01468}}</ref>
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1980 में, फ्लॉयड एम. गार्डनर|एफ. उपरोक्त तर्क के आधार पर गार्डनर ने अनुमान लगाया कि व्यावहारिक चार्ज-पंप पीएलएल की क्षणिक प्रतिक्रिया समकक्ष क्लासिकल पीएलएल की प्रतिक्रिया के लगभग समान होने की उम्मीद की जा सकती है।<ref name=Gardner-1980/>{{rp|1856}} (फ्लोयड एम. गार्डनर#चार्ज-पंप फेज-लॉक लूप्स पर गार्नर का अनुमान| सीपी-पीएलएल पर गार्डनर का अनुमान<ref name=2021-TCAS-KuznetsovMYY>{{cite journal
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Revision as of 23:45, 3 July 2023

चार्ज-पंप चरण -लॉक लूप (सीपी-पीएलएल) चरण-आवृत्ति डिटेक्टर और वर्गाकार तरंग संकेतों के साथ चरण-लॉक लूप का एक संशोधन है।[1] सीपी-पीएलएल आने वाले संकेतों के चरण को त्वरित रूप से लॉक करने की अनुमति देता है, जिससे कम स्थिर स्थिति चरण त्रुटि प्राप्त होती है।[2]

चरण-आवृत्ति डिटेक्टर (पीएफडी)

फाइल: चरण-फ्रीक्वेंसी-डिटेक्टर.पीडीएफ|थंब|राइट|500पीएक्स|चरण-फ्रीक्वेंसी डिटेक्टर डायनामिक्स

चरण-आवृत्ति डिटेक्टर (पीएफडी) संदर्भ (रेफरी) और नियंत्रित (वीसीओ) संकेतों के अनुगामी किनारों से शुरू होता है।पीएफडी का आउटपुट सिग्नल केवल तीन अवस्थाएँ हो सकती हैं: 0, , और . संदर्भ सिग्नल का पिछला किनारा पीएफडी को उच्च स्थिति में स्विच करने के लिए मजबूर करता है, जब तक कि यह पहले से ही राज्य में न हो . वीसीओ सिग्नल का पिछला किनारा पीएफडी को निचले राज्य में स्विच करने के लिए मजबूर करता है, जब तक कि यह पहले से ही राज्य में न हो .यदि दोनों अनुगामी किनारे एक ही समय में होते हैं, तो पीएफडी शून्य हो जाता है।

==सीपी-पीएलएल == के गणितीय मॉडल फ्लॉयड एम. गार्डनर|एफ द्वारा दूसरे क्रम के सीपी-पीएलएल के पहले रैखिक गणितीय मॉडल का सुझाव दिया गया था। 1980 में गार्डनर।[2]1994 में एम. वैन पैमेल द्वारा वीसीओ अधिभार के बिना एक अरैखिक मॉडल का सुझाव दिया गया था [3] और फिर एन. कुज़नेत्सोव एट अल द्वारा परिष्कृत किया गया। 2019 में।[4] वीसीओ अधिभार को ध्यान में रखते हुए सीपी-पीएलएल का बंद फॉर्म गणितीय मॉडल में व्युत्पन्न हुआ है।[5] सीपी-पीएलएल के ये गणितीय मॉडल होल्ड-इन रेंज के विश्लेषणात्मक अनुमान प्राप्त करने की अनुमति देते हैं (इनपुट सिग्नल अवधि की अधिकतम सीमा जैसे कि वहाँ एक बंद स्थिति मौजूद है जिस पर VCO अतिभारित नहीं है) और पुल-इन रेंज (इनपुट सिग्नल अवधि की अधिकतम सीमा होल्ड-इन रेंज के भीतर जैसे कि किसी भी प्रारंभिक अवस्था के लिए CP-PLL लॉक स्थिति प्राप्त करता है)।[6]


दूसरे क्रम के सीपी-पीएलएल का निरंतर समय रैखिक मॉडल और गार्डनर का अनुमान

गार्डनर का विश्लेषण निम्नलिखित सन्निकटन पर आधारित है:[2]समय अंतराल जिस पर संदर्भ सिग्नल की प्रत्येक अवधि पर पीएफडी गैर-शून्य स्थिति है

चार्ज-पंप पीडीएफ का औसत आउटपुट है

इसी स्थानांतरण समारोह के साथ

फ़िल्टर ट्रांसफर फ़ंक्शन का उपयोग करना और वीसीओ स्थानांतरण समारोह एक को दूसरे क्रम के CP-PLL का गार्डनर का रैखिक अनुमानित औसत मॉडल मिलता है

1980 में, फ्लॉयड एम. गार्डनर|एफ. उपरोक्त तर्क के आधार पर गार्डनर ने अनुमान लगाया कि व्यावहारिक चार्ज-पंप पीएलएल की क्षणिक प्रतिक्रिया समकक्ष क्लासिकल पीएलएल की प्रतिक्रिया के लगभग समान होने की उम्मीद की जा सकती है।[2]: 1856  (फ्लोयड एम. गार्डनर#चार्ज-पंप चरण-लॉक लूप्स पर गार्नर का अनुमान| सीपी-पीएलएल पर गार्डनर का अनुमान[7]). गार्डनर के परिणामों के बाद, विलियम एफ. एगन (इलेक्ट्रिकल इंजीनियर) के साथ समानता से # टाइप II एपीएलएल की पुल-इन रेंज पर ईगन का अनुमान| टाइप 2 एपीएलएल की पुल-इन रेंज पर ईगन का अनुमान, अम्र एम. फहीम ने अपने में अनुमान लगाया किताब[8]: 6  कि एक अनंत पुल-इन (कैप्चर) रेंज रखने के लिए, CP-PLL में लूप फ़िल्टर के लिए एक सक्रिय फ़िल्टर का उपयोग किया जाना चाहिए (फहीम-एगन का अनुमान II CP-PLL के पुल-इन रेंज पर)।

===दूसरे क्रम के CP-PLL=== का निरंतर समय अरैखिक मॉडल व्यापकता के नुकसान के बिना यह माना जाता है कि वीसीओ और रेफ संकेतों के अनुगामी किनारे होते हैं जब संबंधित चरण एक पूर्णांक संख्या तक पहुँचता है। बता दें कि रेफ सिग्नल के पहले अनुगामी किनारे का समय उदाहरण इस रूप में परिभाषित किया गया है . पीएफडी राज्य पीएफडी प्रारंभिक अवस्था द्वारा निर्धारित किया जाता है , VCO के प्रारंभिक चरण में बदलाव और रेफरी संकेत।

इनपुट करंट के बीच संबंध और आउटपुट वोल्टेज एक के लिए प्रतिरोधी और संधारित्र के आधार पर आनुपातिक रूप से एकीकृत (परिपूर्ण पीआई) फ़िल्टर निम्नानुसार है

कहाँ एक प्रतिरोध है, एक समाई है, और कैपेसिटर चार्ज है। नियंत्रण संकेत VCO आवृत्ति समायोजित करता है:

कहाँ VCO फ्री-रनिंग (मौन) आवृत्ति है (यानी के लिए ), VCO लाभ (संवेदनशीलता) है, और VCO चरण है। अंत में, सीपी-पीएलएल का निरंतर समय अरैखिक गणितीय मॉडल इस प्रकार है

निम्नलिखित असंतुलित टुकड़ा-वार निरंतर अरैखिकता के साथ

और प्रारंभिक शर्तें . यह मॉडल एक अरैखिक, गैर-स्वायत्त, असंतुलित, स्विचिंग सिस्टम है।

===दूसरे क्रम के CP-PLL=== का असतत समय अरैखिक मॉडल

पीएफडी गतिकी का समय अंतराल

संदर्भ संकेत आवृत्ति को स्थिर माना जाता है:

कहाँ , और एक अवधि, आवृत्ति और संदर्भ संकेत का एक चरण है। होने देना . द्वारा निरूपित करें समय का पहला पल ऐसा कि पीएफडी आउटपुट शून्य हो जाता है (अगर , तब ) और तक VCO या Ref का पहला अनुगामी किनारा। आगे इसी बढ़ते क्रम और के लिए परिभाषित किया गया हैं। होने देना . फिर के लिए एक गैर-शून्य स्थिरांक है (). द्वारा निरूपित करें पीएफडी पल्स चौड़ाई (समय अंतराल की लंबाई, जहां पीएफडी आउटपुट गैर-शून्य स्थिर है), पीएफडी आउटपुट के संकेत से गुणा किया जाता है: अर्थात। के लिए और के लिए . यदि VCO ट्रेलिंग एज Ref ट्रेलिंग एज से पहले हिट करता है, तब और विपरीत स्थिति में हमारे पास है , अर्थात। दिखाता है कि कैसे एक सिग्नल दूसरे से पिछड़ जाता है। पीएफडी का शून्य उत्पादन अंतराल पर : के लिए . चर का परिवर्तन[9] को पैरामीटर की संख्या को दो तक कम करने की अनुमति देता है: यहाँ एक सामान्यीकृत चरण बदलाव है और VCO आवृत्ति का अनुपात है संदर्भ आवृत्ति के लिए . अंत में, VCO अधिभार के बिना दूसरे क्रम CP-PLL का असतत-समय मॉडल[4][6]

कहाँ

इस असतत-समय के मॉडल में केवल एक ही स्थिर अवस्था है और होल्ड-इन और पुल-इन रेंज का अनुमान लगाने की अनुमति देता है।[6]

यदि VCO अतिभारित है, अर्थात शून्य है, या वही क्या है:

  या

, फिर CP-PLL गतिकी के अतिरिक्त मामले ध्यान में रखा जाना है।[5]किसी भी पैरामीटर के लिए वीसीओ अधिभार वीसीओ और संदर्भ संकेतों के बीच पर्याप्त रूप से बड़े आवृत्ति अंतर के लिए हो सकता है। व्यवहार में VCO अधिभार से बचना चाहिए।

=== उच्च-क्रम सीपी-पीएलएल === के अरैखिक मॉडल उच्च-क्रम सीपी-पीएलएल के गैर-रैखिक गणितीय मॉडल की व्युत्पत्ति ट्रान्सेंडैंटल चरण समीकरणों की ओर ले जाती है जिन्हें विश्लेषणात्मक रूप से हल नहीं किया जा सकता है और शास्त्रीय निश्चित-बिंदु विधि या न्यूटन-रैफसन दृष्टिकोण जैसे संख्यात्मक दृष्टिकोण की आवश्यकता होती है।[10]


संदर्भ

  1. USA US3714463A, Jon M. Laune, "Digital frequency and/or phase detector charge pump", published 1973-01-30 
  2. 2.0 2.1 2.2 2.3 F. Gardner (1980). "चार्ज-पंप चरण-लॉक लूप". IEEE Transactions on Communications. 28 (11): 1849–1858. Bibcode:1980ITCom..28.1849G. doi:10.1109/TCOM.1980.1094619.
  3. M. van Paemel (1994). "Analysis of a charge-pump pll: A new model". IEEE Transactions on Communications. 42 (7): 2490–2498. doi:10.1109/26.297861.
  4. 4.0 4.1 N. Kuznetsov, M. Yuldashev, R. Yuldashev, M. Blagov, E. Kudryashova, O. Kuznetsova, and T. Mokaev (2019). "Comments on van Paemel's mathematical model of charge-pump phase-locked loop" (PDF). Differential Equations and Control Processes. 1: 109–120.{{cite journal}}: CS1 maint: multiple names: authors list (link)
  5. 5.0 5.1 N. Kuznetsov, M. Yuldashev, R. Yuldashev, M. Blagov, E. Kudryashova, O. Kuznetsova, T. Mokaev (2020). "Charge pump phase-locked loop with phase-frequency detector: closed form mathematical model". 1901 (1468). arXiv:1901.01468. {{cite journal}}: Cite journal requires |journal= (help)CS1 maint: multiple names: authors list (link)
  6. 6.0 6.1 6.2 N.V. Kuznetsov, A.S. Matveev, M.V. Yuldashev, R.V. Yuldashev (2020). "Nonlinear analysis of charge-pump phase-locked loop: the hold-in and pull-in ranges". IFAC World Congress. arXiv:2005.00864.{{cite journal}}: CS1 maint: multiple names: authors list (link)
  7. Kuznetsov, N.V.; Matveev, A.S.; Yuldashev, M.V.; Yuldashev, R.V. (2021). "Nonlinear Analysis of Charge-Pump Phase-Locked Loop: The Hold-In and Pull-In Ranges". IEEE Transactions on Circuits and Systems I: Regular Papers. 68 (10): 4049–4061. doi:10.1109/TCSI.2021.3101529.
  8. Fahim, Amr M. (2005). Clock Generators for SOC Processors: Circuits and Architecture. Boston-Dordrecht-London: Kluwer Academic Publishers.
  9. P. Curran, C. Bi, and O. Feely (2013). "चार्ज-पंप चरण-लॉक लूप की गतिशीलता". International Journal of Circuit Theory and Applications. 41 (11): 1109–1135. doi:10.1002/cta.1814. S2CID 3792988.{{cite journal}}: CS1 maint: multiple names: authors list (link)
  10. C. Hedayat, A. Hachem, Y. Leduc, and G. Benbassat (1999). "Modeling and characterization of the 3rd order charge-pump PLL: a fully event-driven approach". Analog Integrated Circuits and Signal Processing. 19 (1): 25–45. doi:10.1023/A:1008326315191. S2CID 58204942.{{cite journal}}: CS1 maint: multiple names: authors list (link)