सॉफ्ट माइक्रोप्रोसेसर: Difference between revisions

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{{Short description|Microprocessor design embeddable in other computer systems}}
{{Short description|Microprocessor design embeddable in other computer systems}}


'''सॉफ्ट [[माइक्रोप्रोसेसर]]''' (जिसे सॉफ्टकोर माइक्रोप्रोसेसर या सॉफ्ट प्रोसेसर भी कहा जाता है) माइक्रोप्रोसेसर कोर है। जिसे [[तर्क संश्लेषण|लॉजिक सिन्थेसिस]] का उपयोग करके पूर्णतः कार्यान्वित किया जा सकता है। इसे प्रोग्रामेबल लॉजिक (जैसे, [[विशिष्ट एकीकृत परिपथ आवेदन]], [[क्षेत्र में प्रोग्राम की जा सकने वाली द्वार श्रंखला|क्षेत्र में प्रोग्राम की जा सकने वाली डोर श्रंखला]], काम्प्लेक्स [[ जटिल प्रोग्रामयोग्य तर्क उपकरण |प्रोग्राम करने योग्य लॉजिक उपकरण]] ) वाले विभिन्न [[ अर्धचालक |अर्धचालक]] उपकरणों के माध्यम से कार्यान्वित किया जा सकता है, जिसमें हाई-एंड कमोडिटी दोनों विविधताएं सम्मिलित हैं।<ref>http://www.dailycircuitry.com/2011/10/zet-soft-core-running-windows-30.html {{Webarchive|url=https://web.archive.org/web/20181013095941/http://www.dailycircuitry.com/2011/10/zet-soft-core-running-windows-30.html |date=2018-10-13 }}
"Zet soft core running Windows 3.0" by Andrew Felch 2011</ref>


सॉफ्ट [[माइक्रोप्रोसेसर]] (जिसे सॉफ्टकोर माइक्रोप्रोसेसर या सॉफ्ट प्रोसेसर भी कहा जाता है) माइक्रोप्रोसेसर कोर है जिसे [[तर्क संश्लेषण]] का उपयोग करके पूरी तरह कार्यान्वित किया जा सकता है। इसे प्रोग्रामेबल लॉजिक (जैसे, [[विशिष्ट एकीकृत परिपथ आवेदन]], [[क्षेत्र में प्रोग्राम की जा सकने वाली द्वार श्रंखला]], [[ जटिल प्रोग्रामयोग्य तर्क उपकरण |जटिल प्रोग्रामयोग्य तर्क उपकरण]] ) वाले विभिन्न [[ अर्धचालक |अर्धचालक]] उपकरणों के माध्यम से कार्यान्वित किया जा सकता है, जिसमें हाई-एंड और कमोडिटी दोनों विविधताएं शामिल हैं।<ref>http://www.dailycircuitry.com/2011/10/zet-soft-core-running-windows-30.html {{Webarchive|url=https://web.archive.org/web/20181013095941/http://www.dailycircuitry.com/2011/10/zet-soft-core-running-windows-30.html |date=2018-10-13 }}
अधिकांश सिस्टम, यदि वह किसी सॉफ्ट प्रोसेसर का उपयोग करते हैं, तब केवल एक ही सॉफ्ट प्रोसेसर का उपयोग करते हैं। चूंकि कुछ डिज़ाइनर एफपीजीए पर उतने ही सॉफ्ट कोर का प्रयोग करते हैं, जितने उपयुक्त होंगे।<ref>
"Zet soft core running Windows 3.0" by Andrew Felch 2011</ref>
अधिकांश सिस्टम, यदि वे किसी सॉफ्ट प्रोसेसर का उपयोग करते हैं, तो केवल एक ही सॉफ्ट प्रोसेसर का उपयोग करते हैं। हालाँकि, कुछ डिज़ाइनर FPGA पर उतने ही सॉफ्ट कोर लगाते हैं जितने फिट होंगे।<ref>
{{cite web |url=http://www.embedded.com/columns/showArticle.jhtml?articleID=192700615 |title=Embedded.com - FPGA Architectures from 'A' to 'Z' : Part 2 |access-date=2012-08-18 |url-status=dead |archive-url=https://web.archive.org/web/20071008163016/http://www.embedded.com/columns/showArticle.jhtml?articleID=192700615 |archive-date=2007-10-08 }}
{{cite web |url=http://www.embedded.com/columns/showArticle.jhtml?articleID=192700615 |title=Embedded.com - FPGA Architectures from 'A' to 'Z' : Part 2 |access-date=2012-08-18 |url-status=dead |archive-url=https://web.archive.org/web/20071008163016/http://www.embedded.com/columns/showArticle.jhtml?articleID=192700615 |archive-date=2007-10-08 }}
"FPGA Architectures from 'A' to 'Z'" by Clive Maxfield 2006
"FPGA Architectures from 'A' to 'Z'" by Clive Maxfield 2006
</ref> उन [[ मल्टी कोर |मल्टी कोर]] सिस्टम में, क्लस्टर में सभी कोर के बीच शायद ही कभी उपयोग किए जाने वाले संसाधनों को साझा किया जा सकता है।
</ref> उन [[ मल्टी कोर |मल्टी कोर]] सिस्टम में क्लस्टर में सभी कोर के मध्य सम्भवतः ही कभी उपयोग किए जाने वाले संसाधनों को साझा किया जा सकता है।


जबकि कई लोग FPGA पर बिल्कुल सॉफ्ट माइक्रोप्रोसेसर लगाते हैं, पर्याप्त रूप से बड़ा FPGA दो या अधिक सॉफ्ट माइक्रोप्रोसेसर रख सकता है, जिसके परिणामस्वरूप [[मल्टी-कोर प्रोसेसर]] बनता है। एकल FPGA पर सॉफ्ट प्रोसेसर की संख्या केवल FPGA के आकार से सीमित होती है।<ref>[http://www.xilinx.com/products/design_resources/proc_central/microblaze_faq.pdf MicroBlaze Soft Processor: Frequently Asked Questions] {{webarchive|url=https://web.archive.org/web/20111027074459/http://www.xilinx.com/products/design_resources/proc_central/microblaze_faq.pdf |date=2011-10-27 }}</ref> कुछ लोगों ने एक ही FPGA पर दर्जनों या सैकड़ों सॉफ्ट माइक्रोप्रोसेसर लगाए हैं।<ref>
जबकि अनेक लोग एफपीजीए पर बिल्कुल सॉफ्ट माइक्रोप्रोसेसर का प्रयोग करते हैं, जो कि पर्याप्त रूप से बड़ा एफपीजीए दो या दो से अधिक सॉफ्ट माइक्रोप्रोसेसर रख सकता है, जिसके परिणामस्वरूप [[मल्टी-कोर प्रोसेसर]] का निर्माण होता है। एकल एफपीजीए पर सॉफ्ट प्रोसेसर की संख्या केवल एफपीजीए के आकार से सीमित होती है।<ref>[http://www.xilinx.com/products/design_resources/proc_central/microblaze_faq.pdf MicroBlaze Soft Processor: Frequently Asked Questions] {{webarchive|url=https://web.archive.org/web/20111027074459/http://www.xilinx.com/products/design_resources/proc_central/microblaze_faq.pdf |date=2011-10-27 }}</ref> कुछ लोगों ने एक ही एफपीजीए पर दर्जनों या सैकड़ों सॉफ्ट माइक्रोप्रोसेसर का प्रयोग किया है।<ref>
István Vassányi.
István Vassányi.
"Implementing processor arrays on FPGAs". 1998.
"Implementing processor arrays on FPGAs". 1998.
[https://doi.org/10.1007%2FBFb0055278 ]
[https://doi.org/10.1007%2FBFb0055278]
</ref><ref>
</ref><ref>
Zhoukun WANG and Omar HAMMAMI.
Zhoukun WANG and Omar HAMMAMI.
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2011.
2011.
[http://www.ecnmag.com/news/2011/01/research/Over-1000-Cores-on-One-Chip.aspx] {{Webarchive|url=https://web.archive.org/web/20120305082424/http://www.ecnmag.com/news/2011/01/research/Over-1000-Cores-on-One-Chip.aspx |date=2012-03-05 }}
[http://www.ecnmag.com/news/2011/01/research/Over-1000-Cores-on-One-Chip.aspx] {{Webarchive|url=https://web.archive.org/web/20120305082424/http://www.ecnmag.com/news/2011/01/research/Over-1000-Cores-on-One-Chip.aspx |date=2012-03-05 }}
</ref> यह कंप्यूटिंग में [[बड़े पैमाने पर समानांतर]] को लागू करने का तरीका है और इसे [[इन-मेमोरी प्रोसेसिंग]] | इन-मेमोरी कंप्यूटिंग पर भी लागू किया जा सकता है।
</ref> यह कंप्यूटिंग में [[बड़े पैमाने पर समानांतर|बड़े मापदंड पर समानांतर]] को क्रियान्वित करने का उपाय है और इसे [[इन-मेमोरी प्रोसेसिंग]] कंप्यूटिंग पर भी संचालित किया जा सकता है।


एफपीजीए में कार्यान्वित नरम माइक्रोप्रोसेसर और इसके आस-पास के परिधीय असतत प्रोसेसर की तुलना में अप्रचलन के प्रति कम संवेदनशील होते हैं।<ref>{{Cite web
एफपीजीए में कार्यान्वित सॉफ्ट माइक्रोप्रोसेसर और इसके साथ के डिस्क्रीट प्रोसेसर की तुलना में प्रयोग न होने के प्रति कम संवेदनशील होते हैं।<ref>{{Cite web
  | author=Joe DeLaere.
  | author=Joe DeLaere.
  | url=https://www.altera.com/content/dam/altera-www/global/en_US/pdfs/literature/wp/wp-01255-top-7-reasons-to-replace-your-microcontroller-with-a-max-10-fpga.pdf  
  | url=https://www.altera.com/content/dam/altera-www/global/en_US/pdfs/literature/wp/wp-01255-top-7-reasons-to-replace-your-microcontroller-with-a-max-10-fpga.pdf  
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{{Cite web|url=https://www.electronicsweekly.com/news/products/fpga-news/fpga-processor-ip-needs-to-be-supported-2010-02/|title=FPGA processor IP needs to be supported|last=Staff|date=2010-02-03|website=Electronics Weekly|language=en-GB|access-date=2019-04-03}}
{{Cite web|url=https://www.electronicsweekly.com/news/products/fpga-news/fpga-processor-ip-needs-to-be-supported-2010-02/|title=FPGA processor IP needs to be supported|last=Staff|date=2010-02-03|website=Electronics Weekly|language=en-GB|access-date=2019-04-03}}
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{| class="wikitable sortable"
{| class="wikitable sortable"
|-
|-
! Processor
! प्रोसेसर
! Developer
! डेवलपर
! Open source
! ओपन सोर्स
! Bus support
! बस सपोर्ट
! Notes
! नोट्स
! Project home
! प्रोजेक्ट होम
! Description language
! डिस्क्रिप्सन लैंग्वेज
|-
|-
| colspan="7" align="center" | ''based on the [[ARM architecture|ARM]] instruction set architecture''
| colspan="7" align="center" | ''[[ARM architecture|एआरएम]] इंस्ट्रक्शन सेट आर्किटेक्चर पर आधारित''
|-
|-
| [[Amber (processor core)|Amber]]
| [[Amber (processor core)|एम्बर]]  
| Conor Santifort
|कॉनर सैंटीफोर्ट
| {{yes|LGPLv2.1}}
| {{yes|LGPLv2.1}}
| [[Wishbone (computer bus)|Wishbone]]
| [[Wishbone (computer bus)|विशबोन]]
| [[ARM architecture|ARMv2a]] 3-stage or 5-stage pipeline
| [[ARM architecture|एआरएमवी2ए]] 3-स्टेज या 5-स्टेज
| [https://opencores.org/project/amber Project page at Opencores]
| [https://opencores.org/project/amber ओपनकोर्स पर प्रोजेक्ट पेज]
| Verilog
| वेरीलॉग
|-
|-
| [[Cortex-M1]]
| [[Cortex-M1|कॉरटेक्स-एम1]]
| [[ARM Holdings|ARM]]
| [[ARM Holdings|एआरएम]]
| {{no}}
| {{no}}
| [http://www.arm.com/products/system-ip/interconnect/index.php]
| [http://www.arm.com/products/system-ip/interconnect/index.php]
| 70–200MHz, 32-bit RISC
| 70–200मेगाहर्टज, 32-बिट आरआईएससी
| [http://www.arm.com/products/CPUs/ARM_Cortex-M1.html]
| [http://www.arm.com/products/CPUs/ARM_Cortex-M1.html]
| Verilog
| वेरीलॉग
|-
|-
| colspan="7" align="center" | ''based on the [[AVR microcontrollers|AVR]] instruction set architecture''
| colspan="7" align="center" | ''[[AVR microcontrollers|ए.वी.आर]] इन्सट्रक्शन सेट आर्किटेक्चर पर आधारित''
|-
|-
| Navré
|नेवरे
| Sébastien Bourdeauducq
|सेबेस्टियन बॉर्डेउडुक
| {{yes}}
| {{yes}}
| Direct SRAM
|डायरेक्ट एसआरएएम
| [[Atmel AVR]]-compatible 8-bit RISC
| [[Atmel AVR|एटमेल ए.वी.आर]]-compatible 8-बिट आरआईएससी
| [http://opencores.org/project,navre Project page at Opencores]
| [http://opencores.org/project,navre ओपनकोर्स पर प्रोजेक्ट पेज]
| Verilog
| वेरीलॉग
|-
|-
| pAVR
| पी.ए.वी.आर
| Doru Cuturela
|डोरू क्यूटुरेला
| {{yes}}
| {{yes}}
|
|
| [[Atmel AVR]]-compatible 8-bit RISC
| [[Atmel AVR|एटमेल ए.वी.आर]]- कॉम्पिटेबल 8-बिट आरआईएससी
| [http://opencores.org/project,pavr Project page at Opencores]
| [http://opencores.org/project,pavr ओपनकोर्स पर प्रोजेक्ट पेज]
| VHDL
| वीएचडीएल
|-
|-
| softavrcore
| सॉफ्ट ए.वी.आर कोर
| Andras Pal
|एंड्रास पाल
| {{yes}}
| {{yes}}
| Standard AVR buses (core-coupled I/O, synchronous SRAM, synchronous program ROM)
|मानक ए.वी.आर. बसें (कोर-युग्मित आई/ओ, सिंक्रोनस एस रैम, सिंक्रोनस प्रोग्राम रोम)
| [[Atmel AVR]]-compatible 8-bit RISC (up to AVR5), peripherals and SoC features included
| [[Atmel AVR|एटमेल ए.वी.आर]]-संगत 8-बिट आरटीआईसी (ए.वी.आर5 तक), परिधीय और एसओएस सुविधाएँ सम्मिलित हैं
| [http://opencores.org/project/softavrcore Project page at Opencores]
| [http://opencores.org/project/softavrcore ओपनकोर्स पर प्रोजेक्ट पेज]
| Verilog
| वेरीलॉग
|-
|-
| colspan="7" align="center" | ''based on the [[MicroBlaze]] instruction set architecture''
| colspan="7" align="center" | ''माइक्रो ब्लेज़ इंस्ट्रक्शन सेट आर्किटेक्चर पर आधारित''
|-
|-
| [[AEMB]]
| [http://www.aeste.my/aemb][[AEMB|एईएमबी]]
| Shawn Tan
|शॉन टैन
| {{yes}}
| {{yes}}
| [[Wishbone (computer bus)|Wishbone]]
|   [[Wishbone (computer bus)|विशबोन]]
| MicroBlaze EDK 3.2 compatible
|माइक्रोब्लेज़ ईडीके 3.2 संगत
| [http://www.aeste.my/aemb AEMB]
| [http://www.aeste.my/aemb एईएमबी]  
| Verilog
| वेरीलॉग
|-
|-
| [[MicroBlaze]]
| [[MicroBlaze|माइक्रो ब्लेज़]]
| [[Xilinx]]
| [[Xilinx|जीलीनिक्स]]
| {{no}}
| {{no}}
| PLB, OPB, FSL, LMB, AXI4
|पीएलबी, ओपीबी, एफएसएल, एलएमबी, एएक्सआई4
|
|
| [https://web.archive.org/web/20030430214925/http://www.xilinx.com/microblaze/ Xilinx MicroBlaze]
| [https://web.archive.org/web/20030430214925/http://www.xilinx.com/microblaze/ शीलाइनक्स माइक्रोब्लेज़]
|
|
|-
|-
| [[OpenFire Soft Processor|OpenFire]]
| [[OpenFire Soft Processor|ओपेन फायर]]
| Virginia Tech CCM Lab
|वर्जीनिया टेक सीसीएम लैब
| {{yes}}
| {{yes}}
| OPB, FSL
|ओपीबी, एफएसएल
| Binary compatible with the MicroBlaze
|माइक्रोब्लेज़ के साथ बाइनरी संगत
| [https://web.archive.org/web/20090724052731/http://www.ccm.ece.vt.edu/~scraven/openfire.html]<ref>{{Cite web|url=http://opencores.org/project,openfire_core,overview|title=Overview :: OpenFire Processor Core :: OpenCores}}</ref>
| [https://web.archive.org/web/20090724052731/http://www.ccm.ece.vt.edu/~scraven/openfire.html]<ref>{{Cite web|url=http://opencores.org/project,openfire_core,overview|title=Overview :: OpenFire Processor Core :: OpenCores}}</ref>
| Verilog
| वेरीलॉग
|-
|-
| [[SecretBlaze]]
| [[SecretBlaze|सीक्रेट ब्लेज]]
| LIRMM, University of Montpellier / CNRS
|एलआईआरएमएम, मोंटपेलियर विश्वविद्यालय / सीएनआरएस
| {{yes}}
| {{yes}}
| [[Wishbone (computer bus)|Wishbone]]
| [[Wishbone (computer bus)|विशबोन]]
| MicroBlaze ISA, VHDL
|माइक्रोब्लेज़ आईएसए, वीएचडीएचएल
| [http://www.lirmm.fr/ADAC/?page_id=462 SecretBlaze]
| [http://www.lirmm.fr/ADAC/?page_id=462 सीक्रेटब्लेज़]
| VHDL
| वीएचडीएल
|-
|-
| colspan="7" align="center" | ''based on the [[MCS-51]] instruction set architecture''
| colspan="7" align="center" | ''[[MCS-51|एमसीएस-51]] इन्सट्रक्शन सेट आर्किटेक्चर पर आधारित''
|-
|-
| [http://www.microcorelabs.com MCL51]
| [http://www.microcorelabs.com एमसीएल51]
| [[MicroCore Labs]]
| [[MicroCore Labs|माइक्रो कोर लैब]]
| {{yes}}
| {{yes}}
| Ultra-small-footprint microsequencer-based 8051 core
|अल्ट्रा-स्मॉल-फ़ुटप्रिंट माइक्रोसेक्वेंसर-आधारित 8051 कोर
| 312 Artix-7 LUTs. Quad-core 8051 version is 1227 LUTs.
|312 आर्टिक्स-7 एलयूटी। क्वाड-कोर 8051 संस्करण 1227 एलयूटी है।
| [http://www.microcorelabs.com MCL51 Core]
| [http://www.microcorelabs.com एमसीएल51 कोर]
|
|
|-
|-
| [https://web.archive.org/web/20131008041359/http://wiki.altium.com/display/ADOH/TSK51x+MCU TSK51/52]
| [https://web.archive.org/web/20131008041359/http://wiki.altium.com/display/ADOH/TSK51x+MCU टीएसके51/52]
| [[Altium]]
| [[Altium|अल्टिम]]
| {{no|Royalty-free}}
| {{no|Royalty-free}}
| [[Wishbone (computer bus)|Wishbone]] / [[Intel 8051]]
| [[Wishbone (computer bus)|विशबोन/इंटेल 8051]]
| 8-bit [[Intel 8051]] instruction set compatible, lower clock cycle alternative
|8-बिट इंटेल 8051 निर्देश सेट संगत, लोवर क्लाक साइकल विकल्प
| [https://web.archive.org/web/20160306202550/http://wiki.altium.com/display/adoh/processor-based+fpga+design Embedded Design on Altium Wiki]
| [https://web.archive.org/web/20160306202550/http://wiki.altium.com/display/adoh/processor-based+fpga+design अल्टिम विकी पर एंबेडेड डिज़ाइन]  
|
|
|-
|-
| colspan="7" align="center" | ''based on the [[MIPS architecture|MIPS]] instruction set architecture''
| colspan="7" align="center" |   ''[[MIPS architecture|एमआईपीएस]] इन्सट्रक्शन सेट आर्किटेक्चर पर आधारित''
|-
|-
| [http://www.cl.cam.ac.uk/research/security/ctsrd/beri/ BERI]
| [http://www.cl.cam.ac.uk/research/security/ctsrd/beri/ बेरी]
| [[University of Cambridge]]
| [[University of Cambridge|यूनिवर्सिटी ऑफ कैम्ब्रिज]]
| {{yes|BSD}}
| {{yes|BSD}}
|
|
| [[MIPS architecture|MIPS]]
| ''[[MIPS architecture|एमआईपीएस]]''
| [http://www.cl.cam.ac.uk/research/security/ctsrd/beri/ Project page]
| [http://www.cl.cam.ac.uk/research/security/ctsrd/beri/ प्रोजेक्ट पेज]
| [[Bluespec]]
| [[Bluespec|ब्लूस्पेक]]  
|-
|-
| [http://www.dossmatik.de/mais-cpu.html Dossmatik]
| [http://www.dossmatik.de/mais-cpu.html डॉस मैटिक]
| [[René Doss]]
| [[René Doss|रेने डॉस]]
| {{yes|CC BY-NC 3.0, except ''commercial applicants have to pay a licence fee''.}}
| {{yes|CC BY-NC 3.0, except ''commercial applicants have to pay a licence fee''.}}
| Pipelined bus
|पाइपलाइन वाली बस
| MIPS I instruction set pipeline stages
|एमआईपीएस I इन्सट्रक्शन सेट पाइपलाइन चरण
| [http://www.dossmatik.de/mais-cpu.html Dossmatik]
| [http://www.dossmatik.de/mais-cpu.html डॉस मैटिक]
| VHDL
| वीएचडीएल
|-
|-
| [https://web.archive.org/web/20131020113429/http://wiki.altium.com/display/ADOH/TSK3000A TSK3000A]
| [https://web.archive.org/web/20131020113429/http://wiki.altium.com/display/ADOH/TSK3000A टीएसके3000ए]
| [[Altium]]
| [[Altium|अल्टिम]]
| {{no|Royalty-free}}
| {{no|Royalty-free}}
| [[Wishbone (computer bus)|Wishbone]]
| [[Wishbone (computer bus)|विशबोन]]
| 32-bit [[R3000]]-style RISC modified Harvard-architecture CPU
| 32-बिट [[R3000|आर3000]]-स्टाइल आरटीआईसी ने हार्वर्ड-आर्किटेक्चर सीपीयू को संशोधित किया
| [https://web.archive.org/web/20160306202550/http://wiki.altium.com/display/adoh/processor-based+fpga+design Embedded Design on Altium Wiki]
| [https://web.archive.org/web/20160306202550/http://wiki.altium.com/display/adoh/processor-based+fpga+design अल्टियम विकी पर एंबेडेड डिज़ाइन]  
|
|
|-
|-
| colspan="7" align="center" | ''based on the [[PicoBlaze]] instruction set architecture''
| colspan="7" align="center" | ''[[PicoBlaze|पिकोब्लेज़]] इंस्ट्रक्शन सेट आर्किटेक्चर पर आधारित''
|-
|-
| [[PacoBlaze]]
| [[PacoBlaze|पैको ब्लेज]]  
| Pablo Bleyer
| पैब्लो ब्लेयर
| {{yes}}
| {{yes}}
|
|
| Compatible with the PicoBlaze processors
|पिकोब्लेज़ प्रोसेसर के साथ संगत
| [http://bleyer.org/pacoblaze PacoBlaze]
| [http://bleyer.org/pacoblaze पैको ब्लेज]
| Verilog
| वेरीलॉग
|-
|-
| [[PicoBlaze]]
| [[PicoBlaze|पिको ब्लेज]]
| [[Xilinx]]
| [[Xilinx|जिलिनक्स]]  
| {{no}}
| {{no}}
|
|
|
|
| [https://web.archive.org/web/20030501203653/http://www.xilinx.com/picoblaze/ Xilinx PicoBlaze]
| [https://web.archive.org/web/20030501203653/http://www.xilinx.com/picoblaze/ जिलिनक्स]  
| VHDL, Verilog
{| class="wikitable sortable"
|-
|  [https://web.archive.org/web/20030501203653/http://www.xilinx.com/picoblaze/ पिको ब्लेज]
|}
| वीएचडीएल, वेरीलॉग
|-
|-
| colspan="7" align="center" | ''based on the [[RISC-V]] instruction set architecture''
| colspan="7" align="center" | ''[[RISC-V|आरआईएससी-V]] इन्सट्रक्शन सेट आर्किटेक्चर पर आधारित''
|-
|-
| [https://github.com/f32c/f32c f32c]
| [https://github.com/f32c/f32c f32c]
| University of Zagreb
|ज़ाग्रेब विश्वविद्यालय
| {{yes|BSD}}
| {{yes|BSD}}
| AXI, SDRAM, SRAM
|एक्सआई, एसडीआरएएम, एसआरएएम
| 32-bit, RISC-V / MIPS ISA subsets (retargetable), GCC toolchain
|32-बिट, आरटीआईसी-वी / एमआईपीएस आईएसए सबसेट (रीटार्गेटेबल), जीसीसी टूलचेन
| [https://github.com/f32c/f32c f32c]
| [https://github.com/f32c/f32c f32c]
| VHDL
| वीएचडीएल
|-
|-
| [https://github.com/stnolting/neorv32 NEORV32]
| [https://github.com/stnolting/neorv32 एनइओआरवी32]
| Stephan Nolting
|स्टीफ़न नोल्टिंग
| {{yes|BSD}}
| {{yes|BSD}}
| Wishbone b4, AXI4
| विशबोन बी4, एएक्सआई4
| rv32[i/e] [m] [a] [c] [b] [u] [Zfinx] [Zicsr] [Zifencei], RISC-V-compliant, CPU & SoC available, highly customizable, GCC toolchain
|rv32[i/e] [m] [a] [c] [b] [u] [Zfinx] [Zicsr] [Zifencei], आरटीआईसी-वी-कम्प्लेंट, सीपीयू और एसओसी उपलब्ध, उच्च अनुकूलन योग्य, जीसीसी टूलचेन
| [https://github.com/stnolting/neorv32 GitHub] [https://opencores.org/projects/neorv32 OpenCores]
| [https://github.com/stnolting/neorv32 गिटहब] [https://opencores.org/projects/neorv32 ओपनकोर्स]
| VHDL
| वीएचडीएल
|-
|-
| VexRiscv
|वेक्स रिस्कव
| SpinalHDL|SpinalHDL
| SpinalHDL|स्पाइनलएचडीएल
| {{Yes}}
| {{Yes}}
| AXI4 / Avalon
|एएक्सआई4 / एवलॉन
| 32-bit, RISC-V, up to 340MHz on Artix 7. Up to 1.44DMIPS/MHz.
|32-बिट, आरटीआईसीएस-वी, आर्टिक्स 7 पर 340 मेगाहर्ट्ज तक। 1.44डीएमआईपीएस/मेगाहर्ट्ज तक।
| https://github.com/SpinalHDL/VexRiscv
| [https://github.com/SpinalHDL/VexRiscv https://github.com/SpinalHDL/Vexआरआईएससीv]
| VHDLVerilog (SpinalHDL)
| वीएचडीएलवेरीलॉग
{| class="wikitable sortable"
|-
|-
| colspan="7" align="center" | ''based on the [[SPARC]] instruction set architecture''
| SpinalHDL |स्पाइनलएचडीएल
|}
|-
|-
| [[LEON|LEON2(-FT)]]
| colspan="7" align="center" |  ''[[SPARC|स्पार्क]]इन्सट्रक्शन सेट आर्किटेक्चर पर आधारित''
| [[European Space Agency|ESA]]
|-
| [[LEON|लिओन2(-एफटी)]]
| [[European Space Agency|ईएसए]]
| {{yes}}
| {{yes}}
| AMBA2
| एएमबीए2
| SPARC V8
| स्पार्क वी8
| [http://www.esa.int/TEC/Microelectronics/SEMUD70CYTE_0.html ESA]
| [http://www.esa.int/TEC/Microelectronics/SEMUD70CYTE_0.html ईएसए]
| VHDL
| वीएचडीएल
|-
|-
| [[LEON|LEON3/4]]
| [[LEON|लिओन3/4]]
| Aeroflex Gaisler
| एरोफ्लेक्स गैसलर
| {{yes}}
| {{yes}}
| AMBA2
| एएमबीए2
| SPARC V8
| स्पार्क वी8
| [http://www.gaisler.com/cms/index.php?option=com_content&task=view&id=156&Itemid=104 Aeroflex Gaisler]
| [http://www.gaisler.com/cms/index.php?option=com_content&task=view&id=156&Itemid=104 एरोफ्लेक्स गैसलर]
| VHDL
| वीएचडीएल
|-
|-
| [http://parallel.princeton.edu/openpiton/specs.html OpenPiton]
| [http://parallel.princeton.edu/openpiton/specs.html ओपन पिटोन]
| Princeton Parallel Group
|प्रिंसटन समानांतर समूह
| {{Yes}}
| {{Yes}}
|
|
| [[Manycore processor|Manycore]] [[SPARC|SPARC V9]]
| [[Manycore processor|मैनीकोर]] [[SPARC|स्पार्क वी9]]
| [http://parallel.princeton.edu/openpiton/specs.html OpenPiton]
| [http://parallel.princeton.edu/openpiton/specs.html ओपन पिटोन]
| Verilog
| वेरीलॉग
|-
|-
| [[OpenSPARC|OpenSPARC T1]]
| [[OpenSPARC|ओपन स्पार्क टी1]]
| [[Sun Microsystems|Sun]]
| [[Sun Microsystems|सन]]
| {{yes}}
| {{yes}}
|
|
| 64-bit
| 64-बिट
| [http://www.opensparc.net/opensparc-t1/index.html OpenSPARC.net]
| [http://www.opensparc.net/opensparc-t1/index.html openSPARC.net]
| Verilog
| वेरीलॉग
|-
|-
| Tacus/PIPE5
|टैकस/पाइप5
| TemLib
| टेमलिब
| {{yes}}
| {{yes}}
| Pipelined bus
| पाइपलाइन्ड बस
| SPARC V8
| स्पार्क वी8
| [http://temlib.org TEMLIB]
| [http://temlib.org टेमलिब]
| VHDL
| वीएचडीएल
|-
|-
| colspan="7" align="center" | ''based on the [[x86]] instruction set architecture''
| colspan="7" align="center" | ''[[x86]] इंस्ट्रक्शन सेट आर्किटेक्चर पर आधारित''
|-
|-
| CPU86
| सीपीयू86
| HT-Lab
| एचटी-लैब
| {{yes}}
| {{yes}}
|
|
| 8088-compatible CPU in VHDL
| 8088- वीएचडीएल में सीपीयू
| [http://www.ht-lab.com/cpu86.htm cpu86]
| [http://www.ht-lab.com/cpu86.htm सीपीयू86]
| VHDL
| वीएचडीएल
|-
|-
| [http://www.microcorelabs.com MCL86]
| [http://www.microcorelabs.com एमसीए86]
| [[MicroCore Labs]]
| [[MicroCore Labs|माइक्रोकोर लैब्स]]  
| {{yes}}
| {{yes}}
| 8088 BIU provided. Others easy to create.
| 8088 बीआईयू प्रदान किया गया। दूसरों को बनाना आसान है.
| Cycle accurate 8088/8086 implemented with a microsequencer. Less than 2% utilization of Kintex-7.
|त्रुटिहीन चक्र 8088/8086 को माइक्रोसीक्वेंसर के साथ कार्यान्वित किया गया। किंटेक्स-7 का 2% से कम उपयोग।
| [http://www.microcorelabs.com MCL86 Core]
| [http://www.microcorelabs.com एमसीएल86 कोर]
|
|
|-
|-
| [https://www.jamieiles.com/80186/ s80x86]
| [https://www.jamieiles.com/80186/ एस80एक्स86]
| Jamie Iles
|जेमी आइल्स
| {{yes|GPLv3}}
| {{yes|GPLv3}}
| Custom
| कस्टम
| 80186-compatible GPLv3 core
| 80186-संगत जीपीएलवी3 कोर
| [https://www.jamieiles.com/80186/ s80x86]
| [https://www.jamieiles.com/80186/ एस80एक्स86]
| SystemVerilog
| सिस्टम वेरीलॉग
|-
|-
| [[Zet (hardware)|Zet]]
| [[Zet (hardware)|जेट]]  
| Zeus Gómez Marmolejo
|ज़ीउस गोमेज़ मार्मोलेजो
| {{yes}}
| {{yes}}
| [[Wishbone (computer bus)|Wishbone]]
| [[Wishbone (computer bus)|विशबोन]]
| x86 PC clone
|एक्स86 पीसी क्लोन
| [https://archive.today/20130112150552/http://zet.aluzina.org/ Zet]
| [https://archive.today/20130112150552/http://zet.aluzina.org/ जेट]
| Verilog
| वेरीलॉग
|-
|-
| [[ao486 (hardware)|ao486]]
| [[ao486 (hardware)|एओ486]]
| Aleksander Osman
|अलेक्जेंडर उस्मान
| {{yes|3-Clause BSD}}
| {{yes|3-Clause BSD}}
| Avalon
| एवलॉन
| i486 SX compatible core
|आई486 एसएक्स संगत कोर
| [https://github.com/alfikpl/ao486 ao486]
| [https://github.com/alfikpl/ao486 एओ486]
| Verilog
| वेरीलॉग
|-
|-
| colspan="7" align="center" | ''based on the [[Power ISA|PowerPC/Power]] instruction set architecture''
| colspan="7" align="center" | ''[[Power ISA|पावरपीसी/पावर]] इंस्ट्रक्शन सेट आर्किटेक्चर पर आधारित''                
|-
|-
| [[PowerPC 400#PowerPC 405|PowerPC 405S]]
| [[PowerPC 400#PowerPC 405|पावरपीसी 405]][[PowerPC 400#PowerPC 470|एस]]
| IBM
| आईबीएम
| {{No}}
| {{No}}
| [[CoreConnect]]
| [[CoreConnect|कोरकनेक्ट]]
| 32-bit PowerPC v.2.03 Book E
| 32-बिट पावरपीसी v.2.03 बुक ई
| [[IBM]]
| [[IBM|आईबीएम]]                                                            
| Verilog
| वेरीलॉग
|-
|-
| [[PowerPC 400#PowerPC 440|PowerPC 440S]]
| [[PowerPC 400#PowerPC 440|पावरपीसी 440]][[PowerPC 400#PowerPC 470|एस]]
| IBM
| आईबीएम
| {{No}}
| {{No}}
| [[CoreConnect]]
| [[CoreConnect|कोरकनेक्ट]]
| 32-bit PowerPC v.2.03 Book E
| 32-बिट पावरपीसी v.2.03 बुक ई
| [[IBM]]
| [[IBM|आईबीएम]]
| Verilog
| वेरीलॉग
|-
|-
| [[PowerPC 400#PowerPC 470|PowerPC 470S]]
| [[PowerPC 400#PowerPC 470|पावरपीसी 470एस]]
| IBM
| आईबीएम
| {{No}}
| {{No}}
| [[CoreConnect]]
| [[CoreConnect|कोरकनेक्ट]]
| 32-bit PowerPC v.2.05 Book E
| 32-बिट पावरपीसी v.2.05 बुक ई
| [[IBM]]
| [[IBM|आईबीएम]]
| Verilog
| वेरीलॉग
|-
|-
| [[OpenPower Microwatt|Microwatt]]
| [[OpenPower Microwatt|माइक्रोवाट]]
| IBM/OpenPOWER
| आईबीएम/ओपेनपावर
| {{yes|CC-BY 4.0}}
| {{yes|CC-BY 4.0}}
| [[Wishbone (computer bus)|Wishbone]]
| [[Wishbone (computer bus)|विशबोन]]
| 64-bit PowerISA 3.0 proof of concept
|64-बिट पावरआईएसए 3.0 अवधारणा का प्रमाण
| [https://github.com/antonblanchard/microwatt Microwatt @ Github]
| [https://github.com/antonblanchard/microwatt माइक्रोवाट @ गिटहब]
| VHDL
| वीएचडीएल
|-
|-
| [[OpenPower Microwatt#Chiselwatt|Chiselwatt]]
| [[OpenPower Microwatt#Chiselwatt|छीसेलवाट]]
| IBM/OpenPOWER
| आईबीएम/ओपेनपावर
| {{yes|CC-BY 4.0}}
| {{yes|CC-BY 4.0}}
| [[Wishbone (computer bus)|Wishbone]]
| [[Wishbone (computer bus)|विशबोन]]
| 64-bit PowerISA 3.0
|64-बिट पावरआईएसए 3.0
| [https://github.com/antonblanchard/chiselwatt Chiselwatt @ Github]
| [https://github.com/antonblanchard/chiselwatt छिसेलवाट @ गिटहब]
| Chisel
| चिसेल
|-
|-
| [[Libre-SOC]]
|[[Libre-SOC|लिब्रे-एसओसी]]
| [https://libre-soc.org Libre-SoC.org]
| [https://libre-soc.org Libre-SoC.org]
| {{yes|BSD/LGPLv2+}}
| {{yes|BSD/LGPLv2+}}
| [[Wishbone (computer bus)|Wishbone]]
| [[Wishbone (computer bus)|विशबोन]]
| 64-bit PowerISA 3.0. CPU/GPU/VPU implementation and custom vector instructions
|64-बिट पावरआईएसए 3.0। ट्यूटोरियल/जीपीयू/वीपीयू कार्यान्वयन और कस्टम सदिस निर्देश
| [https://libre-soc.org Libre-SoC.org]
| [https://libre-soc.org Libre-SoC.org]
| python/nMigen
|पायथन/एन मिगेन
|-
|-
| [[IBM A2#A2I|A2I]]
| [[IBM A2#A2I|ए2आई]]
| IBM/OpenPOWER
| आईबीएम/ओपेनपावर
| {{yes|CC-BY 4.0}}
| {{yes|CC-BY 4.0}}
| Custom PBus
|कस्टम पीबस
| 64-bit PowerPC 2.6 Book E. In order core
| 64-बिट आडर कोर में पावरपीसी 2.6 बुक ई.  
| [https://github.com/openpower-cores/a2i A2I @ Github]
| [https://github.com/openpower-cores/a2i ए2आई @ गिटहब]
| VHDL
| वीएचडीएल
|-
|-
| [[IBM A2#A2O|A2O]]
| [[IBM A2#A2O|ए2ओ]]
| IBM/OpenPOWER
| आईबीएम/ओपेनपावर
| {{yes|CC-BY 4.0}}
| {{yes|CC-BY 4.0}}
| Custom PBus
|कस्टम पीबस
| 64-bit PowerPC 2.7 Book E. Out of order core
|9-बिट आरआईएससी, बहुत छोटा आकार, सी-प्रोग्राम के लिये
| [https://github.com/openpower-cores/a2o A2O @ Github]
| [https://github.com/openpower-cores/a2o ए2ओ @ गिटहब]
| Verilog
| वेरीलॉग
|-
|-
| colspan="7" align="center" | ''Other architectures''
| colspan="7" align="center" | अन्य आर्चिटेक्चर
|-
|-
| [[ARC (processor)|ARC]]
| [[ARC (processor)|एआरसी]]
| [[Synopsys#ARC International|ARC International]], [[Synopsys]]
| [[Synopsys|एआरसी इंटरनेशनल, सिनोप्सिस]]  
| {{no}}
| {{no}}
|
|
| 16/32/64-bit ISA RISC
| 16/32/64-बिट आईएसए आरआईएससी
| [https://www.synopsys.com/designware-ip/processor-solutions.html DesignWare ARC]
| [https://www.synopsys.com/designware-ip/processor-solutions.html डिज़ाइनवेयर एआरसी]
| Verilog
| वेरीलॉग
|-
|-
| ERIC5
|एरिक 5
| Entner Electronics
|एंटनर इलेक्ट्रॉनिक्स
| {{no}}
| {{no}}
|
|
| 9-bit RISC, very small size, C-programmable
|9-बिट आरआईएससी, बहुत छोटा आकार, सी-प्रोग्राम के योग्य
| [http://www.entner-electronics.com/tl/index.php/eric5.html ERIC5]
| [http://www.entner-electronics.com/tl/index.php/eric5.html एरिक 5]
| VHDL
| वीएचडीएल
|-
|-
| [https://github.com/howerj/forth-cpu H2 CPU]
| [https://github.com/howerj/forth-cpu एच2 सीपीयू]
| Richard James Howe
|रिचर्ड जेम्स होवे
| {{yes | MIT}}
| {{yes | MIT}}
| Custom
| कस्टम
| 16-bit Stack Machine, designed to execute Forth directly, small
|16-बिट स्टैक मशीन, फोर्थ को सीधे एक्सीक्यूट करने के लिए डिज़ाइन की गई, छोटी
| [https://github.com/howerj/forth-cpu H2 CPU]
| [https://github.com/howerj/forth-cpu एच2 सीपीयू]
| VHDL
| वीएचडीएल
|-
|-
| [http://www.fpga-cores.com/instant-soc/ Instant SoC]
| [http://www.fpga-cores.com/instant-soc/ इन्सटेन्ट सॉक]  
| [http://www.fpga-cores.com/ FPGA Cores]
| [http://www.fpga-cores.com/ एफपीजीए कोर्स]
| {{no}}
| {{no}}
| Custom
| कस्टम
| 32-bit RISC-V M Extension, SoC defined by C++
|32-बिट आरटीआईसी-वी एम एक्सटेंशन, एसओसी सी++ द्वारा परिभाषित
| [http://www.fpga-cores.com/instant-soc/ Instant SoC]
| [http://www.fpga-cores.com/instant-soc/ इन्सटेन्ट सॉक]
| VHDL
| वीएचडीएल
|-
|-
| [[Java optimized processor|JOP]]
| [[Java optimized processor|जेओपी]]
| Martin Schoeberl
|मार्टिन शॉएबर्ल
| {{yes}}
| {{yes}}
| [[SimpCon]] / [[Wishbone (computer bus)|Wishbone]] (extension)
| [[SimpCon|सिम्पकॉन]] / [[Wishbone (computer bus)|विशबोन]] (एक्सटेन्सन)
| Stack-oriented, hard real-time support, executing [[Java bytecode]] directly
|स्टैक-ओरिएंटेड, कठिन वास्तविक समय समर्थन, जावा बाइटकोड को सीधे एक्सीक्यूट करना
| [https://web.archive.org/web/20190417225405/http://www.jopdesign.com/ Jop]
| [https://web.archive.org/web/20190417225405/http://www.jopdesign.com/ जेओपी]
| VHDL
| वीएचडीएल
|-
|-
| [[LatticeMico8]]
| [[LatticeMico8|लैटिस माइको8]]
| [[Lattice Semiconductor|Lattice]]
| [[Lattice Semiconductor|लैटिस]]
| {{yes}}
| {{yes}}
| [[Wishbone (computer bus)|Wishbone]]
| [[Wishbone (computer bus)|विशबोन]]
|
|
| [http://www.latticesemi.com/Products/DesignSoftwareAndIP/IntellectualProperty/IPCore/IPCores02/Mico8.aspx LatticeMico8]
| [http://www.latticesemi.com/Products/DesignSoftwareAndIP/IntellectualProperty/IPCore/IPCores02/Mico8.aspx लैटिस माइको8]
| Verilog
| वेरीलॉग
|-
|-
| [[LatticeMico32]]
| [[LatticeMico32|लैटिस माइको32]]
| [[Lattice Semiconductor|Lattice]]
| [[Lattice Semiconductor|लैटिस]]
| {{yes}}
| {{yes}}
| [[Wishbone (computer bus)|Wishbone]]
| [[Wishbone (computer bus)|विशबोन]]
|
|
| [http://www.latticesemi.com/products/intellectualproperty/ipcores/mico32/index.cfm LatticeMico32]
| [http://www.latticesemi.com/products/intellectualproperty/ipcores/mico32/index.cfm लैटिस माइको32]
| Verilog
| वेरीलॉग
|-
|-
| [https://lxp32.github.io/ LXP32]
| [https://lxp32.github.io/ एलएक्सपी32]
| Alex Kuznetsov
|एलेक्स कुज़नेत्सोव
| {{yes|MIT}}
| {{yes|MIT}}
| [[Wishbone (computer bus)|Wishbone]]
| [[Wishbone (computer bus)|विशबोन]]
| 32-bit, 3-stage pipeline, [[register file]] based on block RAM
|32-बिट, 3-स्टेज पाइपलाइन, ब्लॉक रैम पर आधारित रजिस्टर फ़ाइल
| [https://lxp32.github.io/ lxp32]
| [https://lxp32.github.io/ lxp32]
| VHDL
| वीएचडीएल
|-
|-
| [https://github.com/MicroCoreLabs/Projects MCL65]
| [https://github.com/MicroCoreLabs/Projects एमसीएल65]
| [[MicroCore Labs]]
| [[MicroCore Labs|माइक्रोकोर लैब्स]]
| {{yes}}
| {{yes}}
| Ultra-small-footprint microsequencer-based 6502 core
|अल्ट्रा-स्मॉल-फ़ुटप्रिंट माइक्रोसीक्वेंसर-आधारित 6502 कोर
| 252 Spartan-7 LUTs. Clock cycle-exact.
|252 स्पार्टन-7 एलयूटी। त्रुटिहीन क्लॉक स्टेज.
| [https://github.com/MicroCoreLabs/Projects MCL65 Core]
| [https://github.com/MicroCoreLabs/Projects एमसीएल65 कोर]
|
|
|-
|-
| [https://mrisc32.bitsnbites.eu/ MRISC32-A1]
| [https://mrisc32.bitsnbites.eu/ एमआरआईएससी 32-ए1]
| Marcus Geelnard
|मार्कस गिलनार्ड
| {{yes}}
| {{yes}}
| [[Wishbone (computer bus)|Wishbone]], B4/pipelined
| [[Wishbone (computer bus)|विशबोन]], बी4/पाइपलाइन
| 32-bit RISC/Vector CPU implementing the MRISC32 ISA
|32-बिट आरटीआईसी/वेक्टर आर्किटेक्चर एम आरटीआईसी 32 आईएसए को कार्यान्वित कर रहा है
| [https://mrisc32.bitsnbites.eu/ MRISC32]
| [https://mrisc32.bitsnbites.eu/ एमआरआईएससी32]
| VHDL
| वीएचडीएल
|-
|-
| [https://github.com/stnolting/neo430 NEO430]
| [https://github.com/stnolting/neo430 निओ430]
| Stephan Nolting
|स्टीफ़न नोल्टिंग
| {{yes}}
| {{yes}}
| Wishbone (Avalon, AXI4-Lite)
|विस्बोन (एवलॉन, एएक्सआई4-लाइट)
| 16-bit MSP430 ISA-compatible, very small size, many peripherals, highly customizable
|16-बिट एमएसपी430 आईएसए-कैम्पैटिबल, बहुत छोटा आकार, अनेक बाह्य उपकरण, अत्यधिक कस्टमाइज़ेबल
| [https://github.com/stnolting/neo430 NEO430]
| [https://github.com/stnolting/neo430 निओ430]
| VHDL
| वीएचडीएल
|-
|-
| [[Nios embedded processor|Nios]], [[Nios II]]
| [[Nios embedded processor|एनआईओएस]], [[Nios II|एनआईओएस II]]
| [[Altera]]
| [[Altera|अल्टेरा]]  
| {{no}}
| {{no}}
| Avalon
| एवलॉन
|
|
| [https://web.archive.org/web/20101225092752/http://www.altera.com/products/ip/processors/nios2/ni2-index.html Altera Nios II]
| [https://web.archive.org/web/20101225092752/http://www.altera.com/products/ip/processors/nios2/ni2-index.html अल्टेरा एनआईओएस II]
| Verilog
| वेरीलॉग
|-
|-
| [[OpenRISC]]
| [[OpenRISC|ओपेनआरआईएससी]]
| [[OpenCores]]
| [[OpenCores|ओपेनकोर्स]]
| {{yes}}
| {{yes}}
| [[Wishbone (computer bus)|Wishbone]]
| [[Wishbone (computer bus)|विशबोन]]
| 32-bit; done in ASIC, Actel, Altera, Xilinx FPGA.
|32-बिट; एएसआईसी, एक्टेल, एल्टेरा, जिलिनक्स में किया गया।
| [https://openrisc.io/]
| [https://openrisc.io/]
| Verilog
| वेरीलॉग
|-
|-
| [[SpartanMC]]
| [[SpartanMC|स्पार्टनएमसी]]
| TU Darmstadt / TU Dresden
|टीयू डार्मस्टेड / टीयू ड्रेसडेन
| {{Yes}}
| {{Yes}}
| Custom ([[Advanced eXtensible Interface|AXI]] support in development)
| कस्टम ([[Advanced eXtensible Interface|एएक्सआई]] के विकास में समर्थन
| 18-bit ISA (GNU Binutils / GCC support in development)
|18-बिट आईएसए (विकास में जीएनयू बिनुटिल्स/जीसीसी समर्थन)
| [http://www.spartanmc.de SpartanMC]
| [http://www.spartanmc.de स्पार्टनएमसी]
| Verilog
| वेरीलॉग
|-
|-
| SYNPIC12
|सिंपिक 12
| Miguel Angel Ajo Pelayo
|मिगुएल एंजेल एजो पेलायो
| {{yes|MIT}}
| {{yes|MIT}}
|
|
| PIC12F compatible, program synthesised in gates
|पीआईसी12एफ कम्पैटिबल, प्रोग्राम गेट्स में संश्लेषित
| [http://projects.nbee.es/display/IPCORES/SYNPIC12+8bit+RISC+CPU+core nbee.es]
| [http://projects.nbee.es/display/IPCORES/SYNPIC12+8bit+RISC+CPU+core nbee.es]
| VHDL
| वीएचडीएल
|-
|-
| [[xr16]]
| [[xr16|एक्सआर16]]
| Jan Gray
|जान ग्रे
| {{no}}
| {{no}}
| XSOC abstract bus
|एक्सएस ओसी एब्सट्रेक्ट बस
| 16-bit RISC CPU and SoC featured in Circuit Cellar Magazine #116-118
|परिपथ सेलर पत्रिका #116-118 में 16-बिट आरटीआइ बेसिक्स और एसओसी को प्रदर्शित किया गया
| [http://www.fpgacpu.org/xsoc/index.html XSOC/xr16]
| [http://www.fpgacpu.org/xsoc/index.html एक्सएसओसी/xr16]
| Schematic
| योजनाबद्ध
|-
|-
| [[YASEP (architecture)|YASEP]]
| [[YASEP (architecture)|यासेप]]  
| Yann Guidon
|यान गाइडन
| {{yes|AGPLv3}}
| {{yes|AGPLv3}}
| Direct SRAM
|डायरेक्ट एसआरएएम
| 16 or 32 bits, RTL in [https://web.archive.org/web/20121207045204/http://yasep.org/VHDL/ VHDL] & [http://yasep.org/#!ASM/impASM#examples/keywords.yas asm] in [[JavaScript|JS]], microcontroller subset : ready
|16 या 32 बिट्स, वीएचडीएल में आरटीएल और जेएस में एएसएम, माइक्रोकंट्रोलर सबसेट: तैयार
| [http://yasep.org yasep.org] ([http://www.mozilla.com/ Firefox] required)
| [http://yasep.org yasep.org] ([http://www.mozilla.com/ Firefox] required)
| VHDL
| वीएचडीएल
|-
|-
| [http://zipcpu.com/about/zipcpu.html ZipCPU]
| [http://zipcpu.com/about/zipcpu.html जिपसीपीयू]
| [http://zipcpu.com/about/gisselquist-technology.html Gisselquist Technology]
| [http://zipcpu.com/about/gisselquist-technology.html गिसेलक्विस्ट टेक्नोलॉजी]
| {{yes|GPLv3}}
| {{yes|GPLv3}}
| Wishbone, B4/pipelined
|विस्बोन, बी4/पाइपलाइन
| 32-bit CPU targeted for minimal FPGA resource usage
|32-बिट प्रोटोटाइप न्यूनतम संसाधन उपयोग के लिए लक्षित है
| [http://zipcpu.com/about/zipcpu.html zipcpu.com]
| [http://zipcpu.com/about/zipcpu.html zipcpu.com]
| Verilog
| वेरीलॉग
|-
|-
| [[ZPU (microprocessor)|ZPU]]
| [[ZPU (microprocessor)|जेडपीयू]]
| Zylin AS
|ज़िलिन ए.एस
| {{yes}}
| {{yes}}
| [[Wishbone (computer bus)|Wishbone]]
| [[Wishbone (computer bus)|विशबोन]]
| Stack based CPU, configurable 16/32 bit datapath, [[eCos]] support
|स्टैक आधारित गेम, कॉन्फ़िगर करने योग्य 16/32 बिट डेटापथ, ईकोस समर्थन
| [http://opensource.zylin.com/zpu.htm Zylin CPU]
| [http://opensource.zylin.com/zpu.htm जाइलिल सीपीयू]
| VHDL
| वीएचडीएल
|-
|-
|RISC5
|आरआईएससी5
|Niklaus Wirth| Niklaus Wirth
|Niklaus Wirth|निकलॉस विर्थ
| {{yes}}
| {{yes}}
|Custom
|कस्टम
|Running a complete graphical Oberon System including an editor and compiler. Software can be developed and ran on the same FPGA board.
|संपादक और कंपाइलर सहित एक संपूर्ण ग्राफिकल ओबेरॉन सिस्टम चलाना। सॉफ्टवेयर को एक ही चिपबोर्ड पर विकसित और चलाया जा सकता है।
|[http://www.projectoberon.com/ www.projectoberon.com/]
|[http://www.projectoberon.com/ www.projectoberon.com/]
|Verilog
|वेरीलॉग
|}
|}


 
== यह भी देखे ==
== यह भी देखें ==
** [[एक चिप पर सिस्टम|चिप पर सिस्टम]] (एसओस)
* [[एक चिप पर सिस्टम|चिप पर सिस्टम]]|सिस्टम-ऑन-ए-चिप (SoC)
*** [[एक चिप पर नेटवर्क|चिप पर नेटवर्क]] (एनओसी)
** [[एक चिप पर नेटवर्क|चिप पर नेटवर्क]]|नेटवर्क-ऑन-ए-चिप (NoC)
* [[पुन: कॉन्फ़िगर करने योग्य कंप्यूटिंग]]
* [[पुन: कॉन्फ़िगर करने योग्य कंप्यूटिंग]]
** फील्ड-प्रोग्रामेबल गेट ऐरे (एफपीजीए)
** फील्ड-प्रोग्रामेबल गेट ऐरे (एफपीजीए)
* [[वीएचडीएल]]
* [[वीएचडीएल]]
* [[ Verilog ]]
* [[ Verilog | वेरीलॉग]]  
** सिस्टम वेरिलॉग
** सिस्टम वेरिलॉग
* [[हार्डवेयर एक्सिलरेशन]]
* [[हार्डवेयर एक्सिलरेशन]]


==संदर्भ==
==संदर्भ==
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== बाहरी संबंध ==
== बाहरी संबंध ==
* [https://web.archive.org/web/20091026171102/http://1-core.com/library/digital/soft-cpu-cores/ Soft CPU Cores for FPGA]
* [https://web.archive.org/web/20091026171102/http://1-core.com/library/digital/soft-cpu-cores/ Soft सीपीयू Cores for एफपीजीए]
* [https://web.archive.org/web/20070615082550/http://www.ews.uiuc.edu/~pdabrows/soft_processor_comparison.html Detailed Comparison of 12 Soft Microprocessors]
* [https://web.archive.org/web/20070615082550/http://www.ews.uiuc.edu/~pdabrows/soft_processor_comparison.html Detailed Comparison of 12 Soft Microprocessors]
* [http://www.fpgacpu.org FPGA CPU News]
* [http://www.fpgacpu.org एफपीजीए सीपीयू News]
* [http://f-cpu.org Freedom CPU website]
* [http://f-cpu.org Freedom सीपीयू website]
* [http://opencores.org/projects Microprocessor cores] on Opencores.org (Expand the "Processor" tab)
* [http://opencores.org/projects Microprocessor cores] on ओपेनcores.org (Expand the "Processor" tab)
* [http://www.niktech.com NikTech] 32 bit RISC Microprocessor MANIK.
* [http://www.niktech.com NikTech] 32 बिट आरआईएससी Microprocessor MANIK.
 
{{DEFAULTSORT:Soft Microprocessor}}
{{Soft microprocessors}}
{{Programmable Logic}}
{{DEFAULTSORT:Soft Microprocessor}}[[Category: सॉफ्ट माइक्रोप्रोसेसर|*]]
 
 


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Latest revision as of 17:07, 21 August 2023

सॉफ्ट माइक्रोप्रोसेसर (जिसे सॉफ्टकोर माइक्रोप्रोसेसर या सॉफ्ट प्रोसेसर भी कहा जाता है) माइक्रोप्रोसेसर कोर है। जिसे लॉजिक सिन्थेसिस का उपयोग करके पूर्णतः कार्यान्वित किया जा सकता है। इसे प्रोग्रामेबल लॉजिक (जैसे, विशिष्ट एकीकृत परिपथ आवेदन, क्षेत्र में प्रोग्राम की जा सकने वाली डोर श्रंखला, काम्प्लेक्स प्रोग्राम करने योग्य लॉजिक उपकरण ) वाले विभिन्न अर्धचालक उपकरणों के माध्यम से कार्यान्वित किया जा सकता है, जिसमें हाई-एंड कमोडिटी दोनों विविधताएं सम्मिलित हैं।[1]

अधिकांश सिस्टम, यदि वह किसी सॉफ्ट प्रोसेसर का उपयोग करते हैं, तब केवल एक ही सॉफ्ट प्रोसेसर का उपयोग करते हैं। चूंकि कुछ डिज़ाइनर एफपीजीए पर उतने ही सॉफ्ट कोर का प्रयोग करते हैं, जितने उपयुक्त होंगे।[2] उन मल्टी कोर सिस्टम में क्लस्टर में सभी कोर के मध्य सम्भवतः ही कभी उपयोग किए जाने वाले संसाधनों को साझा किया जा सकता है।

जबकि अनेक लोग एफपीजीए पर बिल्कुल सॉफ्ट माइक्रोप्रोसेसर का प्रयोग करते हैं, जो कि पर्याप्त रूप से बड़ा एफपीजीए दो या दो से अधिक सॉफ्ट माइक्रोप्रोसेसर रख सकता है, जिसके परिणामस्वरूप मल्टी-कोर प्रोसेसर का निर्माण होता है। एकल एफपीजीए पर सॉफ्ट प्रोसेसर की संख्या केवल एफपीजीए के आकार से सीमित होती है।[3] कुछ लोगों ने एक ही एफपीजीए पर दर्जनों या सैकड़ों सॉफ्ट माइक्रोप्रोसेसर का प्रयोग किया है।[4][5][6][7][8] यह कंप्यूटिंग में बड़े मापदंड पर समानांतर को क्रियान्वित करने का उपाय है और इसे इन-मेमोरी प्रोसेसिंग कंप्यूटिंग पर भी संचालित किया जा सकता है।

एफपीजीए में कार्यान्वित सॉफ्ट माइक्रोप्रोसेसर और इसके साथ के डिस्क्रीट प्रोसेसर की तुलना में प्रयोग न होने के प्रति कम संवेदनशील होते हैं।[9][10][11]


कोर तुलना

प्रोसेसर डेवलपर ओपन सोर्स बस सपोर्ट नोट्स प्रोजेक्ट होम डिस्क्रिप्सन लैंग्वेज
एआरएम इंस्ट्रक्शन सेट आर्किटेक्चर पर आधारित
एम्बर कॉनर सैंटीफोर्ट LGPLv2.1 विशबोन एआरएमवी2ए 3-स्टेज या 5-स्टेज ओपनकोर्स पर प्रोजेक्ट पेज वेरीलॉग
कॉरटेक्स-एम1 एआरएम No [6] 70–200मेगाहर्टज, 32-बिट आरआईएससी [7] वेरीलॉग
ए.वी.आर इन्सट्रक्शन सेट आर्किटेक्चर पर आधारित
नेवरे सेबेस्टियन बॉर्डेउडुक Yes डायरेक्ट एसआरएएम एटमेल ए.वी.आर-compatible 8-बिट आरआईएससी ओपनकोर्स पर प्रोजेक्ट पेज वेरीलॉग
पी.ए.वी.आर डोरू क्यूटुरेला Yes एटमेल ए.वी.आर- कॉम्पिटेबल 8-बिट आरआईएससी ओपनकोर्स पर प्रोजेक्ट पेज वीएचडीएल
सॉफ्ट ए.वी.आर कोर एंड्रास पाल Yes मानक ए.वी.आर. बसें (कोर-युग्मित आई/ओ, सिंक्रोनस एस रैम, सिंक्रोनस प्रोग्राम रोम) एटमेल ए.वी.आर-संगत 8-बिट आरटीआईसी (ए.वी.आर5 तक), परिधीय और एसओएस सुविधाएँ सम्मिलित हैं ओपनकोर्स पर प्रोजेक्ट पेज वेरीलॉग
माइक्रो ब्लेज़ इंस्ट्रक्शन सेट आर्किटेक्चर पर आधारित
[8]एईएमबी शॉन टैन Yes विशबोन माइक्रोब्लेज़ ईडीके 3.2 संगत एईएमबी वेरीलॉग
माइक्रो ब्लेज़ जीलीनिक्स No पीएलबी, ओपीबी, एफएसएल, एलएमबी, एएक्सआई4 शीलाइनक्स माइक्रोब्लेज़
ओपेन फायर वर्जीनिया टेक सीसीएम लैब Yes ओपीबी, एफएसएल माइक्रोब्लेज़ के साथ बाइनरी संगत [9][12] वेरीलॉग
सीक्रेट ब्लेज एलआईआरएमएम, मोंटपेलियर विश्वविद्यालय / सीएनआरएस Yes विशबोन माइक्रोब्लेज़ आईएसए, वीएचडीएचएल सीक्रेटब्लेज़ वीएचडीएल
एमसीएस-51 इन्सट्रक्शन सेट आर्किटेक्चर पर आधारित
एमसीएल51 माइक्रो कोर लैब Yes अल्ट्रा-स्मॉल-फ़ुटप्रिंट माइक्रोसेक्वेंसर-आधारित 8051 कोर 312 आर्टिक्स-7 एलयूटी। क्वाड-कोर 8051 संस्करण 1227 एलयूटी है। एमसीएल51 कोर
टीएसके51/52 अल्टिम Royalty-free विशबोन/इंटेल 8051 8-बिट इंटेल 8051 निर्देश सेट संगत, लोवर क्लाक साइकल विकल्प अल्टिम विकी पर एंबेडेड डिज़ाइन
एमआईपीएस इन्सट्रक्शन सेट आर्किटेक्चर पर आधारित
बेरी यूनिवर्सिटी ऑफ कैम्ब्रिज BSD एमआईपीएस प्रोजेक्ट पेज ब्लूस्पेक
डॉस मैटिक रेने डॉस CC BY-NC 3.0, except commercial applicants have to pay a licence fee. पाइपलाइन वाली बस एमआईपीएस I इन्सट्रक्शन सेट पाइपलाइन चरण डॉस मैटिक वीएचडीएल
टीएसके3000ए अल्टिम Royalty-free विशबोन 32-बिट आर3000-स्टाइल आरटीआईसी ने हार्वर्ड-आर्किटेक्चर सीपीयू को संशोधित किया अल्टियम विकी पर एंबेडेड डिज़ाइन
पिकोब्लेज़ इंस्ट्रक्शन सेट आर्किटेक्चर पर आधारित
पैको ब्लेज पैब्लो ब्लेयर Yes पिकोब्लेज़ प्रोसेसर के साथ संगत पैको ब्लेज वेरीलॉग
पिको ब्लेज जिलिनक्स No जिलिनक्स
पिको ब्लेज
वीएचडीएल, वेरीलॉग
आरआईएससी-V इन्सट्रक्शन सेट आर्किटेक्चर पर आधारित
f32c ज़ाग्रेब विश्वविद्यालय BSD एक्सआई, एसडीआरएएम, एसआरएएम 32-बिट, आरटीआईसी-वी / एमआईपीएस आईएसए सबसेट (रीटार्गेटेबल), जीसीसी टूलचेन f32c वीएचडीएल
एनइओआरवी32 स्टीफ़न नोल्टिंग BSD विशबोन बी4, एएक्सआई4 rv32[i/e] [m] [a] [c] [b] [u] [Zfinx] [Zicsr] [Zifencei], आरटीआईसी-वी-कम्प्लेंट, सीपीयू और एसओसी उपलब्ध, उच्च अनुकूलन योग्य, जीसीसी टूलचेन गिटहब ओपनकोर्स वीएचडीएल
वेक्स रिस्कव स्पाइनलएचडीएल Yes एएक्सआई4 / एवलॉन 32-बिट, आरटीआईसीएस-वी, आर्टिक्स 7 पर 340 मेगाहर्ट्ज तक। 1.44डीएमआईपीएस/मेगाहर्ट्ज तक। https://github.com/SpinalHDL/Vexआरआईएससीv वीएचडीएलवेरीलॉग
स्पाइनलएचडीएल
स्पार्कइन्सट्रक्शन सेट आर्किटेक्चर पर आधारित
लिओन2(-एफटी) ईएसए Yes एएमबीए2 स्पार्क वी8 ईएसए वीएचडीएल
लिओन3/4 एरोफ्लेक्स गैसलर Yes एएमबीए2 स्पार्क वी8 एरोफ्लेक्स गैसलर वीएचडीएल
ओपन पिटोन प्रिंसटन समानांतर समूह Yes मैनीकोर स्पार्क वी9 ओपन पिटोन वेरीलॉग
ओपन स्पार्क टी1 सन Yes 64-बिट openSPARC.net वेरीलॉग
टैकस/पाइप5 टेमलिब Yes पाइपलाइन्ड बस स्पार्क वी8 टेमलिब वीएचडीएल
x86 इंस्ट्रक्शन सेट आर्किटेक्चर पर आधारित
सीपीयू86 एचटी-लैब Yes 8088- वीएचडीएल में सीपीयू सीपीयू86 वीएचडीएल
एमसीए86 माइक्रोकोर लैब्स Yes 8088 बीआईयू प्रदान किया गया। दूसरों को बनाना आसान है. त्रुटिहीन चक्र 8088/8086 को माइक्रोसीक्वेंसर के साथ कार्यान्वित किया गया। किंटेक्स-7 का 2% से कम उपयोग। एमसीएल86 कोर
एस80एक्स86 जेमी आइल्स GPLv3 कस्टम 80186-संगत जीपीएलवी3 कोर एस80एक्स86 सिस्टम वेरीलॉग
जेट ज़ीउस गोमेज़ मार्मोलेजो Yes विशबोन एक्स86 पीसी क्लोन जेट वेरीलॉग
एओ486 अलेक्जेंडर उस्मान 3-Clause BSD एवलॉन आई486 एसएक्स संगत कोर एओ486 वेरीलॉग
पावरपीसी/पावर इंस्ट्रक्शन सेट आर्किटेक्चर पर आधारित
पावरपीसी 405एस आईबीएम No कोरकनेक्ट 32-बिट पावरपीसी v.2.03 बुक ई आईबीएम वेरीलॉग
पावरपीसी 440एस आईबीएम No कोरकनेक्ट 32-बिट पावरपीसी v.2.03 बुक ई आईबीएम वेरीलॉग
पावरपीसी 470एस आईबीएम No कोरकनेक्ट 32-बिट पावरपीसी v.2.05 बुक ई आईबीएम वेरीलॉग
माइक्रोवाट आईबीएम/ओपेनपावर CC-BY 4.0 विशबोन 64-बिट पावरआईएसए 3.0 अवधारणा का प्रमाण माइक्रोवाट @ गिटहब वीएचडीएल
छीसेलवाट आईबीएम/ओपेनपावर CC-BY 4.0 विशबोन 64-बिट पावरआईएसए 3.0 छिसेलवाट @ गिटहब चिसेल
लिब्रे-एसओसी Libre-SoC.org BSD/LGPLv2+ विशबोन 64-बिट पावरआईएसए 3.0। ट्यूटोरियल/जीपीयू/वीपीयू कार्यान्वयन और कस्टम सदिस निर्देश Libre-SoC.org पायथन/एन मिगेन
ए2आई आईबीएम/ओपेनपावर CC-BY 4.0 कस्टम पीबस 64-बिट आडर कोर में पावरपीसी 2.6 बुक ई. ए2आई @ गिटहब वीएचडीएल
ए2ओ आईबीएम/ओपेनपावर CC-BY 4.0 कस्टम पीबस 9-बिट आरआईएससी, बहुत छोटा आकार, सी-प्रोग्राम के लिये ए2ओ @ गिटहब वेरीलॉग
अन्य आर्चिटेक्चर
एआरसी एआरसी इंटरनेशनल, सिनोप्सिस No 16/32/64-बिट आईएसए आरआईएससी डिज़ाइनवेयर एआरसी वेरीलॉग
एरिक 5 एंटनर इलेक्ट्रॉनिक्स No 9-बिट आरआईएससी, बहुत छोटा आकार, सी-प्रोग्राम के योग्य एरिक 5 वीएचडीएल
एच2 सीपीयू रिचर्ड जेम्स होवे MIT कस्टम 16-बिट स्टैक मशीन, फोर्थ को सीधे एक्सीक्यूट करने के लिए डिज़ाइन की गई, छोटी एच2 सीपीयू वीएचडीएल
इन्सटेन्ट सॉक एफपीजीए कोर्स No कस्टम 32-बिट आरटीआईसी-वी एम एक्सटेंशन, एसओसी सी++ द्वारा परिभाषित इन्सटेन्ट सॉक वीएचडीएल
जेओपी मार्टिन शॉएबर्ल Yes सिम्पकॉन / विशबोन (एक्सटेन्सन) स्टैक-ओरिएंटेड, कठिन वास्तविक समय समर्थन, जावा बाइटकोड को सीधे एक्सीक्यूट करना जेओपी वीएचडीएल
लैटिस माइको8 लैटिस Yes विशबोन लैटिस माइको8 वेरीलॉग
लैटिस माइको32 लैटिस Yes विशबोन लैटिस माइको32 वेरीलॉग
एलएक्सपी32 एलेक्स कुज़नेत्सोव MIT विशबोन 32-बिट, 3-स्टेज पाइपलाइन, ब्लॉक रैम पर आधारित रजिस्टर फ़ाइल lxp32 वीएचडीएल
एमसीएल65 माइक्रोकोर लैब्स Yes अल्ट्रा-स्मॉल-फ़ुटप्रिंट माइक्रोसीक्वेंसर-आधारित 6502 कोर 252 स्पार्टन-7 एलयूटी। त्रुटिहीन क्लॉक स्टेज. एमसीएल65 कोर
एमआरआईएससी 32-ए1 मार्कस गिलनार्ड Yes विशबोन, बी4/पाइपलाइन 32-बिट आरटीआईसी/वेक्टर आर्किटेक्चर एम आरटीआईसी 32 आईएसए को कार्यान्वित कर रहा है एमआरआईएससी32 वीएचडीएल
निओ430 स्टीफ़न नोल्टिंग Yes विस्बोन (एवलॉन, एएक्सआई4-लाइट) 16-बिट एमएसपी430 आईएसए-कैम्पैटिबल, बहुत छोटा आकार, अनेक बाह्य उपकरण, अत्यधिक कस्टमाइज़ेबल निओ430 वीएचडीएल
एनआईओएस, एनआईओएस II अल्टेरा No एवलॉन अल्टेरा एनआईओएस II वेरीलॉग
ओपेनआरआईएससी ओपेनकोर्स Yes विशबोन 32-बिट; एएसआईसी, एक्टेल, एल्टेरा, जिलिनक्स में किया गया। [10] वेरीलॉग
स्पार्टनएमसी टीयू डार्मस्टेड / टीयू ड्रेसडेन Yes कस्टम (एएक्सआई के विकास में समर्थन 18-बिट आईएसए (विकास में जीएनयू बिनुटिल्स/जीसीसी समर्थन) स्पार्टनएमसी वेरीलॉग
सिंपिक 12 मिगुएल एंजेल एजो पेलायो MIT पीआईसी12एफ कम्पैटिबल, प्रोग्राम गेट्स में संश्लेषित nbee.es वीएचडीएल
एक्सआर16 जान ग्रे No एक्सएस ओसी एब्सट्रेक्ट बस परिपथ सेलर पत्रिका #116-118 में 16-बिट आरटीआइ बेसिक्स और एसओसी को प्रदर्शित किया गया एक्सएसओसी/xr16 योजनाबद्ध
यासेप यान गाइडन AGPLv3 डायरेक्ट एसआरएएम 16 या 32 बिट्स, वीएचडीएल में आरटीएल और जेएस में एएसएम, माइक्रोकंट्रोलर सबसेट: तैयार yasep.org (Firefox required) वीएचडीएल
जिपसीपीयू गिसेलक्विस्ट टेक्नोलॉजी GPLv3 विस्बोन, बी4/पाइपलाइन 32-बिट प्रोटोटाइप न्यूनतम संसाधन उपयोग के लिए लक्षित है zipcpu.com वेरीलॉग
जेडपीयू ज़िलिन ए.एस Yes विशबोन स्टैक आधारित गेम, कॉन्फ़िगर करने योग्य 16/32 बिट डेटापथ, ईकोस समर्थन जाइलिल सीपीयू वीएचडीएल
आरआईएससी5 निकलॉस विर्थ Yes कस्टम संपादक और कंपाइलर सहित एक संपूर्ण ग्राफिकल ओबेरॉन सिस्टम चलाना। सॉफ्टवेयर को एक ही चिपबोर्ड पर विकसित और चलाया जा सकता है। www.projectoberon.com/ वेरीलॉग

यह भी देखे

संदर्भ

  1. ↑ http://www.dailycircuitry.com/2011/10/zet-soft-core-running-windows-30.html Archived 2018-10-13 at the Wayback Machine "Zet soft core running Windows 3.0" by Andrew Felch 2011
  2. ↑ "Embedded.com - FPGA Architectures from 'A' to 'Z' : Part 2". Archived from the original on 2007-10-08. Retrieved 2012-08-18. "FPGA Architectures from 'A' to 'Z'" by Clive Maxfield 2006
  3. ↑ MicroBlaze Soft Processor: Frequently Asked Questions Archived 2011-10-27 at the Wayback Machine
  4. ↑ István Vassányi. "Implementing processor arrays on FPGAs". 1998. [1]
  5. ↑ Zhoukun WANG and Omar HAMMAMI. "A 24 Processors System on Chip FPGA Design with Network on Chip". [2]
  6. ↑ John Kent. "Micro16 Array - A Simple CPU Array" [3]
  7. ↑ Kit Eaton. "1,000 Core CPU Achieved: Your Future Desktop Will Be a Supercomputer". 2011. [4]
  8. ↑ "Scientists Squeeze Over 1,000 Cores onto One Chip". 2011. [5] Archived 2012-03-05 at the Wayback Machine
  9. ↑ Joe DeLaere. ""Top 7 Reasons to Replace Your Microcontroller with a MAX 10 FPGA"" (PDF).
  10. ↑ John Swan; Tomek Krzyzak. (2008). ""Using FPGAs to avoid microprocessor obsolescence"". Archived from the original on 2016-01-30. {{cite web}}: |archive-date= / |archive-url= timestamp mismatch (help)
  11. ↑ Staff (2010-02-03). "FPGA processor IP needs to be supported". Electronics Weekly (in British English). Retrieved 2019-04-03.
  12. ↑ "Overview :: OpenFire Processor Core :: OpenCores".

बाहरी संबंध

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