वोल्टेज-नियंत्रित प्रतिरोधक: Difference between revisions

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'''वोल्टेज-नियंत्रित [[अवरोध|प्रतिरोधक]]''' ('''वीसीआर''') एक तीन-टर्मिनल सक्रिय उपकरण है जिसमें एक इनपुट पोर्ट और दो आउटपुट पोर्ट होते हैं। इनपुट-पोर्ट वोल्टेज आउटपुट पोर्ट के बीच प्रतिरोधक के मान को नियंत्रित करता है। वीसीआर अधिकांश क्षेत्र-प्रभाव ट्रांजिस्टर (एफईटी) के साथ बनाए जाते हैं। दो प्रकार के FET अधिकांश उपयोग किए जाते हैं: [[JFET]] और [[MOSFET]]। इसमें [[ तैरती हुई ज़मीन |फ्लोटिंग]] वोल्टेज-नियंत्रित प्रतिरोधक और ग्राउंडेड वोल्टेज-नियंत्रित प्रतिरोधक दोनों हैं। फ्लोटिंग वीसीआर को दो निष्क्रिय या सक्रिय घटकों के बीच रखा जा सकता है। ग्राउंडेड वीसीआर, अधिक सामान्य और कम जटिल डिज़ाइन, के लिए आवश्यक है कि वोल्टेज-नियंत्रित प्रतिरोधक का एक पोर्ट ग्राउंडेड हो।
'''वोल्टेज-नियंत्रित [[अवरोध|प्रतिरोधक]]''' ('''वीसीआर''') एक तीन-टर्मिनल सक्रिय उपकरण है जिसमें एक इनपुट पोर्ट और दो आउटपुट पोर्ट होते हैं। इनपुट-पोर्ट वोल्टेज आउटपुट पोर्ट के मध्य प्रतिरोधक के मान को नियंत्रित करता है। वीसीआर अधिकांश क्षेत्र-प्रभाव ट्रांजिस्टर (एफईटी) के साथ बनाए जाते हैं। दो प्रकार के एफईटी अधिकांश उपयोग किए जाते हैं: [[JFET|जेएफईटी]] और [[MOSFET|एमओएसएफईटी]]। इसमें [[ तैरती हुई ज़मीन |फ्लोटिंग]] वोल्टेज-नियंत्रित प्रतिरोधक और ग्राउंडेड वोल्टेज-नियंत्रित प्रतिरोधक दोनों हैं। फ्लोटिंग वीसीआर को दो निष्क्रिय या सक्रिय घटकों के मध्य रखा जा सकता है। ग्राउंडेड वीसीआर, अधिक सामान्य और कम जटिल डिज़ाइन, के लिए आवश्यक है कि वोल्टेज-नियंत्रित प्रतिरोधक का एक पोर्ट ग्राउंडेड हो।


==उपयोग==
==उपयोग==


वोल्टेज-नियंत्रित प्रतिरोधक सबसे अधिक उपयोग किए जाने वाले एनालॉग डिज़ाइन ब्लॉकों में से एक हैं: अनुकूली एनालॉग फ़िल्टर,<ref>Jafaripahah, M.; Al-Hashimi, B. M.; White, N. M. (2004, May). Design Consideration and Implementation of Analog Adaptive Filters for Sensor Response Correction. Proceedings of the ICEE2004.</ref> स्वचालित लाभ-नियंत्रण सर्किट, [[घड़ी जनरेटर]],<ref>Greason, Jeffrey K. (1983). Voltage-Controlled Resistance Element With Superior Dynamic Range. U.S. Patent US 5264785 A US 5264785 A.</ref> कम्प्रेसर,<ref>Sherwin, Jim (1975, August).</ref> [[ विद्युतमापी |विद्युतमापी]] ,<ref>Wee, Keng Hoongl; Sarpeshkar, Rahul (1986) JFET Ohmic Differential Amplifier, Keithley Instruments, U.S. Patent.</ref> ऊर्जा संचयक,<ref>Schneider, Leif E.; Thompson, Kevin D. (2014). Self-optimizing Energy Harvester Using Generator Having a Variable Source Voltage. Perpetua Power Source Technologies, Inc. U.S. Patent US 8664931 B2.</ref> विस्तारक,<ref>Sherwin, Jim (1975, August).</ref> कान की मशीन,<ref>Madaffari, Peter L. (2000). Amplifier with Reduced Input Capacitance. Tibbetts Industries, inc. U.S. Patent US 6023194 A.</ref> [[ प्रकाश मंदक |प्रकाश मंदक]] ्स,<ref>Ballenger, Matthew; Kendrick, George (2006). Lamp With Integral Voltage Converter Having Phase-Controlled Dimming Circuit Containing a Voltage Controlled Resistor. Osram Sylvania, Inc. U.S. Patent, US 20060082320 A1.</ref> मॉड्यूलेटर (मिक्सर),<ref>Stoffer, C. Daniel W (1971). Balanced Modulator With JFET's Voltage Controlled Resistors. Collins Radio Company, U.S. Patent US 3621473 A.</ref> कृत्रिम तंत्रिका प्रसार,<ref>Sung-Dae, Lee; Won-Hyo, Lee; Kang-Min, Chung (1998). A Highly Linear Voltage Controlled Resistor for Neural Chip. Systems, Man, and Cybernetics, 1998. 1998 IEEE International Conference.</ref> [[प्रोग्रामयोग्य-लाभ प्रवर्धक]],<ref>Molina, Johnnie F.; Stitt II, Mark; R., Burt, Rodney. (1994). Programmable Gain Amplifier Circuitry and Method for Biasing JFET Gain Switches Thereof Burr-Brown. U.S. Patent US 5327098 A.</ref> चरणबद्ध सरणियाँ,<ref>Electrosmash. MXR Phase 90 Analysis Phasers. www.electrosmash.com.</ref> चरण-बंद लूप,<ref>Tsai, Tsung-Hsien; Hung, Tsung-Hsien, Chen, Chien-Hung; Yuan, Min-Shueh  (2010) Phase Lock Loop (PLL) with Gain Control. Taiwan Semiconductor Manufacturing Company. U.S. Patent US7786771 B2.</ref> चरण-नियंत्रित डिमिंग सर्किट,<ref>Ballenger, Matthew B; Kendrick, George B. (2010). Lamp With Integral Voltage Converter Having Phase-Controlled Dimming Circuit Containing a Voltage Controlled Resistor. Osram Sylvania Inc., U.S. Patent US 7839095 B2.</ref> चरण-विलंब और -अग्रिम सर्किट,<ref>FETs as Voltage Controlled Resistors, (1997, March). Vishay.</ref> ट्यून करने योग्य फ़िल्टर,<ref>Kumngern, Montree; Torteanchai, Usa; Dejhan, Kobchai (2011, April). Voltage-Controlled Floating Resistor Using DDCC, RadioEngineering.</ref> वेरिएबल एटेन्यूएटर्स,<ref>McCarthy, Daniel P.; Connell, Lawrence E; Hollenbeck, Neal W. (2009) Linear Voltage Controlled Variable Attenuator With Linear db/v Gain Slope. FreeScale Semiconductor. U.S. Patent US 20090143036 A1.</ref> वोल्टेज-नियंत्रित ऑसिलेटर,<ref>Griffen, Jed D. (2002). Highly Accurate Voltage Controlled Oscillator With RC Circuit. Intel Corp. U.S. Patent US 6498539 B2.</ref> वोल्टेज-नियंत्रित मल्टीवाइब्रेटर,<ref>High-Voltage Electric Stimulation Apparatus for Plants (2012). 西藏农牧科学院蔬菜研究所 China Patent CN 202285631 U.</ref> साथ ही [[तरंगरूप जनरेटर]],<ref>Symons, Pete (2013). Digital Waveform Generation. Cambridge University Press. P. 33.</ref> सभी में वोल्टेज-नियंत्रित प्रतिरोधक शामिल हैं।
वोल्टेज-नियंत्रित प्रतिरोधक सबसे अधिक उपयोग किए जाने वाले एनालॉग डिज़ाइन ब्लॉकों में से एक हैं: अनुकूली एनालॉग फ़िल्टर,<ref>Jafaripahah, M.; Al-Hashimi, B. M.; White, N. M. (2004, May). Design Consideration and Implementation of Analog Adaptive Filters for Sensor Response Correction. Proceedings of the ICEE2004.</ref> स्वतः लब्धि नियंत्रण परिपथ, [[घड़ी जनरेटर]],<ref>Greason, Jeffrey K. (1983). Voltage-Controlled Resistance Element With Superior Dynamic Range. U.S. Patent US 5264785 A US 5264785 A.</ref> संपीड़क,<ref>Sherwin, Jim (1975, August).</ref> [[ विद्युतमापी |विद्युतमापी]] ,<ref>Wee, Keng Hoongl; Sarpeshkar, Rahul (1986) JFET Ohmic Differential Amplifier, Keithley Instruments, U.S. Patent.</ref> ऊर्जा संचयक,<ref>Schneider, Leif E.; Thompson, Kevin D. (2014). Self-optimizing Energy Harvester Using Generator Having a Variable Source Voltage. Perpetua Power Source Technologies, Inc. U.S. Patent US 8664931 B2.</ref> विस्तारक,<ref>Sherwin, Jim (1975, August).</ref> श्रवण यंत्र,<ref>Madaffari, Peter L. (2000). Amplifier with Reduced Input Capacitance. Tibbetts Industries, inc. U.S. Patent US 6023194 A.</ref> [[ प्रकाश मंदक |प्रकाश मंदक]],<ref>Ballenger, Matthew; Kendrick, George (2006). Lamp With Integral Voltage Converter Having Phase-Controlled Dimming Circuit Containing a Voltage Controlled Resistor. Osram Sylvania, Inc. U.S. Patent, US 20060082320 A1.</ref> मॉड्यूलेटर (मिक्सर),<ref>Stoffer, C. Daniel W (1971). Balanced Modulator With JFET's Voltage Controlled Resistors. Collins Radio Company, U.S. Patent US 3621473 A.</ref> कृत्रिम न्यूरल नेटवर्क,<ref>Sung-Dae, Lee; Won-Hyo, Lee; Kang-Min, Chung (1998). A Highly Linear Voltage Controlled Resistor for Neural Chip. Systems, Man, and Cybernetics, 1998. 1998 IEEE International Conference.</ref> [[प्रोग्रामयोग्य-लाभ प्रवर्धक|प्रोग्रामयोग्य-लाभ एम्पलीफायर]],<ref>Molina, Johnnie F.; Stitt II, Mark; R., Burt, Rodney. (1994). Programmable Gain Amplifier Circuitry and Method for Biasing JFET Gain Switches Thereof Burr-Brown. U.S. Patent US 5327098 A.</ref> चरणबद्ध सरणियाँ,<ref>Electrosmash. MXR Phase 90 Analysis Phasers. www.electrosmash.com.</ref> चरण-बंद लूप,<ref>Tsai, Tsung-Hsien; Hung, Tsung-Hsien, Chen, Chien-Hung; Yuan, Min-Shueh  (2010) Phase Lock Loop (PLL) with Gain Control. Taiwan Semiconductor Manufacturing Company. U.S. Patent US7786771 B2.</ref> चरण-नियंत्रित डिमिंग परिपथ,<ref>Ballenger, Matthew B; Kendrick, George B. (2010). Lamp With Integral Voltage Converter Having Phase-Controlled Dimming Circuit Containing a Voltage Controlled Resistor. Osram Sylvania Inc., U.S. Patent US 7839095 B2.</ref> चरण-विलंब और -अग्रिम परिपथ,<ref>FETs as Voltage Controlled Resistors, (1997, March). Vishay.</ref> ट्यून करने योग्य फ़िल्टर,<ref>Kumngern, Montree; Torteanchai, Usa; Dejhan, Kobchai (2011, April). Voltage-Controlled Floating Resistor Using DDCC, RadioEngineering.</ref> वेरिएबल एटेन्यूएटर्स,<ref>McCarthy, Daniel P.; Connell, Lawrence E; Hollenbeck, Neal W. (2009) Linear Voltage Controlled Variable Attenuator With Linear db/v Gain Slope. FreeScale Semiconductor. U.S. Patent US 20090143036 A1.</ref> वोल्टेज-नियंत्रित ऑसिलेटर,<ref>Griffen, Jed D. (2002). Highly Accurate Voltage Controlled Oscillator With RC Circuit. Intel Corp. U.S. Patent US 6498539 B2.</ref> वोल्टेज-नियंत्रित मल्टीवाइब्रेटर,<ref>High-Voltage Electric Stimulation Apparatus for Plants (2012). 西藏农牧科学院蔬菜研究所 China Patent CN 202285631 U.</ref> साथ ही [[तरंगरूप जनरेटर]],<ref>Symons, Pete (2013). Digital Waveform Generation. Cambridge University Press. P. 33.</ref> सभी में वोल्टेज-नियंत्रित प्रतिरोधक सम्मिलित हैं।


जेएफईटी वोल्टेज-नियंत्रित प्रतिरोधों के डिजाइन के लिए उपयोग किए जाने वाले अधिक सामान्य सक्रिय उपकरणों में से एक है। इतना कि, JFET उपकरणों को वोल्टेज-नियंत्रित प्रतिरोधकों के रूप में पैक और बेचा जाता है।<ref>[http://www.linearsystems.com/lsdata/datasheets/Copy_20116%20-%20VCR11N%20Rev%20A19%20dated%202019%2007%2024%20-%20Peter.pdf VCR11 Voltage Controlled Resistor]. Linear Integrated Systems.</ref> आमतौर पर, जेएफईटी को जब वीसीआर के रूप में पैक किया जाता है तो उनमें अधिकांश उच्च पिंच-ऑफ वोल्टेज होता है, जिसके परिणामस्वरूप अधिक गतिशील प्रतिरोध सीमा होती है। वीसीआर के लिए जेएफईटी को अधिकांश जोड़े में पैक किया जाता है, जो वीसीआर डिजाइन की अनुमति देता है जिसके लिए मिलान ट्रांजिस्टर पैरामीटर की आवश्यकता होती है।
जेएफईटी वोल्टेज-नियंत्रित प्रतिरोधों के डिजाइन के लिए उपयोग किए जाने वाले अधिक सामान्य सक्रिय उपकरणों में से एक है। इतना कि, जेएफईटी उपकरणों को वोल्टेज-नियंत्रित प्रतिरोधकों के रूप में पैक और बेचा जाता है।<ref>[http://www.linearsystems.com/lsdata/datasheets/Copy_20116%20-%20VCR11N%20Rev%20A19%20dated%202019%2007%2024%20-%20Peter.pdf VCR11 Voltage Controlled Resistor]. Linear Integrated Systems.</ref> सामान्यतः, जेएफईटी को जब वीसीआर के रूप में पैक किया जाता है तब उनमें अधिकांश उच्च संकुचन वोल्टता होता है, जिसके परिणामस्वरूप अधिक गतिशील प्रतिरोध सीमा होती है। वीसीआर के लिए जेएफईटी को अधिकांश जोड़े में पैक किया जाता है, जो वीसीआर डिजाइन की अनुमति देता है जिसके लिए सुमेलित ट्रांजिस्टर पैरामीटर की आवश्यकता होती है।
 
वीसीआर अनुप्रयोगों के लिए जिसमें सेंसर सिग्नल प्रवर्धन या ऑडियो शामिल है, असतत जेएफईटी का अधिकांश उपयोग किया जाता है। एक कारण यह है कि जेएफईटी और जेएफईटी के साथ निर्मित सर्किट टोपोलॉजी में कम शोर (विशेष रूप से कम 1/एफ [[झिलमिलाहट शोर]] और कम विस्फोट शोर) की सुविधा होती है। इन अनुप्रयोगों में, कम शोर वाले जेएफईटी अधिक विश्वसनीय और सटीक माप और ध्वनि शुद्धता के ऊंचे स्तर की अनुमति देते हैं।<ref>Maxwell, John (1976), AN-6602Low Noise JFET – The Noise Problem Solver. Fairchild Semiconductor.</ref>
अलग-अलग जेएफईटी का उपयोग करने का एक अन्य कारण यह है कि जेएफईटी ऊबड़-खाबड़ वातावरण के लिए बेहतर अनुकूल हैं। जेएफईटी एमओएसएफईटी सर्किट की तुलना में विद्युत, विद्युत चुम्बकीय हस्तक्षेप (ईएमआई) और अन्य उच्च विकिरण झटके का बेहतर सामना कर सकते हैं।<ref>Levinzon, Felix (2014). Piezoelectric Accelerometers with Integral Electronics. Springer, P. 75.</ref> JFETs एक इनपुट सर्ज-प्रोटेक्शन डिवाइस के रूप में भी काम कर सकते हैं।<ref>Yang, Eric; Milic, Ognjen; Zhou, Jinghai (2011, Nov), Input Surge Protection Device Using JFET, Monolithic Power Systems, Inc. U.S. Patent US 8068321 B2.</ref> MOSFETs की तुलना में JFETs इलेक्ट्रोस्टैटिक डिस्चार्ज के प्रति भी कम संवेदनशील होते हैं।<ref>Roundree, Robert Newton (2014, Nov). JFET ESD Protection Circuit for low Voltage Applications. U.S. Patent US 20140339608 A1.</ref>


वीसीआर अनुप्रयोगों के लिए जिसमें सेंसर संकेत प्रवर्धन या ऑडियो सम्मिलित है, असतत जेएफईटी का अधिकांश उपयोग किया जाता है। एक कारण यह है कि जेएफईटी और जेएफईटी के साथ निर्मित परिपथ टोपोलॉजी में कम ध्वनि (विशेष रूप से कम ''1/f'' [[झिलमिलाहट शोर|फ्लिकर ध्वनि]] और कम विस्फोट ध्वनि) की सुविधा होती है। इन अनुप्रयोगों में, कम ध्वनि वाले जेएफईटी अधिक विश्वसनीय और त्रुटिहीन माप और ध्वनि शुद्धता के ऊंचे स्तर की अनुमति देते हैं।<ref>Maxwell, John (1976), AN-6602Low Noise JFET – The Noise Problem Solver. Fairchild Semiconductor.</ref>


भिन्न-भिन्न जेएफईटी का उपयोग करने का एक अन्य कारण यह है कि जेएफईटी असमतल वातावरण के लिए उत्तम अनुकूल हैं। जेएफईटी एमओएसएफईटी परिपथ की तुलना में विद्युत, विद्युत चुम्बकीय व्यतिकरण (ईएमआई) और अन्य उच्च विकिरण झटके का उत्तम सामना कर सकते हैं।<ref>Levinzon, Felix (2014). Piezoelectric Accelerometers with Integral Electronics. Springer, P. 75.</ref> जेएफईटीएस एक इनपुट सर्ज-प्रोटेक्शन उपकरण के रूप में भी काम कर सकते हैं।<ref>Yang, Eric; Milic, Ognjen; Zhou, Jinghai (2011, Nov), Input Surge Protection Device Using JFET, Monolithic Power Systems, Inc. U.S. Patent US 8068321 B2.</ref> मॉसफेटएस की तुलना में जेएफईटीएस इलेक्ट्रोस्टैटिक डिस्चार्ज के प्रति भी कम संवेदनशील होते हैं।<ref>Roundree, Robert Newton (2014, Nov). JFET ESD Protection Circuit for low Voltage Applications. U.S. Patent US 20140339608 A1.</ref>
==वोल्टेज-नियंत्रित प्रतिरोधक डिज़ाइन==
==वोल्टेज-नियंत्रित प्रतिरोधक डिज़ाइन==


जेएफईटी वीसीआर के लिए दो अधिक सामान्य और सबसे अधिक लागत प्रभावी डिजाइन गैर-रेखीयकृत और रैखिककृत वीसीआर डिजाइन हैं। गैर-रैखिकीकृत डिज़ाइन के लिए केवल एक JFET की आवश्यकता होती है, रैखिककृत डिज़ाइन भी एक JFET का उपयोग करता है, लेकिन इसमें दो रैखिककरण प्रतिरोधक होते हैं। रैखिककृत डिज़ाइन का उपयोग वीसीआर अनुप्रयोगों के लिए किया जाता है जिनके लिए उच्च इनपुट-सिग्नल वोल्टेज स्तर की आवश्यकता होती है। गैर-रेखीय डिज़ाइन का उपयोग कम इनपुट सिग्नल स्तर और लागत-संचालित डीसी अनुप्रयोगों में किया जाता है।
जेएफईटी वीसीआर के लिए दो अधिक सामान्य और सबसे अधिक निवेश प्रभावी डिजाइन गैर-रेखीयकृत और रैखिककृत वीसीआर डिजाइन हैं। गैर-रैखिकीकृत डिज़ाइन के लिए केवल एक जेएफईटी की आवश्यकता होती है, रैखिककृत डिज़ाइन भी एक जेएफईटी का उपयोग करता है, किन्तु इसमें दो रैखिककरण प्रतिरोधक होते हैं। रैखिककृत डिज़ाइन का उपयोग वीसीआर अनुप्रयोगों के लिए किया जाता है जिनके लिए उच्च इनपुट-संकेत वोल्टेज स्तर की आवश्यकता होती है। गैर-रेखीय डिज़ाइन का उपयोग कम इनपुट संकेत स्तर और निवेश-संचालित DC अनुप्रयोगों में किया जाता है।


==गैर-रैखिकीकृत वीसीआर डिज़ाइन==
==गैर-रैखिकीकृत वीसीआर डिज़ाइन==


[[File:Programmable voltage divider based on a JFET VCR.png|thumb|right|जेएफईटी वीसीआर पर आधारित प्रोग्रामेबल वोल्टेज डिवाइडर]]चित्र पर सर्किट में, एक गैर-रैखिकीकृत वीसीआर डिज़ाइन, वोल्टेज-नियंत्रित प्रतिरोधक, एलएसके489सी जेएफईटी, का उपयोग प्रोग्रामयोग्य वोल्टेज विभक्त के रूप में किया जाता है। वीजीएस आपूर्ति जेएफईटी के आउटपुट प्रतिरोध का स्तर निर्धारित करती है। जेएफईटी (आर) का ड्रेन-टू-सोर्स प्रतिरोध<sub>DS</sub>) और नाली प्रतिरोधक (आर<sub>1</sub>) वोल्टेज-डिवाइडर नेटवर्क बनाएं। आउटपुट वोल्टेज समीकरण से निर्धारित किया जा सकता है
[[File:Programmable voltage divider based on a JFET VCR.png|thumb|right|जेएफईटी वीसीआर पर आधारित प्रोग्रामेबल वोल्टेज डिवाइडर]]चित्र पर परिपथ में, एक गैर-रैखिकीकृत वीसीआर डिज़ाइन, वोल्टेज-नियंत्रित प्रतिरोधक, LSK489C जेएफईटी, का उपयोग प्रोग्रामयोग्य वोल्टेज डिवाइडर के रूप में किया जाता है। V<sub>GS</sub> आपूर्ति जेएफईटी के आउटपुट प्रतिरोध का स्तर निर्धारित करती है। जेएफईटी (''R''<sub>DS</sub>) का ड्रेन-टू-सोर्स प्रतिरोध और ड्रेन रेसिस्टर (R<sub>1</sub>) वोल्टेज-डिवाइडर नेटवर्क बनाते हैं। आउटपुट वोल्टेज समीकरण से निर्धारित किया जा सकता है
 
: वी<sub>out</sub> = वी<sub>DC</sub> · आर<sub>DS</sub> / (आर<sub>1</sub> + आर<sub>DS</sub>).
 
गैर-रैखिकीकृत वीसीआर डिज़ाइन का एक एलटीस्पाइस सिमुलेशन सत्यापित करता है कि जेएफईटी प्रतिरोध गेट-टू-सोर्स वोल्टेज (वी) में बदलाव के साथ बदलता है<sub>GS</sub>). सिमुलेशन में (नीचे), एक निरंतर इनपुट वोल्टेज लागू किया जाता है (वीडीसी आपूर्ति 4 वोल्ट पर सेट होती है), और गेट-टू-सोर्स वोल्टेज को चरणों में कम किया जाता है, जिससे जेएफईटी ड्रेन-टू-सोर्स प्रतिरोध बढ़ जाता है। जेएफईटी के ड्रेन से सोर्स टर्मिनलों के बीच प्रतिरोध बढ़ जाता है क्योंकि गेट-टू-सोर्स वोल्टेज अधिक नकारात्मक हो जाता है और गेट-टू-सोर्स वोल्टेज 0 वोल्ट तक पहुंचने पर घट जाता है। नीचे दिया गया अनुकरण इसे स्पष्ट करता है। आउटपुट वोल्टेज लगभग 2.5 वोल्ट है और गेट-टू-सोर्स वोल्टेज -1 वोल्ट है। इसके विपरीत, गेट-टू-सोर्स वोल्टेज 0 वोल्ट होने पर आउटपुट वोल्टेज लगभग 1.6 वोल्ट तक गिर जाता है।
 
4-वोल्ट इनपुट सिग्नल और आर के साथ<sub>1</sub> 300 ओम की, जेएफईटी वीसीआर के लिए प्रतिरोध की सीमा की गणना वी के रूप में सिमुलेशन परिणामों से की जा सकती है<sub>GS</sub> समीकरण का उपयोग करके -1 वोल्ट और 0 वोल्ट के बीच भिन्न होता है


: आर<sub>DS</sub> = वी<sub>0</sub> · आर<sub>1</sub> / (में<sub>DS</sub> - वी<sub>0</sub>).
: V<sub>out</sub> = V<sub>DC</sub> · R<sub>DS</sub> / (R<sub>1</sub> + R<sub>DS</sub>).


उपरोक्त समीकरण का उपयोग करते हुए, V पर<sub>GS</sub> = −1 वी, वीसीआर प्रतिरोध लगभग 500 ओम है, और वी पर<sub>GD</sub> = 0 वी, वीसीआर प्रतिरोध लगभग 200 ओम है।
गैर-रैखिकीकृत वीसीआर डिज़ाइन का एक एलटीस्पाइस सिमुलेशन सत्यापित करता है कि जेएफईटी प्रतिरोध गेट-टू-सोर्स वोल्टेज (''V''<sub>GS</sub>) में बदलाव के साथ बदलता है। सिमुलेशन (नीचे) में, एक निरंतर इनपुट वोल्टेज प्रयुक्त (वीडीसी आपूर्ति 4 वोल्ट पर सेट होती है) किया जाता है, और गेट-टू-सोर्स वोल्टेज चरणों में कम हो जाता है, जिससे जेएफईटी ड्रेन-टू-सोर्स प्रतिरोध बढ़ जाता है। जेएफईटी के ड्रेन से सोर्स टर्मिनलों के मध्य प्रतिरोध बढ़ जाता है क्योंकि गेट-टू-सोर्स वोल्टेज अधिक ऋणात्मक हो जाता है और गेट-टू-सोर्स वोल्टेज 0 वोल्ट तक पहुंचने पर घट जाता है। नीचे दिया गया अनुकरण इसे स्पष्ट करता है। आउटपुट वोल्टेज लगभग 2.5 वोल्ट है और गेट-टू-सोर्स वोल्टेज -1 वोल्ट हैहै। इसके विपरीत, गेट-टू-सोर्स वोल्टेज 0 वोल्ट होने पर आउटपुट वोल्टेज लगभग 1.6 वोल्ट तक गिर जाता है।


<!--
4-वोल्ट इनपुट सिग्नल और 300 ओम के R<sub>1</sub> के साथ, जेएफईटी वीसीआर के लिए प्रतिरोध की सीमा की गणना सिमुलेशन परिणामों से की जा सकती है क्योंकि ''V''<sub>GS</sub> समीकरण का उपयोग करके -1 वोल्ट और 0 वोल्ट के मध्य भिन्न होता है।
'''Figure 2: Stepped DC simulation of a VCR-based programmable voltage divider. Changing the level of the gate-to-source voltage, vc, reduces the voltage divider's output voltage (vout).'''
Deleted image removed: [[File:Stepped DC simulation of a VCR-based programmable voltage divider.png|thumb|right|Fig 2: Stepped DC simulation of VCR based programmable voltage divider]]
-->
एक समान वीसीआर सर्किट (लोड प्रतिरोधी को 3000 ओम में बदल दिया गया है) के इनपुट पर रैंप वोल्टेज लागू करने से किसी को जेएफईटी के प्रतिरोध का सटीक मूल्य निर्धारित करने की अनुमति मिलती है क्योंकि इनपुट वोल्टेज भिन्न होता है।


<!--
: ''R''<sub>DS</sub> = ''V''<sub>0</sub> · ''R''<sub>1</sub> / (''V''<sub>DS</sub> − ''V''<sub>0</sub>).
'''Figure 3: Applying a ramp voltage (Vsweep PWL) to a non-linearized VCR to determine the VCR resistance characteristic'''
Deleted image removed: [[File:Applying a ramp voltage (Vsweep PWL) to a non-linearized VCR.png|thumb|right|Fig 3: Applying a ramp voltage (Vsweep PWL) to a non-linearized VCR to determine the VCR resistance characteristic.]]
-->
नीचे दिए गए रैंप सिमुलेशन से पता चलता है कि जेएफईटी का ड्रेन-टू-सोर्स प्रतिरोध इनपुट स्वीप वोल्टेज, वी तक काफी स्थिर (लगभग 280 ओम) है।<sub>sweep</sub> (में<sub>signal</sub>), लगभग 2 वी तक पहुंच जाता है। इस बिंदु पर ड्रेन-टू-सोर्स प्रतिरोध धीरे-धीरे बढ़ना शुरू हो जाता है जब तक कि इनपुट वोल्टेज 8 वी तक नहीं पहुंच जाता। लगभग 8 वी पर, इस पूर्वाग्रह स्थिति के लिए (वी)<sub>GS</sub> = 0 V और R = 3 kΩ), JFET ड्रेन करंट (I<sub>D</sub>(J1)) संतृप्त हो जाता है, और प्रतिरोध अब स्थिर नहीं रहता है और इनपुट वोल्टेज में वृद्धि के साथ बदलता है। रैंप सिमुलेशन यह भी इंगित करता है कि 2 वी से नीचे भी, वीसीआर का प्रतिरोध इनपुट वोल्टेज स्तर से पूरी तरह से स्वतंत्र नहीं है। अर्थात्, वीसीआर प्रतिरोध एक पूर्णतः रैखिक प्रतिरोधक का प्रतिनिधित्व नहीं करता है।


क्योंकि प्रतिरोध 2 वी से ऊपर स्थिर नहीं है, इस गैर-रैखिकीकृत वीसीआर डिज़ाइन का उपयोग अधिकांश तब किया जाता है जब इनपुट वोल्टेज सिग्नल 1 वी से नीचे होता है, जैसे सेंसर अनुप्रयोगों में या ऐसे अनुप्रयोगों में जहां उच्च इनपुट वोल्टेज स्तरों पर विरूपण चिंता का विषय नहीं है। या अन्य मामलों में, जब एक स्थिर प्रतिरोधक मान की आवश्यकता नहीं होती है (उदाहरण के लिए, एलईडी डिमर अनुप्रयोगों और संगीत पेडल-प्रभाव सर्किट में)।
उपरोक्त समीकरण का उपयोग करते हुए, V<sub>GS</sub> = −1 V पर, वीसीआर प्रतिरोध लगभग 500 ओम है, और V<sub>GD</sub> = 0 V, वीसीआर प्रतिरोध लगभग 200 ओम है।


<!--
एक समान वीसीआर परिपथ (लोड प्रतिरोधी को 3000 ओम में बदल दिया गया है) के इनपुट पर रैंप वोल्टेज प्रयुक्त करने से किसी को जेएफईटी के प्रतिरोध का त्रुटिहीन मान निर्धारित करने की अनुमति मिलती है क्योंकि इनपुट वोल्टेज भिन्न होता है।
'''Figure 4: The VCR resistance is approximately 280 ohms when the input signal (vsignal) varies between 0 and 2 Volts.'''
Deleted image removed: [[File:The VCR resistance is approximately 280 ohms.png|thumb|right|Fig 4: The VCR resistance is approximately 280 ohms when the input signal (vsignal) varies between 0 and 2 Volts. ]]
-->


नीचे दिए गए रैम्प सिमुलेशन से पता चलता है कि जेएफईटी का ड्रेन-टू-सोर्स प्रतिरोध इनपुट स्वीप वोल्टेज, ''V''<sub>sweep</sub> (''V''<sub>signal</sub>) तक लगभग 2 V तक पहुंचने तक अत्यंत स्थिर (लगभग 280 ओम) है। इस बिंदु पर ड्रेन-टू -स्रोत प्रतिरोध तब तक धीरे-धीरे बढ़ना प्रारंभ हो जाता है जब तक कि इनपुट वोल्टेज 8 V तक नहीं पहुंच जाता। लगभग 8 V पर, इस पूर्वाग्रह स्थिति (V<sub>GS</sub> = 0 V और R = 3 kΩ) के लिए, जेएफईटी ड्रेन करंट (I<sub>D</sub>(J1)) संतृप्त होता है, और प्रतिरोध अब स्थिर नहीं है और इनपुट वोल्टेज में वृद्धि के साथ बदलता है। रैंप सिमुलेशन यह भी निरुपित करता है कि 2 V से नीचे भी, वीसीआर का प्रतिरोध इनपुट वोल्टेज स्तर से पूरी तरह से स्वतंत्र नहीं है। अर्थात्, वीसीआर प्रतिरोध एक पूर्णतः रैखिक प्रतिरोधक का प्रतिनिधित्व नहीं करता है।


क्योंकि प्रतिरोध 2 V से ऊपर स्थिर नहीं है, इस गैर-रैखिकीकृत वीसीआर डिज़ाइन का उपयोग अधिकांश तब किया जाता है जब इनपुट वोल्टेज संकेत 1 V से नीचे होता है, जैसे सेंसर अनुप्रयोगों में या ऐसे अनुप्रयोगों में जहां उच्च इनपुट वोल्टेज स्तरों पर विरूपण चिंता का विषय नहीं है। या अन्य स्थितियों में, जब एक स्थिर प्रतिरोधक मान की आवश्यकता नहीं (उदाहरण के लिए, एलईडी डिमर अनुप्रयोगों और संगीत पेडल-प्रभाव परिपथ में) होती है।
==रैखिकीकृत वीसीआर डिज़ाइन==
==रैखिकीकृत वीसीआर डिज़ाइन==


इनपुट वोल्टेज की गतिशील रेंज को बढ़ाने के लिए, इनपुट सिग्नल रेंज पर निरंतर प्रतिरोध बनाए रखने के लिए, और सिग्नल-टू-शोर अनुपात और कुल हार्मोनिक विरूपण विनिर्देशों में सुधार करने के लिए, रैखिककरण प्रतिरोधों का उपयोग किया जाता है।
इनपुट वोल्टेज की गतिशील सीमा को बढ़ाने के लिए, इनपुट संकेत सीमा पर निरंतर प्रतिरोध बनाए रखने के लिए, और संकेत-से-ध्वनि अनुपात और कुल हार्मोनिक विरूपण विनिर्देशों में सुधार करने के लिए, रैखिककरण प्रतिरोधों का उपयोग किया जाता है।


वोल्टेज-नियंत्रित प्रतिरोधों की एक मूलभूत सीमा यह है कि इनपुट सिग्नल को रैखिककरण वोल्टेज (लगभग वह बिंदु जब JFET संतृप्ति में प्रवेश करता है) से नीचे रखा जाना चाहिए। यदि रैखिककरण वोल्टेज पार हो गया है, तो वोल्टेज नियंत्रण प्रतिरोधक मान इनपुट वोल्टेज सिग्नल के स्तर और गेट-टू-सोर्स वोल्टेज दोनों के साथ बदल जाएगा।<ref>FETs as Voltage Controlled Resistors, (1997, March). Vishay.</ref>
वोल्टेज-नियंत्रित प्रतिरोधों की एक मूलभूत सीमा यह है कि इनपुट संकेत को रैखिककरण वोल्टेज (लगभग वह बिंदु जब जेएफईटी संतृप्ति में प्रवेश करता है) से नीचे रखा जाना चाहिए। यदि रैखिककरण वोल्टेज पार हो गया है, तब वोल्टेज नियंत्रण प्रतिरोधक मान इनपुट वोल्टेज संकेत के स्तर और गेट-टू-सोर्स वोल्टेज दोनों के साथ बदल जाएगा।<ref>FETs as Voltage Controlled Resistors, (1997, March). Vishay.</ref>


<!--A linearized VCR design is shown in the figure below. -->बड़े इनपुट सिग्नलों को संभालने की इस डिज़ाइन की क्षमता के मूल्यांकन के लिए, वीसीआर इनपुट पर एक रैंप लगाया जाता है। रैंप सिमुलेशन के परिणामों से, वीसीआर एक वास्तविक प्रतिरोधक का कितनी बारीकी से अनुकरण करता है और इनपुट वोल्टेज की किस सीमा पर वीसीआर एक प्रतिरोधक के रूप में व्यवहार करता है, यह निर्धारित किया जाता है।
बड़े इनपुट सिग्नलों को संभालने की इस डिज़ाइन की क्षमता के मूल्यांकन के लिए, वीसीआर इनपुट पर एक रैंप लगाया जाता है। रैंप सिमुलेशन के परिणामों से, वीसीआर एक वास्तविक प्रतिरोधक का कितनी निकटतम से अनुकरण करता है और इनपुट वोल्टेज की किस सीमा पर वीसीआर एक प्रतिरोधक के रूप में व्यवहार करता है, यह निर्धारित किया जाता है।


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नीचे रैखिककृत वीसीआर रैंप सिमुलेशन निरुपित करता है कि वीसीआर प्रतिरोध लगभग −6 V से 6 V (the ''V''(''V''<sub>out</sub>)/''I''(''R''<sub>1</sub>) वक्र) तक इनपुट सिग्नल सीमा के लिए लगभग 260 ओम पर स्थिर है। स्वीप यह भी निरुपित करता है कि वीसीआर प्रतिरोध नाटकीय रूप से बढ़ना प्रारंभ हो जाता है, जैसा कि जेएफईटी के संतृप्ति क्षेत्र में प्रवेश करने के पश्चात् गैर-रेखीय डिजाइन में होता है।
'''Figure 5: Applying a ramp voltage (Vin PWL) to a linearized JFET VCR to determine the resistance characteristic'''
Deleted image removed: [[File:Applying a ramp voltage (Vin PWL) to a linearized JFET VCR.png|thumb|right|Fig 5: Applying a ramp voltage (Vin PWL) to a linearized JFET VCR to determine the resistance characteristic]]
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नीचे दिए गए रेखीयकृत वीसीआर रैंप सिमुलेशन से पता चलता है कि वीसीआर प्रतिरोध लगभग -6 वी से 6 वी (वी (वी) तक इनपुट सिग्नल रेंज के लिए लगभग 260 ओम पर स्थिर है<sub>out</sub>)/आई(आर<sub>1</sub>) वक्र). स्वीप यह भी इंगित करता है कि वीसीआर प्रतिरोध नाटकीय रूप से बढ़ना शुरू हो जाता है, जैसा कि गैर-रेखीय डिजाइन में होता है, एक बार जब जेएफईटी अपने संतृप्ति क्षेत्र में प्रवेश करता है।


रैखिककृत वीसीआर के व्यापक स्थिर प्रतिरोध क्षेत्र के कारण, गैर-रैखिकीकृत डिज़ाइनों की तुलना में बहुत बड़े इनपुट संकेतों को विरूपण के बिना वीसीआर पर लागू किया जा सकता है। हालाँकि, यह विचार करना भी महत्वपूर्ण है कि ड्रेन रेसिस्टर मान ड्रेन-टू-सोर्स वोल्टेज की सीमा को थोड़ा प्रभावित करेगा जो कि वीसीआर प्रतिरोध स्थिर है।
रैखिककृत वीसीआर के व्यापक स्थिर प्रतिरोध क्षेत्र के कारण, गैर-रैखिकीकृत डिज़ाइनों की तुलना में बहुत बड़े इनपुट संकेतों को विरूपण के बिना वीसीआर पर प्रयुक्त किया जा सकता है। चूँकि, यह विचार करना भी महत्वपूर्ण है कि ड्रेन रेसिस्टर मान ड्रेन-टू-सोर्स वोल्टेज की सीमा को थोड़ा प्रभावित करेगा जो कि वीसीआर प्रतिरोध स्थिर है।


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बढ़ी हुई रैखिककरण सीमा के कारण, रैखिक परिपथ एसी संकेतों को संभालने में सक्षम है जो विरूपण के दृश्य स्तर सेट होने से पहले 8 V पीक-टू-पीक के क्रम में हैं। नीचे दिया गया सिमुलेशन, जो 3000-ओम नाली प्रतिरोधी का उपयोग करता है, दर्शाता है कि वीसीआर का उपयोग अत्यंत उच्च इनपुट वोल्टेज इनपुट संकेत पर सफलतापूर्वक किया जा सकता है। इस डिज़ाइन के लिए, 8 V पीक-टू-पीक इनपुट वोल्टेज संकेत को 2.2 वोल्ट पीक से 0.5 वोल्ट पीक तक क्षीण किया जा सकता है, जब नियंत्रण वोल्टेज -2.5 वोल्ट से 0.5 वोल्ट तक भिन्न होता है।
'''Figure 6: The VCR resistance is approximately 250 ohms when the input signal (vsignal) varies between -6 and 6 Volts.'''
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बढ़ी हुई रैखिककरण सीमा के कारण, रैखिक सर्किट एसी संकेतों को संभालने में सक्षम है जो विरूपण के दृश्य स्तर सेट होने से पहले 8 वी पीक-टू-पीक के क्रम में हैं। नीचे दिया गया सिमुलेशन, जो 3000-ओम नाली प्रतिरोधी का उपयोग करता है, दर्शाता है कि वीसीआर का उपयोग काफी उच्च इनपुट वोल्टेज इनपुट सिग्नल पर सफलतापूर्वक किया जा सकता है। इस डिज़ाइन के लिए, 8 V पीक-टू-पीक इनपुट वोल्टेज सिग्नल को 2.2 वोल्ट पीक से 0.5 वोल्ट पीक तक क्षीण किया जा सकता है, जब नियंत्रण वोल्टेज -2.5 वोल्ट से 0.5 वोल्ट तक भिन्न होता है।


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गैर-रैखिकीकृत डिज़ाइन के विपरीत, रैखिककृत वीसीआर डिज़ाइन के बारे में ध्यान देने योग्य बात यह है कि आउटपुट संकेत में कोई महत्वपूर्ण ऑफसेट नहीं होता है। नियंत्रण वोल्टेज बदलने पर यह 0 V पर केन्द्रित रहता है। गैर-रेखीय डिज़ाइन के सिमुलेशन आउटपुट पर एक महत्वपूर्ण ऑफसेट वोल्टेज का संकेत देते हैं। रेखीयकृत वीसीआर डिज़ाइन की एक अन्य महत्वपूर्ण विशेषता यह है कि इसमें गैर-रैखिकीकृत डिज़ाइन की तुलना में अधिक आउटपुट करंट होता है। रैखिककरण प्रतिरोधों का प्रभाव वीसीआर के अंतराचालकता लाभ को प्रभावी रूप से बढ़ाना है।
'''Figure 7: Linearized VCR output with a 8 Vpp input signal applied at different Vgs (vcontrol) values'''
Deleted image removed: [[File:Linearized VCR output with a 8 Vpp input signal.png|thumb|right|Fig 7: Linearized VCR output with a 8 Vpp input signal applied at different Vgs (vcontrol) values]] -->
गैर-रैखिकीकृत डिज़ाइन के विपरीत, रैखिककृत वीसीआर डिज़ाइन के बारे में ध्यान देने योग्य बात यह है कि आउटपुट सिग्नल में कोई महत्वपूर्ण ऑफसेट नहीं होता है। नियंत्रण वोल्टेज बदलने पर यह 0 V पर केन्द्रित रहता है। गैर-रेखीय डिज़ाइन के सिमुलेशन आउटपुट पर एक महत्वपूर्ण ऑफसेट वोल्टेज का संकेत देते हैं। रेखीयकृत वीसीआर डिज़ाइन की एक अन्य महत्वपूर्ण विशेषता यह है कि इसमें गैर-रैखिकीकृत डिज़ाइन की तुलना में अधिक आउटपुट करंट होता है। रैखिककरण प्रतिरोधों का प्रभाव वीसीआर के ट्रांसकंडक्टेंस लाभ को प्रभावी ढंग से बढ़ाना है।


==प्रतिरोध सीमा चयन==
==प्रतिरोध सीमा चयन==


विभिन्न वीसीआर प्रतिरोध रेंज प्राप्त करने के लिए विभिन्न जेएफईटी का उपयोग किया जा सकता है। आमतौर पर, JFET के लिए IDSS मान जितना अधिक होगा, प्राप्त प्रतिरोध मान उतना ही कम होगा। इसी प्रकार, आईडीएसएस के कम मूल्यों वाले जेएफईटी में प्रतिरोध के उच्च मूल्य होते हैं।<ref>FETs as Voltage Controlled Resistors, (1997, March). Vishay.</ref> JFETs के एक बैंक के साथ, विभिन्न IDSS मानों के साथ (और इसलिए, R<sub>DS</sub> मान), प्रोग्राम करने योग्य स्वचालित लाभ-नियंत्रण सर्किट के बैंकों का निर्माण किया जा सकता है जो प्रतिरोध रेंज की एक विस्तृत श्रृंखला प्रदान करते हैं। उदाहरण के लिए, LSK489A और LSK489C, ग्रेडेड IDSS JFETS, 3:1 प्रतिरोध भिन्नता दिखाते हैं।
विभिन्न वीसीआर प्रतिरोध सीमा प्राप्त करने के लिए विभिन्न जेएफईटी का उपयोग किया जा सकता है। सामान्यतः, जेएफईटी के लिए आईडीएसएस मान जितना अधिक होगा, प्राप्त प्रतिरोध मान उतना ही कम होगा। इसी प्रकार, आईडीएसएस के कम मानों वाले जेएफईटी में प्रतिरोध के उच्च मान होते हैं।<ref>FETs as Voltage Controlled Resistors, (1997, March). Vishay.</ref> जेएफईटीएस के एक बैंक के साथ, विभिन्न आईडीएसएस मानों के साथ (और इसलिए, R<sub>DS</sub> मान), प्रोग्राम करने योग्य स्वचालित लाभ-नियंत्रण परिपथ के बैंकों का निर्माण किया जा सकता है जो प्रतिरोध सीमा की एक विस्तृत श्रृंखला प्रदान करते हैं। उदाहरण के लिए, LSK489A और LSK489C, ग्रेडेड IDSS जेएफईटीएस, 3:1 प्रतिरोध भिन्नता दिखाते हैं।


==विरूपण संबंधी विचार==
==विरूपण संबंधी विचार==


वोल्टेज-नियंत्रित प्रतिरोधों के साथ विरूपण एक प्रमुख चिंता का विषय है। जब एक एसी या गैर-डीसी इनपुट सिग्नल लागू किया जाता है जिसके परिणामस्वरूप वीसीआर प्रतिरोधक रैखिक ट्रायोड क्षेत्र से बाहर चला जाता है (या पूरी तरह से रैखिक ट्रायोड क्षेत्र से कम में संचालित होता है), तो इनपुट सिग्नल परिणामों का असमान प्रवर्धन (प्रत्यक्ष परिणाम के रूप में) प्रतिरोध में एक गैर-रैखिक वृद्धि)। इसके परिणामस्वरूप आउटपुट सिग्नल में विकृति आती है।
वोल्टेज-नियंत्रित प्रतिरोधों के साथ विरूपण एक प्रमुख चिंता का विषय है। जब एक एसी या गैर-डीसी इनपुट संकेत प्रयुक्त किया जाता है जिसके परिणामस्वरूप वीसीआर प्रतिरोधक रैखिक ट्रायोड क्षेत्र से बाहर चला जाता है (या पूरी तरह से रैखिक ट्रायोड क्षेत्र से कम में संचालित होता है), तब इनपुट संकेत परिणामों का असमान प्रवर्धन (प्रत्यक्ष परिणाम के रूप में) प्रतिरोध में एक गैर-रैखिक वृद्धि) होता हैं। इसके परिणामस्वरूप आउटपुट संकेत में विकृति आती है।


इस समस्या को दूर करने के लिए, गैर-रैखिकीकृत वीसीआर को काफी कम सिग्नल स्तरों पर संचालित किया जाता है। दूसरी ओर, रैखिककृत वीसीआर डिज़ाइन में बहुत अधिक इनपुट वोल्टेज सिग्नल स्तरों पर काफी कम विरूपण होगा और कुल हार्मोनिक विरूपण विनिर्देश में सुधार की अनुमति होगी।
इस समस्या को दूर करने के लिए, गैर-रैखिकीकृत वीसीआर को अत्यंत कम संकेत स्तरों पर संचालित किया जाता है। दूसरी ओर, रैखिककृत वीसीआर डिज़ाइन में बहुत अधिक इनपुट वोल्टेज संकेत स्तरों पर अत्यंत कम विरूपण होगा और कुल हार्मोनिक विरूपण विनिर्देश में सुधार की अनुमति होगी।


उदाहरण के लिए, जब 5 वी पीक-टू-पीक का इनपुट सिग्नल एक गैर-रैखिक वीसीआर डिज़ाइन पर लागू किया जाता है, तो नीचे दिया गया सिमुलेशन महत्वपूर्ण मात्रा में दृश्य विरूपण दिखाता है।
उदाहरण के लिए, जब 5 V पीक-टू-पीक का इनपुट संकेत एक गैर-रैखिक वीसीआर डिज़ाइन पर प्रयुक्त किया जाता है, तब नीचे दिया गया सिमुलेशन महत्वपूर्ण मात्रा में दृश्य विरूपण दिखाता है।


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दूसरी ओर, जब 8 V पीक-टू-पीक इनपुट संकेत प्रयुक्त किया जाता है तब एक रेखीयकृत वीसीआर डिज़ाइन का सिमुलेशन बहुत कम विरूपण (चित्रा 7) दिखाता है।
'''Figure 8: The AC output waveform from a non-linearized VCR results in visible distortion when the input voltage exceeds the maximum linearization voltage. The level of distortion reduces at gate-to-source levels near 0 Volts. Additionally, the DC offset is significant.''' 
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दूसरी ओर, जब 8 वी पीक-टू-पीक इनपुट सिग्नल लागू किया जाता है तो एक रेखीयकृत वीसीआर डिज़ाइन का सिमुलेशन बहुत कम विरूपण दिखाता है (चित्रा 7)।


==अन्य वीसीआर टोपोलॉजी और डिज़ाइन==
==अन्य वीसीआर टोपोलॉजी और डिज़ाइन==


इन अधिक बुनियादी वीसीआर डिज़ाइनों के अलावा, कई और अधिक परिष्कृत डिज़ाइन भी हैं। इन डिज़ाइनों में अधिकांश एक डिफरेंशियल डिफरेंस कन्वेयर करंट (डीडीसीसी) सर्किट, एक डिफरेंशियल एम्पलीफायर, दो या अधिक मिलान वाले जेएफईटी ट्रांजिस्टर या एक या दो [[ ऑपरेशनल एंप्लीफायर |ऑपरेशनल एंप्लीफायर]] शामिल होते हैं। ये डिज़ाइन गतिशील रेंज, विरूपण, सिग्नल-टू-शोर अनुपात और तापमान भिन्नता के प्रति संवेदनशीलता में सुधार प्रदान करते हैं।<ref>Wee, Keng Hoongl; Sarpeshkar, Rahul (1986) JFET Ohmic Differential Amplifier, Keithley Instruments, U.S. Patent</ref><ref>Holani, Rani; Pandey, Prem C; Tiwari, Nitya (2014). A JFET-based Circuit For Realizing a Precision and linear Floating Voltage-Controlled Resistance, 2014 Annual IEEE India Conference (INDICON).</ref>
इन अधिक मौलिक वीसीआर डिज़ाइनों के अतिरिक्त, अनेक और अधिक परिष्कृत डिज़ाइन भी हैं। इन डिज़ाइनों में अधिकांश एक डिफरेंशियल डिफरेंस कन्वेयर करंट (डीडीसीसी) परिपथ, एक डिफरेंशियल एम्पलीफायर, दो या अधिक मिलान वाले जेएफईटी ट्रांजिस्टर या एक या दो [[ ऑपरेशनल एंप्लीफायर |ऑपरेशनल एंप्लीफायर]] सम्मिलित होते हैं। यह डिज़ाइन गतिशील सीमा, विरूपण, संकेत-टू-ध्वनि अनुपात और तापमान भिन्नता के प्रति संवेदनशीलता में सुधार प्रदान करते हैं।<ref>Wee, Keng Hoongl; Sarpeshkar, Rahul (1986) JFET Ohmic Differential Amplifier, Keithley Instruments, U.S. Patent</ref><ref>Holani, Rani; Pandey, Prem C; Tiwari, Nitya (2014). A JFET-based Circuit For Realizing a Precision and linear Floating Voltage-Controlled Resistance, 2014 Annual IEEE India Conference (INDICON).</ref>
 
 
==डिज़ाइन सिद्धांत - IV विश्लेषण==
==डिज़ाइन सिद्धांत - IV विश्लेषण==


वर्तमान-वोल्टेज (IV) स्थानांतरण विशेषताएँ निर्धारित करती हैं कि JFET VCR कैसा प्रदर्शन करेगा। विशेष रूप से, IV वक्रों के रैखिक क्षेत्र इनपुट सिग्नल रेंज निर्धारित करते हैं जहां वीसीआर एक प्रतिरोधक के रूप में व्यवहार करेगा। एक विशिष्ट JFET के वक्र प्रतिरोधक मानों की सीमा को भी निर्धारित करते हैं जिनके लिए VCR को प्रोग्राम किया जा सकता है।
वर्तमान-वोल्टेज (IV) स्थानांतरण विशेषताएँ निर्धारित करती हैं कि जेएफईटी वी.सी.आर कैसा प्रदर्शन करेगा। विशेष रूप से, IV वक्रों के रैखिक क्षेत्र इनपुट संकेत सीमा निर्धारित करते हैं जहां वीसीआर एक प्रतिरोधक के रूप में व्यवहार करेगा। एक विशिष्ट जेएफईटी के वक्र प्रतिरोधक मानों की सीमा को भी निर्धारित करते हैं जिनके लिए वी.सी.आर को प्रोग्राम किया जा सकता है।


JFET IV वक्र को परिभाषित करने वाला गणितीय फ़ंक्शन रैखिक नहीं है। हालाँकि, इन वक्रों के ऐसे क्षेत्र हैं जो बहुत रैखिक हैं। इनमें ट्रायोड क्षेत्र (ओमिक या रैखिक क्षेत्र के रूप में भी जाना जाता है) और संतृप्ति क्षेत्र (सक्रिय क्षेत्र या निरंतर-वर्तमान-स्रोत क्षेत्र के रूप में भी जाना जाता है) शामिल हैं। ट्रायोड क्षेत्र में, JFET एक प्रतिरोधक की तरह कार्य करता है, हालाँकि, संतृप्ति क्षेत्र में यह एक स्थिर-वर्तमान स्रोत की तरह व्यवहार करता है। वह बिंदु जो ट्रायोड क्षेत्र और संतृप्ति क्षेत्र को अलग करता है, मोटे तौर पर वह बिंदु है जहां वी<sub>DS</sub> V के बराबर है<sub>GS</sub> प्रत्येक IV वक्र पर।
जेएफईटी IV वक्र को परिभाषित करने वाला गणितीय फलन रैखिक नहीं है। चूँकि, इन वक्रों के ऐसे क्षेत्र हैं जो बहुत रैखिक हैं। इनमें ट्रायोड क्षेत्र (ओमिक या रैखिक क्षेत्र के रूप में भी जाना जाता है) और संतृप्ति क्षेत्र (सक्रिय क्षेत्र या निरंतर-वर्तमान-स्रोत क्षेत्र के रूप में भी जाना जाता है) सम्मिलित हैं। ट्रायोड क्षेत्र में, जेएफईटी एक प्रतिरोधक की तरह कार्य करता है, चूँकि, संतृप्ति क्षेत्र में यह एक स्थिर-वर्तमान स्रोत की तरह व्यवहार करता है। वह बिंदु जो ट्रायोड क्षेत्र और संतृप्ति क्षेत्र को भिन्न करता है, सामान्यतः वह बिंदु है जहां V<sub>DS</sub> प्रत्येक IV वक्र पर ''V''<sub>GS</sub> के सामान्तर है।


ट्रायोड क्षेत्र में, ड्रेन-टू-सोर्स वोल्टेज में बदलाव से जेएफईटी के ड्रेन और सोर्स टर्मिनलों के बीच प्रतिरोध में बदलाव नहीं होगा (या बहुत कम बदलाव होगा)। संतृप्ति क्षेत्र में, या अधिक उचित रूप से निरंतर-वर्तमान क्षेत्र में, ड्रेन-टू-सोर्स वोल्टेज में परिवर्तन के लिए ड्रेन-टू-सोर्स प्रतिरोध को इस तरह बदलने की आवश्यकता होगी कि वर्तमान अलग-अलग ड्रेन-टू-सोर्स के लिए स्थिर मूल्य पर बना रहे। वोल्टेज स्तर.
ट्रायोड क्षेत्र में, ड्रेन-टू-सोर्स वोल्टेज में बदलाव से जेएफईटी के ड्रेन और सोर्स टर्मिनलों के मध्य प्रतिरोध में बदलाव नहीं (या बहुत कम बदलाव होगा) होगा। संतृप्ति क्षेत्र में, या अधिक उचित रूप से निरंतर-वर्तमान क्षेत्र में, ड्रेन-टू-सोर्स वोल्टेज में परिवर्तन के लिए ड्रेन टू सोर्स प्रतिरोध को इस तरह बदलने की आवश्यकता होगी कि विभिन्न ड्रेन-टू-सोर्स वोल्टेज स्तरों के लिए करंट एक स्थिर मान पर बना रहे।


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शून्य के निकट V<sub>GS</sub> के मानों के लिए, ड्रेन-टू-सोर्स वोल्टेज रैखिककरण वोल्टेज या ट्रायोड ब्रेकप्वाइंट उस समय की तुलना में बहुत अधिक होता है जब V<sub>GS</sub> का स्तर पिंच-ऑफ वोल्टेज के निकट होता है। इसका अर्थ है कि V<sub>GS</sub> के विभिन्न मानों के लिए निरंतर प्रतिरोधी व्यवहार को बनाए रखने के लिए, अधिकतम रैखिककरण मूल्य उपयोग किए गए V<sub>GS</sub> के उच्चतम मान के अनुसार निर्धारित किया जाएगा।
'''Figure 9: Simulated IV Curves of the Linear Systems LSK489A JFET (minimum spec).'''
Deleted image removed: [[File:Simulated IV Curves of the LSK489A JFET.png|thumb|right|Fig 9: Simulated IV Curves of the Linear Systems LSK489A JFET (minimum spec)]]
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वी के मूल्यों के लिए<sub>GS</sub> शून्य के निकट, ड्रेन-टू-सोर्स वोल्टेज रैखिककरण वोल्टेज या ट्रायोड ब्रेकप्वाइंट वी की तुलना में बहुत अधिक है<sub>GS</sub> स्तर पिंच-ऑफ वोल्टेज के निकट हैं। इसका मतलब वी के विभिन्न मूल्यों के लिए निरंतर प्रतिरोधक व्यवहार को बनाए रखना है<sub>GS</sub>, अधिकतम रैखिककरण मान V के उच्चतम मान के अनुसार निर्धारित किया जाएगा<sub>GS</sub> इस्तेमाल किया गया।


रैखिक ट्रायोड क्षेत्र में वास्तव में V के नकारात्मक मान शामिल हैं<sub>GS</sub>. नीचे दिया गया चित्र, ट्रायोड क्षेत्र में IV वक्रों का LTSPICE (LTSPICE) सिमुलेशन दिखाता है। जैसा कि देखा जा सकता है, एक गैर-रैखिकीकृत LSK489 लगभग −0.1 V से 0.1 V तक रैखिक है। V के लिए<sub>GS</sub> 0 वी के करीब के स्तर पर, ट्रायोड रैखिक सीमा लगभग −0.2 वी से 0.2 वी तक फैली हुई है। वी के मूल्य के रूप में<sub>GS</sub> वृद्धि हुई है, रैखिक ट्रायोड क्षेत्र काफी कम हो गया है।
रैखिक ट्रायोड क्षेत्र में वास्तव में V<sub>GS</sub> के ऋणात्मक मान सम्मिलित हैं। नीचे दिया गया चित्र, ट्रायोड क्षेत्र में IV वक्रों का LTSPICE (LTSPICE) सिमुलेशन दिखाता है। जैसा कि देखा जा सकता है, एक गैर-रैखिकीकृत एलएसके489 लगभग −0.1 वी से 0.1 वी तक रैखिक है। 0 वी के निकट V<sub>GS</sub> स्तरों के लिए, ट्रायोड रैखिक सीमा लगभग -0.2 वी से 0.2 वी तक फैली हुई है। जैसे-जैसे V<sub>GS</sub> का मान बढ़ता है रैखिक ट्रायोड क्षेत्र अत्यंत कम हो गया है।
 
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'''Figure 10: The LSK489A JFET triode region (minimum spec)'''
Deleted image removed: [[File:LSK489A JFET triode region (minimum spec).png|thumb|right|Fig 10: The LSK489A JFET triode region (minimum spec)]]
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इसके विपरीत, जब रैखिककरण प्रतिरोधों का उपयोग किया जाता है, तो एक समान IV वक्र स्वेप्ट सिमुलेशन इंगित करता है कि रैखिक ट्रायोड क्षेत्र काफी विस्तारित है। IV वक्रों से, कोई देख सकता है कि रैखिक डिज़ाइन के लिए रैखिककरण क्षेत्र -6 V से 6 V (I) तक आसानी से विस्तारित होता है<sub>DS</sub> बनाम वी<sub>DS</sub> बनाम वी<sub>in</sub> वक्र)। गैर-रैखिकीकृत डिज़ाइन लगभग 200 mV रेंज से बहुत ऊपर उत्पन्न होता है।
 
आगे दिलचस्प बात यह है कि रैखिककरण के परिणामस्वरूप गेट-टू-सोर्स वोल्टेज का रैखिककरण होता है, भले ही इनपुट वोल्टेज (V<sub>in</sub>) प्रत्येक स्वीप के दौरान निरंतर डीसी स्तर पर रखा जाता है। ऐसा इसलिए है क्योंकि जैसे ही इनपुट वोल्टेज बदलता है, वी का मान<sub>GS</sub> वोल्टेज ऐसे बदलता है कि वी<sub>GS</sub> सदैव आधे V के बराबर होता है<sub>DS</sub>. वी में परिवर्तन<sub>GS</sub> वी में परिवर्तन के लिए<sub>DS</sub> ऐसा है कि JFET उस बिंदु तक एक प्रतिरोधक के रूप में व्यवहार करता है जहां JFET संतृप्त होता है।
 
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'''Figure 11: The triode region is extended in a linearized VCR design.'''
Deleted image removed: [[File:The triode region is extended in a linearized VCR design.png|thumb|right|Fig 11: The triode region is extended in a linearized VCR design.]]
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इसके विपरीत, जब रैखिककरण प्रतिरोधों का उपयोग किया जाता है, तो एक समान IV वक्र स्वेप्ट सिमुलेशन निरुपित करता है कि रैखिक ट्रायोड क्षेत्र अत्यंत विस्तारित है। IV वक्रों से, कोई देख सकता है कि रैखिक डिज़ाइन के लिए रैखिककरण क्षेत्र -6 V से 6 V (I<sub>DS</sub> बनाम V<sub>DS</sub> बनाम V<sub>in</sub> वक्र) तक आसानी से विस्तारित होता है। गैर-रैखिकीकृत डिज़ाइन लगभग 200 mV रेंज से बहुत ऊपर उत्पन्न होता है।


आगे रोचक बात यह है कि रैखिककरण के परिणामस्वरूप गेट-टू-सोर्स वोल्टेज का रैखिककरण होता है, किन्तु इनपुट वोल्टेज (V<sub>in</sub>) प्रत्येक स्वीप के समय निरंतर DC स्तर पर रखा जाता है। ऐसा इसलिए है क्योंकि जैसे ही इनपुट वोल्टेज बदलता है, V<sub>GS</sub> का मान वोल्टेज ऐसे बदलता है कि V<sub>GS</sub> सदैव आधे V<sub>DS</sub> के सामान्तर होता है। V<sub>DS</sub> में परिवर्तन V<sub>GS</sub> में परिवर्तन के लिए ऐसा है कि जेएफईटी उस बिंदु तक एक प्रतिरोधक के रूप में व्यवहार करता है जहां जेएफईटी संतृप्त होता है।
==रैखिकीकरण का गणित==
==रैखिकीकरण का गणित==


रैखिककरण प्रतिरोधों के पीछे का गणित सीधे तौर पर दूसरी डिग्री वी को रद्द करने से संबंधित है<sub>DS</sub> JFET ट्रायोड समीकरण में पद. यह समीकरण ड्रेन करंट को V से संबंधित करता है<sub>GS</sub> और वी<sub>DS</sub>. क्लेनफेल्ड<ref>David Kleinfeld Research Laboratory at UC San Diego. The Field Effect Transistor as a Voltage Controlled Resistor. https://neurophysics.ucsd.edu/courses/physics_120/The%20Field%20Effect%20Transistor%20as%20a%20Voltage%20Controlled%20Resistor.pdf</ref> यह साबित करने के लिए किरचॉफ का वर्तमान कानून लागू होता है कि वी<sub>DS</sub> रैखिकरण प्रतिरोधों के साथ गैर-रैखिक शब्द रद्द हो जाता है। द्वितीय-डिग्री (द्विघात) पद को रद्द करने के लिए रैखिककरण प्रतिरोधक बराबर होने चाहिए। समान मूल्य वाले रैखिककरण प्रतिरोधक ड्रेन-टू-सोर्स वोल्टेज को 2 से विभाजित करते हैं, प्रभावी रूप से गैर-रेखीय वी को रद्द कर देते हैं<sub>DS</sub> JFET ट्रायोड समीकरण में पद.
रैखिककरण प्रतिरोधों के पीछे का गणित सामान्यतः जेएफईटी ट्रायोड समीकरण में दूसरी डिग्री V<sub>DS</sub> शब्द को रद्द करने से संबंधित है। यह समीकरण ड्रेन करंट को V<sub>GS</sub> और V<sub>DS</sub> से संबंधित करता है। क्लेनफेल्ड<ref>David Kleinfeld Research Laboratory at UC San Diego. The Field Effect Transistor as a Voltage Controlled Resistor. https://neurophysics.ucsd.edu/courses/physics_120/The%20Field%20Effect%20Transistor%20as%20a%20Voltage%20Controlled%20Resistor.pdf</ref> यह सिद्ध करने के लिए किरचॉफ का वर्तमान नियम प्रयुक्त होता है कि V<sub>DS</sub> गैर-रेखीय शब्द रैखिककरण प्रतिरोधों के साथ रद्द हो जाता है। द्वितीय-डिग्री (द्विघात) पद को रद्द करने के लिए रैखिककरण प्रतिरोधक सामान्तर होने चाहिए। समान मान वाले रैखिककरण प्रतिरोधक ड्रेन-टू-सोर्स वोल्टेज को 2 से विभाजित करते हैं, जिससे जेएफईटी ट्रायोड समीकरण में गैर-रेखीय V<sub>DS</sub> शब्द प्रभावी रूप से रद्द हो जाता है।


==वोल्टेज-नियंत्रित प्रतिरोधकों का भविष्य==
==वोल्टेज-नियंत्रित प्रतिरोधकों का भविष्य==


कई एनालॉग इलेक्ट्रॉनिक सर्किट डिजाइनों के सफल डिजाइन के लिए रोजमर्रा और उच्च-प्रदर्शन वाले वीसीआर आवश्यक हैं और आगे भी रहेंगे। कृत्रिम बुद्धिमत्ता (तंत्रिका) आधारित सेंसर नेटवर्क की उन्नति में वीसीआर डिजाइनों द्वारा केंद्रीय भूमिका निभाने की उम्मीद है।<ref>Liao, Yihua. Neural Networks in Hardware: A Survey, Analog Neurochips, Section 5.3.2, University of California Davis.</ref> वीसीआर, मूल रूप से एक कृत्रिम तंत्रिका नेटवर्क में सिनैप्टिक कोशिकाओं का हृदय है,<ref>Zhang, Xiaolin; Maeda, Yoshinori (2012). Nerve Equivalent Circuit Synapse Equivalent Circuit and Nerve Cell Body Tokyo Institute of Technology. U.S. Patent US 8112373 B2.</ref> हाई-स्पीड एनालॉग डेटा प्रोसेसिंग और सूचना के नियंत्रण को सक्षम करने के लिए आवश्यक है जो माइक्रोकंट्रोलर, डिजिटल-टू-एनालॉग कनवर्टर्स और एनालॉग-टू-डिजिटल कनवर्टर्स वर्तमान में करते हैं।
अनेक एनालॉग इलेक्ट्रॉनिक परिपथ डिजाइनों के सफल डिजाइन के लिए दैनिक और उच्च-प्रदर्शन वाले वीसीआर आवश्यक हैं और आगे भी रहेंगे। कृत्रिम बुद्धिमत्ता (न्यूरल) आधारित सेंसर नेटवर्क की उन्नति में वीसीआर डिजाइनों द्वारा केंद्रीय भूमिका निभाने का विश्वाश है।<ref>Liao, Yihua. Neural Networks in Hardware: A Survey, Analog Neurochips, Section 5.3.2, University of California Davis.</ref> वीसीआर, मूल रूप से एक कृत्रिम न्यूरल नेटवर्क में सिनैप्टिक कोशिकाओं का हृदय है,<ref>Zhang, Xiaolin; Maeda, Yoshinori (2012). Nerve Equivalent Circuit Synapse Equivalent Circuit and Nerve Cell Body Tokyo Institute of Technology. U.S. Patent US 8112373 B2.</ref> हाई-स्पीड एनालॉग डेटा प्रोसेसिंग और सूचना के नियंत्रण को सक्षम करने के लिए आवश्यक है जो माइक्रोकंट्रोलर, डिजिटल-टू-एनालॉग कनवर्टर्स और एनालॉग-से-डिजिटल कनवर्टर्स वर्तमान में करते हैं।
 
कम शोर वाले जेएफईटी अपनी कम सिग्नल संवेदनशीलता, विद्युत चुम्बकीय और विकिरण लचीलापन, और एक सिनैप्टिक सेल में वीसीआर के रूप में और कम शोर वाले उच्च प्रदर्शन सेंसर प्रीएम्प्लीफायर दोनों के रूप में कॉन्फ़िगर करने की उनकी क्षमता के कारण कार्यान्वयन के लिए एक समाधान प्रदान करते हैं। कृत्रिम-बुद्धिमान-आधारित सेंसर नोड्स। यह इस तथ्य का स्वाभाविक विस्तार है कि सेंसर माप अनुप्रयोगों में कम शोर वाले वीसीआर और कम शोर वाले प्रीएम्प्लीफायर के डिजाइन में कम शोर वाले जेएफईटी और कम शोर वाले जेएफईटी सर्किट टोपोलॉजी का बड़े पैमाने पर उपयोग किया जाता है।<ref>Rice University (2016, June), RedEye could let your phone see 24-7. Science Daily.</ref><ref>Quan, Ron. A Guide to Using Sensors JFET for Sensor Applications. Linear Systems.</ref>
 


कम ध्वनि वाले जेएफईटी अपनी कम संकेत संवेदनशीलता, विद्युत चुम्बकीय और विकिरण प्रत्यास्थता, और एक सिनैप्टिक सेल में वीसीआर के रूप में और कम ध्वनि वाले उच्च प्रदर्शन सेंसर प्रीएम्प्लीफायर दोनों के रूप में कॉन्फ़िगर करने की उनकी क्षमता के कारण कृत्रिम-बुद्धिमान-आधारित सेंसर नोड्स कार्यान्वयन के लिए एक समाधान प्रदान करते हैं। यह इस तथ्य का स्वाभाविक विस्तार है कि सेंसर माप अनुप्रयोगों में कम ध्वनि वाले वीसीआर और कम ध्वनि वाले प्रीएम्प्लीफायर के डिजाइन में कम ध्वनि वाले जेएफईटी और कम ध्वनि वाले जेएफईटी परिपथ टोपोलॉजी का बड़े स्तर पर उपयोग किया जाता है।<ref>Rice University (2016, June), RedEye could let your phone see 24-7. Science Daily.</ref><ref>Quan, Ron. A Guide to Using Sensors JFET for Sensor Applications. Linear Systems.</ref>
==संदर्भ==
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वोल्टेज-नियंत्रित प्रतिरोधक (वीसीआर) एक तीन-टर्मिनल सक्रिय उपकरण है जिसमें एक इनपुट पोर्ट और दो आउटपुट पोर्ट होते हैं। इनपुट-पोर्ट वोल्टेज आउटपुट पोर्ट के मध्य प्रतिरोधक के मान को नियंत्रित करता है। वीसीआर अधिकांश क्षेत्र-प्रभाव ट्रांजिस्टर (एफईटी) के साथ बनाए जाते हैं। दो प्रकार के एफईटी अधिकांश उपयोग किए जाते हैं: जेएफईटी और एमओएसएफईटी। इसमें फ्लोटिंग वोल्टेज-नियंत्रित प्रतिरोधक और ग्राउंडेड वोल्टेज-नियंत्रित प्रतिरोधक दोनों हैं। फ्लोटिंग वीसीआर को दो निष्क्रिय या सक्रिय घटकों के मध्य रखा जा सकता है। ग्राउंडेड वीसीआर, अधिक सामान्य और कम जटिल डिज़ाइन, के लिए आवश्यक है कि वोल्टेज-नियंत्रित प्रतिरोधक का एक पोर्ट ग्राउंडेड हो।

उपयोग

वोल्टेज-नियंत्रित प्रतिरोधक सबसे अधिक उपयोग किए जाने वाले एनालॉग डिज़ाइन ब्लॉकों में से एक हैं: अनुकूली एनालॉग फ़िल्टर,[1] स्वतः लब्धि नियंत्रण परिपथ, घड़ी जनरेटर,[2] संपीड़क,[3] विद्युतमापी ,[4] ऊर्जा संचयक,[5] विस्तारक,[6] श्रवण यंत्र,[7] प्रकाश मंदक,[8] मॉड्यूलेटर (मिक्सर),[9] कृत्रिम न्यूरल नेटवर्क,[10] प्रोग्रामयोग्य-लाभ एम्पलीफायर,[11] चरणबद्ध सरणियाँ,[12] चरण-बंद लूप,[13] चरण-नियंत्रित डिमिंग परिपथ,[14] चरण-विलंब और -अग्रिम परिपथ,[15] ट्यून करने योग्य फ़िल्टर,[16] वेरिएबल एटेन्यूएटर्स,[17] वोल्टेज-नियंत्रित ऑसिलेटर,[18] वोल्टेज-नियंत्रित मल्टीवाइब्रेटर,[19] साथ ही तरंगरूप जनरेटर,[20] सभी में वोल्टेज-नियंत्रित प्रतिरोधक सम्मिलित हैं।

जेएफईटी वोल्टेज-नियंत्रित प्रतिरोधों के डिजाइन के लिए उपयोग किए जाने वाले अधिक सामान्य सक्रिय उपकरणों में से एक है। इतना कि, जेएफईटी उपकरणों को वोल्टेज-नियंत्रित प्रतिरोधकों के रूप में पैक और बेचा जाता है।[21] सामान्यतः, जेएफईटी को जब वीसीआर के रूप में पैक किया जाता है तब उनमें अधिकांश उच्च संकुचन वोल्टता होता है, जिसके परिणामस्वरूप अधिक गतिशील प्रतिरोध सीमा होती है। वीसीआर के लिए जेएफईटी को अधिकांश जोड़े में पैक किया जाता है, जो वीसीआर डिजाइन की अनुमति देता है जिसके लिए सुमेलित ट्रांजिस्टर पैरामीटर की आवश्यकता होती है।

वीसीआर अनुप्रयोगों के लिए जिसमें सेंसर संकेत प्रवर्धन या ऑडियो सम्मिलित है, असतत जेएफईटी का अधिकांश उपयोग किया जाता है। एक कारण यह है कि जेएफईटी और जेएफईटी के साथ निर्मित परिपथ टोपोलॉजी में कम ध्वनि (विशेष रूप से कम 1/f फ्लिकर ध्वनि और कम विस्फोट ध्वनि) की सुविधा होती है। इन अनुप्रयोगों में, कम ध्वनि वाले जेएफईटी अधिक विश्वसनीय और त्रुटिहीन माप और ध्वनि शुद्धता के ऊंचे स्तर की अनुमति देते हैं।[22]

भिन्न-भिन्न जेएफईटी का उपयोग करने का एक अन्य कारण यह है कि जेएफईटी असमतल वातावरण के लिए उत्तम अनुकूल हैं। जेएफईटी एमओएसएफईटी परिपथ की तुलना में विद्युत, विद्युत चुम्बकीय व्यतिकरण (ईएमआई) और अन्य उच्च विकिरण झटके का उत्तम सामना कर सकते हैं।[23] जेएफईटीएस एक इनपुट सर्ज-प्रोटेक्शन उपकरण के रूप में भी काम कर सकते हैं।[24] मॉसफेटएस की तुलना में जेएफईटीएस इलेक्ट्रोस्टैटिक डिस्चार्ज के प्रति भी कम संवेदनशील होते हैं।[25]

वोल्टेज-नियंत्रित प्रतिरोधक डिज़ाइन

जेएफईटी वीसीआर के लिए दो अधिक सामान्य और सबसे अधिक निवेश प्रभावी डिजाइन गैर-रेखीयकृत और रैखिककृत वीसीआर डिजाइन हैं। गैर-रैखिकीकृत डिज़ाइन के लिए केवल एक जेएफईटी की आवश्यकता होती है, रैखिककृत डिज़ाइन भी एक जेएफईटी का उपयोग करता है, किन्तु इसमें दो रैखिककरण प्रतिरोधक होते हैं। रैखिककृत डिज़ाइन का उपयोग वीसीआर अनुप्रयोगों के लिए किया जाता है जिनके लिए उच्च इनपुट-संकेत वोल्टेज स्तर की आवश्यकता होती है। गैर-रेखीय डिज़ाइन का उपयोग कम इनपुट संकेत स्तर और निवेश-संचालित DC अनुप्रयोगों में किया जाता है।

गैर-रैखिकीकृत वीसीआर डिज़ाइन

जेएफईटी वीसीआर पर आधारित प्रोग्रामेबल वोल्टेज डिवाइडर

चित्र पर परिपथ में, एक गैर-रैखिकीकृत वीसीआर डिज़ाइन, वोल्टेज-नियंत्रित प्रतिरोधक, LSK489C जेएफईटी, का उपयोग प्रोग्रामयोग्य वोल्टेज डिवाइडर के रूप में किया जाता है। VGS आपूर्ति जेएफईटी के आउटपुट प्रतिरोध का स्तर निर्धारित करती है। जेएफईटी (RDS) का ड्रेन-टू-सोर्स प्रतिरोध और ड्रेन रेसिस्टर (R1) वोल्टेज-डिवाइडर नेटवर्क बनाते हैं। आउटपुट वोल्टेज समीकरण से निर्धारित किया जा सकता है

Vout = VDC · RDS / (R1 + RDS).

गैर-रैखिकीकृत वीसीआर डिज़ाइन का एक एलटीस्पाइस सिमुलेशन सत्यापित करता है कि जेएफईटी प्रतिरोध गेट-टू-सोर्स वोल्टेज (VGS) में बदलाव के साथ बदलता है। सिमुलेशन (नीचे) में, एक निरंतर इनपुट वोल्टेज प्रयुक्त (वीडीसी आपूर्ति 4 वोल्ट पर सेट होती है) किया जाता है, और गेट-टू-सोर्स वोल्टेज चरणों में कम हो जाता है, जिससे जेएफईटी ड्रेन-टू-सोर्स प्रतिरोध बढ़ जाता है। जेएफईटी के ड्रेन से सोर्स टर्मिनलों के मध्य प्रतिरोध बढ़ जाता है क्योंकि गेट-टू-सोर्स वोल्टेज अधिक ऋणात्मक हो जाता है और गेट-टू-सोर्स वोल्टेज 0 वोल्ट तक पहुंचने पर घट जाता है। नीचे दिया गया अनुकरण इसे स्पष्ट करता है। आउटपुट वोल्टेज लगभग 2.5 वोल्ट है और गेट-टू-सोर्स वोल्टेज -1 वोल्ट हैहै। इसके विपरीत, गेट-टू-सोर्स वोल्टेज 0 वोल्ट होने पर आउटपुट वोल्टेज लगभग 1.6 वोल्ट तक गिर जाता है।

4-वोल्ट इनपुट सिग्नल और 300 ओम के R1 के साथ, जेएफईटी वीसीआर के लिए प्रतिरोध की सीमा की गणना सिमुलेशन परिणामों से की जा सकती है क्योंकि VGS समीकरण का उपयोग करके -1 वोल्ट और 0 वोल्ट के मध्य भिन्न होता है।

RDS = V0 · R1 / (VDS − V0).

उपरोक्त समीकरण का उपयोग करते हुए, VGS = −1 V पर, वीसीआर प्रतिरोध लगभग 500 ओम है, और VGD = 0 V, वीसीआर प्रतिरोध लगभग 200 ओम है।

एक समान वीसीआर परिपथ (लोड प्रतिरोधी को 3000 ओम में बदल दिया गया है) के इनपुट पर रैंप वोल्टेज प्रयुक्त करने से किसी को जेएफईटी के प्रतिरोध का त्रुटिहीन मान निर्धारित करने की अनुमति मिलती है क्योंकि इनपुट वोल्टेज भिन्न होता है।

नीचे दिए गए रैम्प सिमुलेशन से पता चलता है कि जेएफईटी का ड्रेन-टू-सोर्स प्रतिरोध इनपुट स्वीप वोल्टेज, Vsweep (Vsignal) तक लगभग 2 V तक पहुंचने तक अत्यंत स्थिर (लगभग 280 ओम) है। इस बिंदु पर ड्रेन-टू -स्रोत प्रतिरोध तब तक धीरे-धीरे बढ़ना प्रारंभ हो जाता है जब तक कि इनपुट वोल्टेज 8 V तक नहीं पहुंच जाता। लगभग 8 V पर, इस पूर्वाग्रह स्थिति (VGS = 0 V और R = 3 kΩ) के लिए, जेएफईटी ड्रेन करंट (ID(J1)) संतृप्त होता है, और प्रतिरोध अब स्थिर नहीं है और इनपुट वोल्टेज में वृद्धि के साथ बदलता है। रैंप सिमुलेशन यह भी निरुपित करता है कि 2 V से नीचे भी, वीसीआर का प्रतिरोध इनपुट वोल्टेज स्तर से पूरी तरह से स्वतंत्र नहीं है। अर्थात्, वीसीआर प्रतिरोध एक पूर्णतः रैखिक प्रतिरोधक का प्रतिनिधित्व नहीं करता है।

क्योंकि प्रतिरोध 2 V से ऊपर स्थिर नहीं है, इस गैर-रैखिकीकृत वीसीआर डिज़ाइन का उपयोग अधिकांश तब किया जाता है जब इनपुट वोल्टेज संकेत 1 V से नीचे होता है, जैसे सेंसर अनुप्रयोगों में या ऐसे अनुप्रयोगों में जहां उच्च इनपुट वोल्टेज स्तरों पर विरूपण चिंता का विषय नहीं है। या अन्य स्थितियों में, जब एक स्थिर प्रतिरोधक मान की आवश्यकता नहीं (उदाहरण के लिए, एलईडी डिमर अनुप्रयोगों और संगीत पेडल-प्रभाव परिपथ में) होती है।

रैखिकीकृत वीसीआर डिज़ाइन

इनपुट वोल्टेज की गतिशील सीमा को बढ़ाने के लिए, इनपुट संकेत सीमा पर निरंतर प्रतिरोध बनाए रखने के लिए, और संकेत-से-ध्वनि अनुपात और कुल हार्मोनिक विरूपण विनिर्देशों में सुधार करने के लिए, रैखिककरण प्रतिरोधों का उपयोग किया जाता है।

वोल्टेज-नियंत्रित प्रतिरोधों की एक मूलभूत सीमा यह है कि इनपुट संकेत को रैखिककरण वोल्टेज (लगभग वह बिंदु जब जेएफईटी संतृप्ति में प्रवेश करता है) से नीचे रखा जाना चाहिए। यदि रैखिककरण वोल्टेज पार हो गया है, तब वोल्टेज नियंत्रण प्रतिरोधक मान इनपुट वोल्टेज संकेत के स्तर और गेट-टू-सोर्स वोल्टेज दोनों के साथ बदल जाएगा।[26]

बड़े इनपुट सिग्नलों को संभालने की इस डिज़ाइन की क्षमता के मूल्यांकन के लिए, वीसीआर इनपुट पर एक रैंप लगाया जाता है। रैंप सिमुलेशन के परिणामों से, वीसीआर एक वास्तविक प्रतिरोधक का कितनी निकटतम से अनुकरण करता है और इनपुट वोल्टेज की किस सीमा पर वीसीआर एक प्रतिरोधक के रूप में व्यवहार करता है, यह निर्धारित किया जाता है।

नीचे रैखिककृत वीसीआर रैंप सिमुलेशन निरुपित करता है कि वीसीआर प्रतिरोध लगभग −6 V से 6 V (the V(Vout)/I(R1) वक्र) तक इनपुट सिग्नल सीमा के लिए लगभग 260 ओम पर स्थिर है। स्वीप यह भी निरुपित करता है कि वीसीआर प्रतिरोध नाटकीय रूप से बढ़ना प्रारंभ हो जाता है, जैसा कि जेएफईटी के संतृप्ति क्षेत्र में प्रवेश करने के पश्चात् गैर-रेखीय डिजाइन में होता है।

रैखिककृत वीसीआर के व्यापक स्थिर प्रतिरोध क्षेत्र के कारण, गैर-रैखिकीकृत डिज़ाइनों की तुलना में बहुत बड़े इनपुट संकेतों को विरूपण के बिना वीसीआर पर प्रयुक्त किया जा सकता है। चूँकि, यह विचार करना भी महत्वपूर्ण है कि ड्रेन रेसिस्टर मान ड्रेन-टू-सोर्स वोल्टेज की सीमा को थोड़ा प्रभावित करेगा जो कि वीसीआर प्रतिरोध स्थिर है।

बढ़ी हुई रैखिककरण सीमा के कारण, रैखिक परिपथ एसी संकेतों को संभालने में सक्षम है जो विरूपण के दृश्य स्तर सेट होने से पहले 8 V पीक-टू-पीक के क्रम में हैं। नीचे दिया गया सिमुलेशन, जो 3000-ओम नाली प्रतिरोधी का उपयोग करता है, दर्शाता है कि वीसीआर का उपयोग अत्यंत उच्च इनपुट वोल्टेज इनपुट संकेत पर सफलतापूर्वक किया जा सकता है। इस डिज़ाइन के लिए, 8 V पीक-टू-पीक इनपुट वोल्टेज संकेत को 2.2 वोल्ट पीक से 0.5 वोल्ट पीक तक क्षीण किया जा सकता है, जब नियंत्रण वोल्टेज -2.5 वोल्ट से 0.5 वोल्ट तक भिन्न होता है।

गैर-रैखिकीकृत डिज़ाइन के विपरीत, रैखिककृत वीसीआर डिज़ाइन के बारे में ध्यान देने योग्य बात यह है कि आउटपुट संकेत में कोई महत्वपूर्ण ऑफसेट नहीं होता है। नियंत्रण वोल्टेज बदलने पर यह 0 V पर केन्द्रित रहता है। गैर-रेखीय डिज़ाइन के सिमुलेशन आउटपुट पर एक महत्वपूर्ण ऑफसेट वोल्टेज का संकेत देते हैं। रेखीयकृत वीसीआर डिज़ाइन की एक अन्य महत्वपूर्ण विशेषता यह है कि इसमें गैर-रैखिकीकृत डिज़ाइन की तुलना में अधिक आउटपुट करंट होता है। रैखिककरण प्रतिरोधों का प्रभाव वीसीआर के अंतराचालकता लाभ को प्रभावी रूप से बढ़ाना है।

प्रतिरोध सीमा चयन

विभिन्न वीसीआर प्रतिरोध सीमा प्राप्त करने के लिए विभिन्न जेएफईटी का उपयोग किया जा सकता है। सामान्यतः, जेएफईटी के लिए आईडीएसएस मान जितना अधिक होगा, प्राप्त प्रतिरोध मान उतना ही कम होगा। इसी प्रकार, आईडीएसएस के कम मानों वाले जेएफईटी में प्रतिरोध के उच्च मान होते हैं।[27] जेएफईटीएस के एक बैंक के साथ, विभिन्न आईडीएसएस मानों के साथ (और इसलिए, RDS मान), प्रोग्राम करने योग्य स्वचालित लाभ-नियंत्रण परिपथ के बैंकों का निर्माण किया जा सकता है जो प्रतिरोध सीमा की एक विस्तृत श्रृंखला प्रदान करते हैं। उदाहरण के लिए, LSK489A और LSK489C, ग्रेडेड IDSS जेएफईटीएस, 3:1 प्रतिरोध भिन्नता दिखाते हैं।

विरूपण संबंधी विचार

वोल्टेज-नियंत्रित प्रतिरोधों के साथ विरूपण एक प्रमुख चिंता का विषय है। जब एक एसी या गैर-डीसी इनपुट संकेत प्रयुक्त किया जाता है जिसके परिणामस्वरूप वीसीआर प्रतिरोधक रैखिक ट्रायोड क्षेत्र से बाहर चला जाता है (या पूरी तरह से रैखिक ट्रायोड क्षेत्र से कम में संचालित होता है), तब इनपुट संकेत परिणामों का असमान प्रवर्धन (प्रत्यक्ष परिणाम के रूप में) प्रतिरोध में एक गैर-रैखिक वृद्धि) होता हैं। इसके परिणामस्वरूप आउटपुट संकेत में विकृति आती है।

इस समस्या को दूर करने के लिए, गैर-रैखिकीकृत वीसीआर को अत्यंत कम संकेत स्तरों पर संचालित किया जाता है। दूसरी ओर, रैखिककृत वीसीआर डिज़ाइन में बहुत अधिक इनपुट वोल्टेज संकेत स्तरों पर अत्यंत कम विरूपण होगा और कुल हार्मोनिक विरूपण विनिर्देश में सुधार की अनुमति होगी।

उदाहरण के लिए, जब 5 V पीक-टू-पीक का इनपुट संकेत एक गैर-रैखिक वीसीआर डिज़ाइन पर प्रयुक्त किया जाता है, तब नीचे दिया गया सिमुलेशन महत्वपूर्ण मात्रा में दृश्य विरूपण दिखाता है।

दूसरी ओर, जब 8 V पीक-टू-पीक इनपुट संकेत प्रयुक्त किया जाता है तब एक रेखीयकृत वीसीआर डिज़ाइन का सिमुलेशन बहुत कम विरूपण (चित्रा 7) दिखाता है।

अन्य वीसीआर टोपोलॉजी और डिज़ाइन

इन अधिक मौलिक वीसीआर डिज़ाइनों के अतिरिक्त, अनेक और अधिक परिष्कृत डिज़ाइन भी हैं। इन डिज़ाइनों में अधिकांश एक डिफरेंशियल डिफरेंस कन्वेयर करंट (डीडीसीसी) परिपथ, एक डिफरेंशियल एम्पलीफायर, दो या अधिक मिलान वाले जेएफईटी ट्रांजिस्टर या एक या दो ऑपरेशनल एंप्लीफायर सम्मिलित होते हैं। यह डिज़ाइन गतिशील सीमा, विरूपण, संकेत-टू-ध्वनि अनुपात और तापमान भिन्नता के प्रति संवेदनशीलता में सुधार प्रदान करते हैं।[28][29]

डिज़ाइन सिद्धांत - IV विश्लेषण

वर्तमान-वोल्टेज (IV) स्थानांतरण विशेषताएँ निर्धारित करती हैं कि जेएफईटी वी.सी.आर कैसा प्रदर्शन करेगा। विशेष रूप से, IV वक्रों के रैखिक क्षेत्र इनपुट संकेत सीमा निर्धारित करते हैं जहां वीसीआर एक प्रतिरोधक के रूप में व्यवहार करेगा। एक विशिष्ट जेएफईटी के वक्र प्रतिरोधक मानों की सीमा को भी निर्धारित करते हैं जिनके लिए वी.सी.आर को प्रोग्राम किया जा सकता है।

जेएफईटी IV वक्र को परिभाषित करने वाला गणितीय फलन रैखिक नहीं है। चूँकि, इन वक्रों के ऐसे क्षेत्र हैं जो बहुत रैखिक हैं। इनमें ट्रायोड क्षेत्र (ओमिक या रैखिक क्षेत्र के रूप में भी जाना जाता है) और संतृप्ति क्षेत्र (सक्रिय क्षेत्र या निरंतर-वर्तमान-स्रोत क्षेत्र के रूप में भी जाना जाता है) सम्मिलित हैं। ट्रायोड क्षेत्र में, जेएफईटी एक प्रतिरोधक की तरह कार्य करता है, चूँकि, संतृप्ति क्षेत्र में यह एक स्थिर-वर्तमान स्रोत की तरह व्यवहार करता है। वह बिंदु जो ट्रायोड क्षेत्र और संतृप्ति क्षेत्र को भिन्न करता है, सामान्यतः वह बिंदु है जहां VDS प्रत्येक IV वक्र पर VGS के सामान्तर है।

ट्रायोड क्षेत्र में, ड्रेन-टू-सोर्स वोल्टेज में बदलाव से जेएफईटी के ड्रेन और सोर्स टर्मिनलों के मध्य प्रतिरोध में बदलाव नहीं (या बहुत कम बदलाव होगा) होगा। संतृप्ति क्षेत्र में, या अधिक उचित रूप से निरंतर-वर्तमान क्षेत्र में, ड्रेन-टू-सोर्स वोल्टेज में परिवर्तन के लिए ड्रेन टू सोर्स प्रतिरोध को इस तरह बदलने की आवश्यकता होगी कि विभिन्न ड्रेन-टू-सोर्स वोल्टेज स्तरों के लिए करंट एक स्थिर मान पर बना रहे।

शून्य के निकट VGS के मानों के लिए, ड्रेन-टू-सोर्स वोल्टेज रैखिककरण वोल्टेज या ट्रायोड ब्रेकप्वाइंट उस समय की तुलना में बहुत अधिक होता है जब VGS का स्तर पिंच-ऑफ वोल्टेज के निकट होता है। इसका अर्थ है कि VGS के विभिन्न मानों के लिए निरंतर प्रतिरोधी व्यवहार को बनाए रखने के लिए, अधिकतम रैखिककरण मूल्य उपयोग किए गए VGS के उच्चतम मान के अनुसार निर्धारित किया जाएगा।

रैखिक ट्रायोड क्षेत्र में वास्तव में VGS के ऋणात्मक मान सम्मिलित हैं। नीचे दिया गया चित्र, ट्रायोड क्षेत्र में IV वक्रों का LTSPICE (LTSPICE) सिमुलेशन दिखाता है। जैसा कि देखा जा सकता है, एक गैर-रैखिकीकृत एलएसके489 लगभग −0.1 वी से 0.1 वी तक रैखिक है। 0 वी के निकट VGS स्तरों के लिए, ट्रायोड रैखिक सीमा लगभग -0.2 वी से 0.2 वी तक फैली हुई है। जैसे-जैसे VGS का मान बढ़ता है रैखिक ट्रायोड क्षेत्र अत्यंत कम हो गया है।

इसके विपरीत, जब रैखिककरण प्रतिरोधों का उपयोग किया जाता है, तो एक समान IV वक्र स्वेप्ट सिमुलेशन निरुपित करता है कि रैखिक ट्रायोड क्षेत्र अत्यंत विस्तारित है। IV वक्रों से, कोई देख सकता है कि रैखिक डिज़ाइन के लिए रैखिककरण क्षेत्र -6 V से 6 V (IDS बनाम VDS बनाम Vin वक्र) तक आसानी से विस्तारित होता है। गैर-रैखिकीकृत डिज़ाइन लगभग 200 mV रेंज से बहुत ऊपर उत्पन्न होता है।

आगे रोचक बात यह है कि रैखिककरण के परिणामस्वरूप गेट-टू-सोर्स वोल्टेज का रैखिककरण होता है, किन्तु इनपुट वोल्टेज (Vin) प्रत्येक स्वीप के समय निरंतर DC स्तर पर रखा जाता है। ऐसा इसलिए है क्योंकि जैसे ही इनपुट वोल्टेज बदलता है, VGS का मान वोल्टेज ऐसे बदलता है कि VGS सदैव आधे VDS के सामान्तर होता है। VDS में परिवर्तन VGS में परिवर्तन के लिए ऐसा है कि जेएफईटी उस बिंदु तक एक प्रतिरोधक के रूप में व्यवहार करता है जहां जेएफईटी संतृप्त होता है।

रैखिकीकरण का गणित

रैखिककरण प्रतिरोधों के पीछे का गणित सामान्यतः जेएफईटी ट्रायोड समीकरण में दूसरी डिग्री VDS शब्द को रद्द करने से संबंधित है। यह समीकरण ड्रेन करंट को VGS और VDS से संबंधित करता है। क्लेनफेल्ड[30] यह सिद्ध करने के लिए किरचॉफ का वर्तमान नियम प्रयुक्त होता है कि VDS गैर-रेखीय शब्द रैखिककरण प्रतिरोधों के साथ रद्द हो जाता है। द्वितीय-डिग्री (द्विघात) पद को रद्द करने के लिए रैखिककरण प्रतिरोधक सामान्तर होने चाहिए। समान मान वाले रैखिककरण प्रतिरोधक ड्रेन-टू-सोर्स वोल्टेज को 2 से विभाजित करते हैं, जिससे जेएफईटी ट्रायोड समीकरण में गैर-रेखीय VDS शब्द प्रभावी रूप से रद्द हो जाता है।

वोल्टेज-नियंत्रित प्रतिरोधकों का भविष्य

अनेक एनालॉग इलेक्ट्रॉनिक परिपथ डिजाइनों के सफल डिजाइन के लिए दैनिक और उच्च-प्रदर्शन वाले वीसीआर आवश्यक हैं और आगे भी रहेंगे। कृत्रिम बुद्धिमत्ता (न्यूरल) आधारित सेंसर नेटवर्क की उन्नति में वीसीआर डिजाइनों द्वारा केंद्रीय भूमिका निभाने का विश्वाश है।[31] वीसीआर, मूल रूप से एक कृत्रिम न्यूरल नेटवर्क में सिनैप्टिक कोशिकाओं का हृदय है,[32] हाई-स्पीड एनालॉग डेटा प्रोसेसिंग और सूचना के नियंत्रण को सक्षम करने के लिए आवश्यक है जो माइक्रोकंट्रोलर, डिजिटल-टू-एनालॉग कनवर्टर्स और एनालॉग-से-डिजिटल कनवर्टर्स वर्तमान में करते हैं।

कम ध्वनि वाले जेएफईटी अपनी कम संकेत संवेदनशीलता, विद्युत चुम्बकीय और विकिरण प्रत्यास्थता, और एक सिनैप्टिक सेल में वीसीआर के रूप में और कम ध्वनि वाले उच्च प्रदर्शन सेंसर प्रीएम्प्लीफायर दोनों के रूप में कॉन्फ़िगर करने की उनकी क्षमता के कारण कृत्रिम-बुद्धिमान-आधारित सेंसर नोड्स कार्यान्वयन के लिए एक समाधान प्रदान करते हैं। यह इस तथ्य का स्वाभाविक विस्तार है कि सेंसर माप अनुप्रयोगों में कम ध्वनि वाले वीसीआर और कम ध्वनि वाले प्रीएम्प्लीफायर के डिजाइन में कम ध्वनि वाले जेएफईटी और कम ध्वनि वाले जेएफईटी परिपथ टोपोलॉजी का बड़े स्तर पर उपयोग किया जाता है।[33][34]

संदर्भ

  1. ↑ Jafaripahah, M.; Al-Hashimi, B. M.; White, N. M. (2004, May). Design Consideration and Implementation of Analog Adaptive Filters for Sensor Response Correction. Proceedings of the ICEE2004.
  2. ↑ Greason, Jeffrey K. (1983). Voltage-Controlled Resistance Element With Superior Dynamic Range. U.S. Patent US 5264785 A US 5264785 A.
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  4. ↑ Wee, Keng Hoongl; Sarpeshkar, Rahul (1986) JFET Ohmic Differential Amplifier, Keithley Instruments, U.S. Patent.
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  6. ↑ Sherwin, Jim (1975, August).
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