मीडिया-स्वतंत्र इंटरफ़ेस: Difference between revisions

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{{Short description|Type of computer networking connection}}[[File:Media independent interface (mii) connector on sun ultra 1.jpg|thumb|MII कनेक्टर पर a {{nowrap|[[Sun Ultra series|Sun Ultra 1]]}} निर्माता कार्य केंद्र]]मीडिया-स्वतंत्र इंटरफ़ेस (MII) को मूल रूप से [[ तेज़ ईथरनेट ]] (यानी,) को जोड़ने के लिए एक मानक इंटरफ़ेस के रूप में परिभाषित किया गया था {{nowrap|100 Mbit/s}}) [[ मीडिया अभिगम नियंत्रण ]] (MAC) एक PHY#Ethernet भौतिक ट्रांसीवर के लिए ब्लॉक करता है। MII को IEEE 802.3u द्वारा मानकीकृत किया गया है और विभिन्न प्रकार के PHYs को MACs से जोड़ता है। मीडिया स्वतंत्र होने का मतलब है कि अलग-अलग मीडिया से कनेक्ट करने के लिए विभिन्न प्रकार के PHY डिवाइस (यानी [[ मुड़ जोड़ी पर ईथरनेट ]], [[ फाइबर ऑप्टिक ]], आदि) का उपयोग मैक हार्डवेयर को फिर से डिजाइन या बदले बिना किया जा सकता है। इस प्रकार किसी भी MAC का उपयोग किसी भी PHY के साथ किया जा सकता है, जो नेटवर्क सिग्नल ट्रांसमिशन मीडिया से स्वतंत्र है।
{{Short description|Type of computer networking connection}}[[File:Media independent interface (mii) connector on sun ultra 1.jpg|thumb|MII कनेक्टर पर a {{nowrap|[[Sun Ultra series|Sun Ultra 1]]}} निर्माता कार्य केंद्र]]मीडिया-स्वतंत्र इंटरफ़ेस (एमआईआई) को मूल रूप से [[ तेज़ ईथरनेट ]] (यानी,) को जोड़ने के लिए एक मानक इंटरफ़ेस के रूप में परिभाषित किया गया था (100 एमबीटी/एस) [[ मीडिया अभिगम नियंत्रण ]] (मैक) एक पीएचवाई ईथरनेट भौतिक ट्रांसीवर के लिए ब्लॉक करता है। एमआईआई को आई ई ई ई 802.3u द्वारा मानकीकृत किया गया है और विभिन्न प्रकार के पीएचवाई एस को मैको से जोड़ता है। मीडिया स्वतंत्र होने का मतलब है कि अलग-अलग मीडिया से कनेक्ट करने के लिए विभिन्न प्रकार के पीएचवाई डिवाइस (यानी [[ मुड़ जोड़ी पर ईथरनेट ]], [[ फाइबर ऑप्टिक ]], आदि) का उपयोग मैक हार्डवेयर को फिर से डिजाइन या बदले बिना किया जा सकता है। इस प्रकार किसी भी मैक का उपयोग किसी भी पीएचवाई के साथ किया जा सकता है, जो नेटवर्क सिग्नल ट्रांसमिशन मीडिया से स्वतंत्र है।


MII का उपयोग प्लगेबल कनेक्टर का उपयोग करके MAC को बाहरी PHY से कनेक्ट करने के लिए या सीधे उसी [[ मुद्रित सर्किट बोर्ड ]] पर PHY चिप से कनेक्ट करने के लिए किया जा सकता है। एक पीसी पर संचार और नेटवर्किंग राइजर टाइप बी में एमआईआई सिग्नल होते हैं।
एमआईआई का उपयोग प्लगेबल कनेक्टर का उपयोग करके मैक को बाहरी पीएचवाई से कनेक्ट करने के लिए या सीधे उसी [[ मुद्रित सर्किट बोर्ड ]] पर पीएचवाई चिप से कनेक्ट करने के लिए किया जा सकता है। एक पीसी पर संचार और नेटवर्किंग राइजर टाइप बी में एमआईआई सिग्नल होते हैं।


इंटरफ़ेस पर नेटवर्क डेटा IEEE [[ ईथरनेट ]] मानक का उपयोग कर [[ ईथरनेट फ्रेम ]] है। जैसे कि इसमें एक प्रस्तावना, स्टार्ट फ्रेम डिलीमीटर, ईथरनेट हेडर, प्रोटोकॉल-विशिष्ट डेटा और [[ चक्रीय अतिरेक की जाँच ]] (सीआरसी) शामिल हैं। मूल MII प्रत्येक दिशा में 4-बिट [[ कुतरना ]]्स का उपयोग करके नेटवर्क डेटा स्थानांतरित करता है (4 डेटा बिट्स संचारित करता है, 4 डेटा बिट्स प्राप्त करता है)। 100 Mbit/s थ्रूपुट प्राप्त करने के लिए डेटा को 25 MHz पर क्लॉक किया जाता है। कम संकेतों और बढ़ी हुई गति का समर्थन करने के लिए मूल MII डिज़ाइन को बढ़ाया गया है। वर्तमान वेरिएंट में शामिल हैं:
इंटरफ़ेस पर नेटवर्क डेटा आई ई ई ई [[ ईथरनेट ]] मानक का उपयोग कर [[ ईथरनेट फ्रेम ]] है। जैसे कि इसमें एक प्रस्तावना, स्टार्ट फ्रेम डिलीमीटर, ईथरनेट हेडर, प्रोटोकॉल-विशिष्ट डेटा और [[ चक्रीय अतिरेक की जाँच ]] (सीआरसी) शामिल हैं। मूल एमआईआई प्रत्येक दिशा में 4-बिट [[ कुतरना ]]्स का उपयोग करके नेटवर्क डेटा स्थानांतरित करता है (4 डेटा बिट्स संचारित करता है, 4 डेटा बिट्स प्राप्त करता है)। 100 एमबीटी/एस थ्रूपुट प्राप्त करने के लिए डेटा को 25 मेगाहर्ट्ज पर क्लॉक किया जाता है। कम संकेतों और बढ़ी हुई गति का समर्थन करने के लिए मूल MII डिज़ाइन को बढ़ाया गया है। वर्तमान वेरिएंट में शामिल हैं:


* #RMII|कम मीडिया-स्वतंत्र इंटरफ़ेस ('RMII')
* #आरएमआईआई|कम मीडिया-स्वतंत्र इंटरफ़ेस ('आरएमआईआई')
* #GMII|गीगाबिट मीडिया-स्वतंत्र इंटरफ़ेस ('GMII')
* #जीएमआईआई|गीगाबिट मीडिया-स्वतंत्र इंटरफ़ेस ('जीएमआईआई')
* #RGMII|कम गीगाबिट मीडिया-स्वतंत्र इंटरफ़ेस ('RGMII')
* #आरजीएमआईआई|कम गीगाबिट मीडिया-स्वतंत्र इंटरफ़ेस ('आरजीएमआईआई')
* सीरियल मीडिया-स्वतंत्र इंटरफ़ेस ('SMII')<ref>{{cite web|url=http://ww1.microchip.com/downloads/en/DeviceDoc/KSZ8001L-S-Data-Sheet-DS00003062A.pdf|title=KSZ8001L/S 1.8V, 3.3V 10/100BASE-T/TX/FX भौतिक परत ट्रांसीवर}}</ref>
* सीरियल मीडिया-स्वतंत्र इंटरफ़ेस ('एसएमआईआई')<ref>{{cite web|url=http://ww1.microchip.com/downloads/en/DeviceDoc/KSZ8001L-S-Data-Sheet-DS00003062A.pdf|title=KSZ8001L/S 1.8V, 3.3V 10/100BASE-T/TX/FX भौतिक परत ट्रांसीवर}}</ref>
* #SGMII|सीरियल गिगाबिट मीडिया-स्वतंत्र इंटरफ़ेस (सीरियल GMII, SGMII)
* #एसजीएमआईआई|सीरियल गिगाबिट मीडिया-स्वतंत्र इंटरफ़ेस (सीरियल जीएमआईआई, एसजीएमआईआई)
* #HSGMII|उच्च सीरियल गीगाबिट मीडिया-स्वतंत्र इंटरफ़ेस (HSGMII)
* #एचएसजीएमआईआई|उच्च सीरियल गीगाबिट मीडिया-स्वतंत्र इंटरफ़ेस (एचएसजीएमआईआई)
* #QSGMII|क्वाड सीरियल गीगाबिट मीडिया-स्वतंत्र इंटरफ़ेस (QSGMII)
* # क्यूएसजीएमआईआई क्वाड सीरियल गीगाबिट मीडिया-स्वतंत्र इंटरफ़ेस ( क्यूएसजीएमआईआई)
* #XGMII|10-गीगाबिट मीडिया-स्वतंत्र इंटरफ़ेस (XGMII)
* #Xजीएमआईआई|10-गीगाबिट मीडिया-स्वतंत्र इंटरफ़ेस (एक्सजीएमआईआई)


प्रबंधन डेटा इनपुट/आउटपुट (MDIO) सीरियल बस MII का एक सबसेट है जिसका उपयोग MAC और PHY के बीच प्रबंधन जानकारी स्थानांतरित करने के लिए किया जाता है। पावर अप पर, [[ स्वतंत्र समझौता ]] का उपयोग करते हुए, PHY आमतौर पर इससे जुड़ा होता है, जब तक कि सेटिंग्स को MDIO इंटरफ़ेस के माध्यम से बदल नहीं दिया जाता है।
प्रबंधन डेटा इनपुट/आउटपुट (एमडीआईओ) सीरियल बस एमआईआई का एक सबसेट है जिसका उपयोग मैक और पीएचवाई के बीच प्रबंधन जानकारी स्थानांतरित करने के लिए किया जाता है। पावर अप पर, [[ स्वतंत्र समझौता ]] का उपयोग करते हुए, पीएचवाई आमतौर पर इससे जुड़ा होता है, जब तक कि सेटिंग्स को एमडीआईओ इंटरफ़ेस के माध्यम से बदल नहीं दिया जाता है।


== मानक एमआईआई ==
== मानक एमआईआई ==
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* मूल मोड कॉन्फ़िगरेशन (#0)
* मूल मोड कॉन्फ़िगरेशन (#0)
* स्थिति शब्द (#1)
* स्थिति शब्द (#1)
* PHY पहचानकर्ता (#2, #3)
* पीएचवाई पहचानकर्ता (#2, #3)
* ऑटो-बातचीत विज्ञापन (#4)
* ऑटो-बातचीत विज्ञापन (#4)
* ऑटो-नेगोशिएशन लिंक पार्टनर बेस पेज एबिलिटी (#5)
* ऑटो-नेगोशिएशन लिंक पार्टनर बेस पेज एबिलिटी (#5)
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! Meaning
! Meaning
|-
|-
| 0x8000 || Capable of [[100BASE-T4]]
| 0x8000 || 100 बेस-टी4 में सक्षम
|-
|-
| 0x6000 || Capable of [[100BASE-TX]] full/half duplex
| 0x6000 || 100 बेस-टेक्सास फुल/हाफ डुप्लेक्स में सक्षम
|-
|-
| 0x1800 || Capable of [[Classic_Ethernet|10BASE-T]] full/half duplex
| 0x1800 || 10 बेस-टी फुल/हाफ डुप्लेक्स में सक्षम
|-
|-
| 0x0600 || Capable of [[100BASE-T2]] full/half duplex
| 0x0600 || 100 बेस-टी2 फुल/हाफ डुप्लेक्स में सक्षम
|-
|-
| 0x0100 || Extended status ([[Gigabit Ethernet]]) register exists
| 0x0100 || विस्तारित स्थिति रजिस्टर मौजूद है(गीगाबिट ईथरनेट)
|-
|-
| 0x0080 || Capable of unidirectional operation
| 0x0080 || यूनिडायरेक्शनल ऑपरेशन में सक्षम
|-
|-
| 0x0040 || Management frame preamble suppression permitted
| 0x0040 || प्रबंधन फ्रेम प्रस्तावना दमन की अनुमति है
|-
|-
| 0x0020 || [[Autonegotiation]] complete
| 0x0020 || पूर्ण ऑटोनेगोटिएशन
|-
|-
| 0x0010 || Remote fault
| 0x0010 || दूरस्थ दोष
|-
|-
| 0x0008 || Capable of Autonegotiation
| 0x0008 || ऑटोनेगोटिएशन करने में सक्षम
|-
|-
| 0x0004 || Link established
| 0x0004 || लिंक स्थापित
|-
|-
| 0x0002 || [[Jabber (networking)|Jabber]] detected
| 0x0002 || जैबर का पता चला
|-
|-
| 0x0001 || Extended MII registers exist
| 0x0001 || विस्तारित एमआईआई रजिस्टर मौजूद हैं
|}
|}


Line 76: Line 76:
! Direction
! Direction
|-
|-
| TX_CLK
| टीएक्स-सीएलके
| Transmit clock
| संचारित घड़ी
| PHY to MAC
| पीएचवाई से मैक
|-
|-
| TXD0
| टीएक्सडी0
| Transmit data bit 0 (transmitted first)
| संचारित डेटा बिट 0 (पहले प्रेषित)
| MAC to PHY
| मैक से  पीएचवाई
|-
|-
| TXD1
| टीएक्सडी1
| Transmit data bit 1
| डेटा 1 बिट संचारित करें
| MAC to PHY
| मैक से  पीएचवाई
|-
|-
| TXD2
| टीएक्सडी2
| Transmit data bit 2
| डेटा 2 बिट संचारित करें
| MAC to PHY
| मैक से  पीएचवाई
|-
|-
| TXD3
| टीएक्सडी3
| Transmit data bit 3
| डेटा 3 बिट संचारित करें
| MAC to PHY
| मैक से  पीएचवाई
|-
|-
| TX_EN
| टीएक्स-ईएन
| Transmit enable
| संचारित सक्षम करें
| MAC to PHY
| मैक से  पीएचवाई
|-
|-
| TX_ER
| टीएक्स-ईआर
| Transmit error (optional)
| प्रेषण त्रुटि (वैकल्पिक)
| MAC to PHY
| मैक से  पीएचवाई
|}
|}
ट्रांसमिट क्लॉक लिंक स्पीड (100 Mbit/s के लिए 25 MHz, 10 Mbit/s के लिए 2.5 MHz) के आधार पर PHY द्वारा जनरेट की गई फ्री-रनिंग क्लॉक है। शेष ट्रांसमिट सिग्नल TX_CLK के बढ़ते किनारे पर MAC द्वारा समकालिक रूप से संचालित होते हैं। यह व्यवस्था मैक को लिंक गति के बारे में जागरूक किए बिना संचालित करने की अनुमति देती है। ट्रांसमिट सक्षम सिग्नल फ्रेम ट्रांसमिशन के दौरान उच्च और ट्रांसमीटर के निष्क्रिय होने पर कम होता है।
ट्रांसमिट क्लॉक लिंक स्पीड (100 मेगाबिट/सेकंड  के लिए 25 मेगाहर्ट्ज, 10 मेगाबिट/सेकंड  के लिए 2.5 मेगाहर्ट्ज) के आधार पर पीएचवाई द्वारा जनरेट की गई फ्री-रनिंग क्लॉक है। शेष ट्रांसमिट सिग्नल टीएक्स_सीएल के के बढ़ते किनारे पर मैक द्वारा समकालिक रूप से संचालित होते हैं। यह व्यवस्था मैक को लिंक गति के बारे में जागरूक किए बिना संचालित करने की अनुमति देती है। ट्रांसमिट सक्षम सिग्नल फ्रेम ट्रांसमिशन के दौरान उच्च और ट्रांसमीटर के निष्क्रिय होने पर कम होता है।


फ्रेम ट्रांसमिशन के दौरान एक या एक से अधिक क्लॉक पीरियड्स के लिए ट्रांसमिट एरर उठाया जा सकता है ताकि PHY को जानबूझकर फ्रेम को कुछ दृश्यमान तरीके से भ्रष्ट करने का अनुरोध किया जा सके जो इसे वैध के रूप में प्राप्त होने से रोकता है। ट्रांसमिशन शुरू होने के बाद कुछ समस्या का पता चलने पर इसका उपयोग फ्रेम को रद्द करने के लिए किया जा सकता है। मैक सिग्नल को छोड़ सकता है अगर इसका इस कार्यक्षमता के लिए कोई उपयोग नहीं है, इस मामले में PHY के लिए सिग्नल को कम बांधा जाना चाहिए।
फ्रेम ट्रांसमिशन के दौरान एक या एक से अधिक क्लॉक पीरियड्स के लिए ट्रांसमिट एरर उठाया जा सकता है ताकि पीएचवाई को जानबूझकर फ्रेम को कुछ दृश्यमान तरीके से भ्रष्ट करने का अनुरोध किया जा सके जो इसे वैध के रूप में प्राप्त होने से रोकता है। ट्रांसमिशन शुरू होने के बाद कुछ समस्या का पता चलने पर इसका उपयोग फ्रेम को रद्द करने के लिए किया जा सकता है। मैक सिग्नल को छोड़ सकता है अगर इसका इस कार्यक्षमता के लिए कोई उपयोग नहीं है, इस मामले में पीएचवाई के लिए सिग्नल को कम बांधा जाना चाहिए।


हाल ही में, फ्रेम ट्रांसमिशन के बाहर ट्रांसमिट एरर बढ़ाने का उपयोग यह इंगित करने के लिए किया जाता है कि ट्रांसमिट डेटा लाइन्स का उपयोग विशेष-उद्देश्य सिग्नलिंग के लिए किया जा रहा है। विशेष रूप से, डेटा मान 0b0001 (TX_EN कम और TX_ER उच्च के साथ लगातार आयोजित) का उपयोग कम पावर मोड में प्रवेश करने के लिए ऊर्जा-कुशल ईथरनेट-सक्षम PHY का अनुरोध करने के लिए किया जाता है।
हाल ही में, फ्रेम ट्रांसमिशन के बाहर ट्रांसमिट एरर बढ़ाने का उपयोग यह इंगित करने के लिए किया जाता है कि ट्रांसमिट डेटा लाइन्स का उपयोग विशेष-उद्देश्य सिग्नलिंग के लिए किया जा रहा है। विशेष रूप से, डेटा मान 0b0001 ( टीएक्स_ईएन कम और टीएक्स_ईआर उच्च के साथ लगातार आयोजित) का उपयोग कम पावर मोड में प्रवेश करने के लिए ऊर्जा-कुशल ईथरनेट-सक्षम पीएचवाई का अनुरोध करने के लिए किया जाता है।


===रिसीवर सिग्नल ===
===रिसीवर सिग्नल ===
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! Direction
! Direction
|-
|-
| RX_CLK
| RX-CLK
| Receive clock
| Receive clock
| PHY to MAC
| पीएचवाई से मैक
|-
|-
| RXD0
| RXD0
| Receive data bit 0 (received first)
| Receive data bit 0 (received first)
| PHY to MAC
| पीएचवाई से मैक
|-
|-
| RXD1
| RXD1
| Receive data bit 1
| Receive data bit 1
| PHY to MAC
| पीएचवाई से मैक
|-
|-
| RXD2
| RXD2
| Receive data bit 2
| Receive data bit 2
| PHY to MAC
| पीएचवाई से मैक
|-
|-
| RXD3
| RXD3
| Receive data bit 3
| Receive data bit 3
| PHY to MAC
| पीएचवाई से मैक
|-
|-
| RX_DV
| RXDV
| Receive data valid
| Receive data valid
| PHY to MAC
| पीएचवाई से मैक
|-
|-
| RX_ER
| RX-ER
| Receive error
| Receive error
| PHY to MAC
| पीएचवाई से मैक
|-
|-
| CRS
| सीआरएस
| Carrier sense
| Carrier sense
| PHY to MAC
| पीएचवाई से मैक
|-
|-
| COL
| सीओएल
| Collision detect
| सीओएलlision detect
| PHY to MAC
| पीएचवाई से मैक
|}
|}
पहले सात रिसीवर सिग्नल पूरी तरह से ट्रांसमीटर सिग्नल के अनुरूप हैं, RX_ER को छोड़कर वैकल्पिक नहीं है और प्राप्त सिग्नल को इंगित करने के लिए वैध डेटा को डीकोड नहीं किया जा सकता है। फ्रेम रिसेप्शन के दौरान इनकमिंग सिग्नल से रिसीव क्लॉक रिकवर किया जाता है। जब कोई घड़ी पुनर्प्राप्त नहीं की जा सकती है (अर्थात जब माध्यम मौन है), PHY को एक फ्री-रनिंग क्लॉक को एक विकल्प के रूप में पेश करना चाहिए।
पहले सात रिसीवर सिग्नल पूरी तरह से ट्रांसमीटर सिग्नल के अनुरूप हैं, टीएक्स_ईआर को छोड़कर वैकल्पिक नहीं है और प्राप्त सिग्नल को इंगित करने के लिए वैध डेटा को डीकोड नहीं किया जा सकता है। फ्रेम रिसेप्शन के दौरान इनकमिंग सिग्नल से रिसीव क्लॉक रिकवर किया जाता है। जब कोई घड़ी पुनर्प्राप्त नहीं की जा सकती है (अर्थात जब माध्यम मौन है), पीएचवाई को एक फ्री-रनिंग क्लॉक को एक विकल्प के रूप में पेश करना चाहिए।


प्राप्त डेटा मान्य सिग्नल (RX_DV) को फ्रेम शुरू होने पर तुरंत उच्च जाने की आवश्यकता नहीं होती है, लेकिन प्राप्त डेटा में फ्रेम सीमांकक बाइट की शुरुआत सुनिश्चित करने के लिए समय पर ऐसा करना चाहिए। प्रस्तावना के कुछ निबल्स खो सकते हैं।
प्राप्त डेटा मान्य सिग्नल (आरएक्स_डीवी) को फ्रेम शुरू होने पर तुरंत उच्च जाने की आवश्यकता नहीं होती है, लेकिन प्राप्त डेटा में फ्रेम सीमांकक बाइट की शुरुआत सुनिश्चित करने के लिए समय पर ऐसा करना चाहिए। प्रस्तावना के कुछ निबल्स खो सकते हैं।


ट्रांसमिट के समान, एक फ्रेम के बाहर RX_ER को उठाना विशेष सिग्नलिंग के लिए उपयोग किया जाता है। प्राप्त करने के लिए, दो डेटा मान परिभाषित किए गए हैं: 0b0001 यह इंगित करने के लिए कि लिंक पार्टनर EEE लो पावर मोड में है, और 0b1110 झूठे वाहक संकेत के लिए है।
ट्रांसमिट के समान, एक फ्रेम के बाहर टीएक्स_ईआर को उठाना विशेष सिग्नलिंग के लिए उपयोग किया जाता है। प्राप्त करने के लिए, दो डेटा मान परिभाषित किए गए हैं: 0b0001 यह इंगित करने के लिए कि लिंक पार्टनर ईईई लो पावर मोड में है, और 0b1110 झूठे वाहक संकेत के लिए है।


CRS और COL सिग्नल प्राप्त घड़ी के लिए अतुल्यकालिक हैं, और केवल आधे-द्वैध मोड में सार्थक हैं। संचारण, प्राप्त करते समय वाहक भावना अधिक होती है, या माध्यम अन्यथा उपयोग में होने के रूप में महसूस किया जाता है। यदि टक्कर का पता चलता है, तो टक्कर बनी रहने पर COL भी ऊपर जाता है।
सीआरएस और सीओएल सिग्नल प्राप्त घड़ी के लिए अतुल्यकालिक हैं, और केवल आधे-द्वैध मोड में सार्थक हैं। संचारण, प्राप्त करते समय वाहक भावना अधिक होती है, या माध्यम अन्यथा उपयोग में होने के रूप में महसूस किया जाता है। यदि टक्कर का पता चलता है, तो टक्कर बनी रहने पर सीओएल भी ऊपर जाता है।


इसके अलावा, MAC कमजोर रूप से COL सिग्नल को खींच सकता है, जिससे अनुपस्थित/डिस्कनेक्टेड PHY के संकेत के रूप में सेवा करने के लिए CRS कम (जो PHY कभी उत्पन्न नहीं होगा) के साथ COL उच्च के संयोजन की अनुमति देता है।
इसके अलावा, मैक कमजोर रूप से सीओएल सिग्नल को खींच सकता है, जिससे अनुपस्थित/डिस्कनेक्टेड पीएचवाई के संकेत के रूप में सेवा करने के लिए सीआरएस कम (जो पीएचवाई कभी उत्पन्न नहीं होगा) के साथ सीओएल उच्च के संयोजन की अनुमति देता है।


=== प्रबंधन संकेत ===
=== प्रबंधन संकेत ===
Line 168: Line 168:
{| class="wikitable"
{| class="wikitable"
|-
|-
! Signal name
! संकेत नाम
! Description
! विवरण
! Direction
! दिशा
|-
|-
| MDIO
| एमडीआईओ
| Management data
| प्रबंधन डेटा
| Bidirectional
| द्विदिश
|-
|-
| MDC    
| एमडीसी    
| Management data clock
| प्रबंधन डेटा घड़ी
| MAC to PHY
| मैक से  पीएचवाई
|}
|}
MDC और MDIO I²C के समान एक तुल्यकालिक सीरियल डेटा इंटरफ़ेस का गठन करते हैं। I²C की तरह, इंटरफ़ेस एक [[ मल्टीड्रॉप बस ]] है इसलिए MDC और MDIO को कई PHYs के बीच साझा किया जा सकता है।
एमडीसी और एमडीआईओ I²C के समान एक तुल्यकालिक सीरियल डेटा इंटरफ़ेस का गठन करते हैं। I²C की तरह, इंटरफ़ेस एक [[ मल्टीड्रॉप बस ]] है इसलिए एमडीसी और एमडीआईओ को कई पीएचवाईs के बीच साझा किया जा सकता है।


=== सीमाएं ===
=== सीमाएं ===
इंटरफ़ेस को 18 संकेतों की आवश्यकता होती है, जिनमें से केवल दो (MDIO और MDC) को कई PHYs के बीच साझा किया जा सकता है। यह एक समस्या प्रस्तुत करता है, विशेष रूप से मल्टीपोर्ट उपकरणों के लिए; उदाहरण के लिए, MII का उपयोग करने वाले आठ-पोर्ट स्विच के लिए 8 × 16 + 2 = 130 सिग्नल की आवश्यकता होगी।
इंटरफ़ेस को 18 संकेतों की आवश्यकता होती है, जिनमें से केवल दो (एमडीआईओ और एमडीसी) को कई पीएचवाईs के बीच साझा किया जा सकता है। यह एक समस्या प्रस्तुत करता है, विशेष रूप से मल्टीपोर्ट उपकरणों के लिए; उदाहरण के लिए, MII का उपयोग करने वाले आठ-पोर्ट स्विच के लिए 8 × 16 + 2 = 130 सिग्नल की आवश्यकता होगी।


==कम मीडिया-स्वतंत्र इंटरफ़ेस ==
==कम मीडिया-स्वतंत्र इंटरफ़ेस ==
{{redirect-distinguish|RMII|RM2 (disambiguation){{!}}RM2}}
{{redirect-distinguish|RMII|RM2 (disambiguation){{!}}RM2}}
रिड्यूस्ड मीडिया-स्वतंत्र इंटरफ़ेस (RMII) एक मानक है जिसे PHY को MAC से जोड़ने के लिए आवश्यक संकेतों की संख्या को कम करने के लिए विकसित किया गया था। पिन काउंट को कम करने से नेटवर्क हार्डवेयर के लिए लागत और जटिलता कम हो जाती है, विशेष रूप से बिल्ट-इन मैक, [[ क्षेत्र में प्रोग्राम की जा सकने वाली द्वार श्रंखला ]], मल्टीपोर्ट स्विच या रिपीटर्स और पीसी मदरबोर्ड चिपसेट के साथ [[ microcontroller ]]्स के संदर्भ में। इसे हासिल करने के लिए एमआईआई मानक की तुलना में चार चीजें बदली गईं। इन परिवर्तनों का अर्थ है कि RMII, MII की तुलना में लगभग आधे संकेतों का उपयोग करता है।
रिड्यूस्ड मीडिया-स्वतंत्र इंटरफ़ेस (आरएमआईआई) एक मानक है जिसे पीएचवाई को मैक से जोड़ने के लिए आवश्यक संकेतों की संख्या को कम करने के लिए विकसित किया गया था। पिन काउंट को कम करने से नेटवर्क हार्डवेयर के लिए लागत और जटिलता कम हो जाती है, विशेष रूप से बिल्ट-इन मैक, [[ क्षेत्र में प्रोग्राम की जा सकने वाली द्वार श्रंखला ]], मल्टीपोर्ट स्विच या रिपीटर्स और पीसी मदरबोर्ड चिपसेट के साथ [[ microcontroller ]]्स के संदर्भ में। इसे हासिल करने के लिए एमआईआई मानक की तुलना में चार चीजें बदली गईं। इन परिवर्तनों का अर्थ है कि आरएमआईआई, MII की तुलना में लगभग आधे संकेतों का उपयोग करता है।
* दो घड़ियों TXCLK और RXCLK को एक घड़ी से बदल दिया गया है। यह घड़ी आउटपुट के बजाय PHY के लिए एक इनपुट है, जो एक स्विच जैसे मल्टीपोर्ट डिवाइस में सभी PHYs के बीच क्लॉक सिग्नल को साझा करने की अनुमति देता है।
* दो घड़ियों ** और RXCLK को एक घड़ी से बदल दिया गया है। यह घड़ी आउटपुट के बजाय पीएचवाई के लिए एक इनपुट है, जो एक स्विच जैसे मल्टीपोर्ट डिवाइस में सभी पीएचवाईs के बीच क्लॉक सिग्नल को साझा करने की अनुमति देता है।
* क्लॉक फ़्रीक्वेंसी को 25 मेगाहर्ट्ज़ से दोगुना करके 50 मेगाहर्ट्ज़ कर दिया गया है, जबकि डेटा पाथ को 4 बिट से 2 बिट तक सीमित कर दिया गया है।
* क्लॉक फ़्रीक्वेंसी को 25 मेगाहर्ट्ज़ से दोगुना करके 50 मेगाहर्ट्ज़ कर दिया गया है, जबकि डेटा पाथ को 4 बिट से 2 बिट तक सीमित कर दिया गया है।
* RXDV और CRS सिग्नल एक सिग्नल में मल्टीप्लेक्स होते हैं।
* RXDV और सीआरएस सिग्नल एक सिग्नल में मल्टीप्लेक्स होते हैं।
* COL सिग्नल हटा दिया गया है।
* सीओएल सिग्नल हटा दिया गया है।


{| class="wikitable"
{| class="wikitable"
|+ Reduced media-independent interface (RMII) signals
|+ Reduced media-independent interface (आरएमआईआई) signals
! Signal name
! Signal name
! Description
! Description
! Direction
! Direction
|-
|-
| REF_CLK
| आर ईएफ_सीएलके
| Continuous 50&nbsp;MHz reference clock
| लगातार 50 मेगाहर्ट्ज संदर्भ घड़ी
| Reference clock may be an input on both devices from an external clock source, or may be driven from the MAC to the PHY, or may be driven from the PHY to the MAC
| संदर्भ घड़ी बाहरी घड़ी स्रोत से दोनों उपकरणों पर एक इनपुट हो सकती है, या मैक से मेन्हाई से संचालित हो सकती है, या मैक से मैक से संचालित हो सकती है।
|-
|-
| TXD0    
| टीएक्सडी0    
| Transmit data bit 0 (transmitted first)
| संचारित डेटा बिट 0 (पहले प्रेषित)
| MAC to PHY
| मैक से  पीएचवाई
|-
|-
| TXD1    
| टीएक्सडी1    
| Transmit data bit 1
| डेटा बिट 1 संचारित करें
| MAC to PHY
| मैक से  पीएचवाई
|-
|-
| TX_EN
| टीएक्स_ईएन
| When high, clock data on TXD0 and TXD1 to the transmitter
| उच्च होने पर, टीएक्सडी 0 और टीएक्सडी1 पर क्लॉक डेटा ट्रांसमीटर से
| MAC to PHY
| मैक से  पीएचवाई
|-
|-
| RXD0    
| आरएक्सडी0    
| Receive data bit 0 (received first)
| डेटा प्राप्त करें बिट 0 (पहले प्राप्त)
| PHY to MAC
| पीएचवाई से मैक
|-
|-
| RXD1    
| आर एक्सडी1    
| Receive data bit 1   
| डेटा बिट 1 प्राप्त करें    
| PHY to MAC
| पीएचवाई से मैक
|-
|-
| CRS_DV
| सीआरएस_डीवी
| Carrier Sense (CRS) and RX_Data Valid (RX_DV) multiplexed on alternate clock cycles. In 10&nbsp;Mbit/s mode, it alternates every 10 clock cycles.  
| कैरियर सेंस (सीआरएस) और आरएक्स_डेटा वैलिड (आरएक्स_डीवी) वैकल्पिक घड़ी चक्र पर मल्टीप्लेक्स। 10 मेगाबिट/सेकंड मोड में, यह प्रत्येक 10 घड़ी चक्रों को वैकल्पिक करता है।  
| PHY to MAC
| पीएचवाई से मैक
|-
|-
| RX_ER
| टीएक्स_ईआर
| Receive error (optional on switches)   
| त्रुटि प्राप्त करें (स्विच पर वैकल्पिक)   
| PHY to MAC
| पीएचवाई से मैक
|-
|-
| MDIO  
| एमडीआईओ  
| Management data
| प्रबंधन डेटा
| Bidirectional
| द्विदिश
|-
|-
| MDC    
| एमडीसी    
| Management data clock.
| प्रबंधन डेटा clock.
| MAC to PHY
| मैक से  पीएचवाई
|}
|}
MDC और MDIO को कई PHYs के बीच साझा किया जा सकता है।
एमडीसी और एमडीआईओ को कई पीएचवाईs के बीच साझा किया जा सकता है।


रिसीवर सिग्नल REF_CLK को संदर्भित करते हैं, ट्रांसमीटर सिग्नल के समान।
रिसीवर सिग्नल REF_CLK को संदर्भित करते हैं, ट्रांसमीटर सिग्नल के समान।


इस इंटरफ़ेस को MII के 18 की तुलना में 9 संकेतों की आवश्यकता होती है। उन 9 में से, मल्टीपोर्ट उपकरणों पर, MDIO, MDC, और REF_CLK को प्रति पोर्ट 6 या 7 पिन छोड़कर साझा किया जा सकता है।
इस इंटरफ़ेस को MII के 18 की तुलना में 9 संकेतों की आवश्यकता होती है। उन 9 में से, मल्टीपोर्ट उपकरणों पर, एमडीआईओ, एमडीसी, और REF_CLK को प्रति पोर्ट 6 या 7 पिन छोड़कर साझा किया जा सकता है।


RMII की आवश्यकता है {{nowrap|50 MHz}} घड़ी जहां एमआईआई की आवश्यकता होती है {{nowrap|25 MHz}} क्लॉक और डेटा को एक समय में दो बिट बनाम MII के लिए एक समय में 4 बिट या SNI के लिए एक बार में 1 बिट (10 Mbit/s केवल) के लिए क्लॉक आउट किया जाता है। डेटा केवल राइजिंग एज पर सैंपल किया जाता है (यानी यह [[ दोहरे पम्प ]] नहीं है)।
आरएमआईआई की आवश्यकता है {{nowrap|50 MHz}} घड़ी जहां एमआईआई की आवश्यकता होती है {{nowrap|25 MHz}} क्लॉक और डेटा को एक समय में दो बिट बनाम MII के लिए एक समय में 4 बिट या SNI के लिए एक बार में 1 बिट (10 मेगाबिट/सेकंड  केवल) के लिए क्लॉक आउट किया जाता है। डेटा केवल राइजिंग एज पर सैंपल किया जाता है (यानी यह [[ दोहरे पम्प ]] नहीं है)।


REF_CLK दोनों में 50 मेगाहर्ट्ज पर संचालित होता है {{nowrap|100 Mbit/s}} मोड और {{nowrap|10 Mbit/s}} तरीका। संचारण पक्ष (पीएचवाई या मैक) को सभी संकेतों को 10 घड़ी चक्रों के लिए वैध रखना चाहिए {{nowrap|10 Mbit/s}} तरीका। रिसीवर (PHY या MAC) केवल हर दस चक्रों में इनपुट सिग्नल का नमूना लेता है {{nowrap|10 Mbit/s}} तरीका।
REF_CLK दोनों में 50 मेगाहर्ट्ज पर संचालित होता है {{nowrap|100 Mbit/s}} मोड और {{nowrap|10 Mbit/s}} तरीका। संचारण पक्ष (पीएचवाई या मैक) को सभी संकेतों को 10 घड़ी चक्रों के लिए वैध रखना चाहिए {{nowrap|10 Mbit/s}} तरीका। रिसीवर ( पीएचवाई या मैक) केवल हर दस चक्रों में इनपुट सिग्नल का नमूना लेता है {{nowrap|10 Mbit/s}} तरीका।


=== सीमाएं ===
=== सीमाएं ===
ऐसा कोई संकेत नहीं है जो परिभाषित करता है कि इंटरफ़ेस पूर्ण या आधा डुप्लेक्स मोड में है, लेकिन MAC और PHY दोनों को सहमत होने की आवश्यकता है। इसके बजाय इसे सीरियल MDIO/MDC इंटरफ़ेस पर संप्रेषित किया जाना चाहिए। ऐसा कोई संकेत भी नहीं है जो यह परिभाषित करता हो कि इंटरफ़ेस 10 या 100 Mbit/s मोड में है, इसलिए इसे भी MDIO/MDC इंटरफ़ेस का उपयोग करके नियंत्रित किया जाना चाहिए। RMII कंसोर्टियम विनिर्देश के संस्करण 1.2 में कहा गया है कि इसका MDIO/MDC इंटरफ़ेस IEEE 802.3u में MII के लिए निर्दिष्ट इंटरफ़ेस के समान है। IEEE 802.3 के वर्तमान संशोधन लिंक की गति और द्वैध मोड को बातचीत और कॉन्फ़िगर करने के लिए एक मानक MDIO/MDC तंत्र निर्दिष्ट करते हैं, लेकिन यह संभव है कि पुराने PHY उपकरणों को मानक के अप्रचलित संस्करणों के विरुद्ध डिज़ाइन किया गया हो, और इसलिए सेट करने के लिए मालिकाना तरीकों का उपयोग कर सकते हैं। गति और द्वैध।
ऐसा कोई संकेत नहीं है जो परिभाषित करता है कि इंटरफ़ेस पूर्ण या आधा डुप्लेक्स मोड में है, लेकिन मैक और पीएचवाई दोनों को सहमत होने की आवश्यकता है। इसके बजाय इसे सीरियल एमडीआईओ/एमडीसी इंटरफ़ेस पर संप्रेषित किया जाना चाहिए। ऐसा कोई संकेत भी नहीं है जो यह परिभाषित करता हो कि इंटरफ़ेस 10 या 100 मेगाबिट/सेकंड  मोड में है, इसलिए इसे भी एमडीआईओ/एमडीसी इंटरफ़ेस का उपयोग करके नियंत्रित किया जाना चाहिए। आरएमआईआई कंसोर्टियम विनिर्देश के संस्करण 1.2 में कहा गया है कि इसका एमडीआईओ/एमडीसी इंटरफ़ेस आई ई ई ई 802.3u में MII के लिए निर्दिष्ट इंटरफ़ेस के समान है। आई ई ई ई 802.3 के वर्तमान संशोधन लिंक की गति और द्वैध मोड को बातचीत और कॉन्फ़िगर करने के लिए एक मानक एमडीआईओ/एमडीसी तंत्र निर्दिष्ट करते हैं, लेकिन यह संभव है कि पुराने पीएचवाई उपकरणों को मानक के अप्रचलित संस्करणों के विरुद्ध डिज़ाइन किया गया हो, और इसलिए सेट करने के लिए मालिकाना तरीकों का उपयोग कर सकते हैं। गति और द्वैध।


RX_ER सिग्नल की कमी जो कुछ MACs (जैसे मल्टीपॉर्ट स्विच) पर कनेक्ट नहीं है, कुछ PHYs पर डेटा प्रतिस्थापन द्वारा चक्रीय अतिरेक जाँच को अमान्य करने के लिए निपटाया जाता है। गायब COL सिग्नल, TX_EN और डीकोड किए गए CRS सिग्नल को मिलाकर AND-ing से हाफ डुप्लेक्स मोड में CRS_DV लाइन से लिया गया है। इसका अर्थ है सीआरएस की परिभाषा में मामूली संशोधन: एमआईआई पर, आरएक्स और टीएक्स फ्रेम दोनों के लिए सीआरएस का दावा किया जाता है; RMII पर केवल Rx फ्रेम के लिए। इसका परिणाम यह है कि RMII पर दो त्रुटि स्थितियों में कोई वाहक और खोया वाहक नहीं पाया जा सकता है, और [[ 10BASE2 ]] या [[ 10BASE5 ]] जैसे साझा मीडिया का समर्थन करना मुश्किल या असंभव है।
टीएक्स_ईआर सिग्नल की कमी जो कुछ मैकs (जैसे मल्टीपॉर्ट स्विच) पर कनेक्ट नहीं है, कुछ पीएचवाईs पर डेटा प्रतिस्थापन द्वारा चक्रीय अतिरेक जाँच को अमान्य करने के लिए निपटाया जाता है। गायब सीओएल सिग्नल, टीएक्स_ईएन और डीकोड किए गए सीआरएस सिग्नल को मिलाकर AND-ing से हाफ डुप्लेक्स मोड में सीआरएस_DV लाइन से लिया गया है। इसका अर्थ है सीआरएस की परिभाषा में मामूली संशोधन: एमआईआई पर, आरएक्स और टीएक्स फ्रेम दोनों के लिए सीआरएस का दावा किया जाता है; आरएमआईआई पर केवल Rx फ्रेम के लिए। इसका परिणाम यह है कि आरएमआईआई पर दो त्रुटि स्थितियों में कोई वाहक और खोया वाहक नहीं पाया जा सकता है, और [[ 10BASE2 ]] या [[ 10BASE5 ]] जैसे साझा मीडिया का समर्थन करना मुश्किल या असंभव है।


चूंकि RMII मानक यह निर्धारित करने के लिए उपेक्षित है कि TX_EN को केवल वैकल्पिक घड़ी चक्रों पर नमूना लिया जाना चाहिए, यह CRS_DV के साथ सममित नहीं है और दो RMII PHY उपकरणों को एक पुनरावर्तक बनाने के लिए बैक टू बैक कनेक्ट नहीं किया जा सकता है; हालांकि, यह राष्ट्रीय DP83848 के साथ संभव है, जो RMII मोड में एक पूरक संकेत के रूप में डिकोड किए गए RX_DV की आपूर्ति करता है।<ref>[http://www.ti.com/lit/an/snla076a/snla076a.pdf AN-1405 schematic]</ref>
चूंकि आरएमआईआई मानक यह निर्धारित करने के लिए उपेक्षित है कि टीएक्स_ईएन को केवल वैकल्पिक घड़ी चक्रों पर नमूना लिया जाना चाहिए, यह सीआरएस_DV के साथ सममित नहीं है और दो आरएमआईआई  पीएचवाई उपकरणों को एक पुनरावर्तक बनाने के लिए बैक टू बैक कनेक्ट नहीं किया जा सकता है; हालांकि, यह राष्ट्रीय DP83848 के साथ संभव है, जो आरएमआईआई मोड में एक पूरक संकेत के रूप में डिकोड किए गए आरएक्स_डीवी की आपूर्ति करता है।<ref>[http://www.ti.com/lit/an/snla076a/snla076a.pdf AN-1405 schematic]</ref>




===सिग्नल स्तर===
===सिग्नल स्तर===
TTL [[ तर्क स्तर ]]ों का उपयोग किया जाता है {{nowrap|5 V}} या {{nowrap|3.3 V}} तर्क। इनपुट उच्च दहलीज है {{nowrap|2.0 V}} और कम है {{nowrap|0.8 V}}. विनिर्देश बताता है कि इनपुट होना चाहिए {{nowrap|5 V}} सहिष्णु, हालांकि, RMII इंटरफेस वाले कुछ लोकप्रिय चिप्स नहीं हैं {{nowrap|5 V}} सहिष्णु। नए उपकरण समर्थन कर सकते हैं {{nowrap|2.5 V}} और {{nowrap|1.8 V}} तर्क।
TTL [[ तर्क स्तर ]]ों का उपयोग किया जाता है {{nowrap|5 V}} या {{nowrap|3.3 V}} तर्क। इनपुट उच्च दहलीज है {{nowrap|2.0 V}} और कम है {{nowrap|0.8 V}}. विनिर्देश बताता है कि इनपुट होना चाहिए {{nowrap|5 V}} सहिष्णु, हालांकि, आरएमआईआई इंटरफेस वाले कुछ लोकप्रिय चिप्स नहीं हैं {{nowrap|5 V}} सहिष्णु। नए उपकरण समर्थन कर सकते हैं {{nowrap|2.5 V}} और {{nowrap|1.8 V}} तर्क।


RMII संकेतों को पारेषण लाइनों के बजाय [[ गांठ-तत्व मॉडल ]] के रूप में माना जाता है। हालाँकि, संबंधित MII मानक का IEEE संस्करण निर्दिष्ट करता है {{nowrap|68 Ω}} ट्रेस प्रतिबाधा।<ref name="AN-1469">[http://www.ti.com/lit/an/snla079d/snla079d.pdf AN-1469 datasheet]</ref> राष्ट्रीय दौड़ने की सलाह देते हैं {{nowrap|50 Ω}} के साथ निशान {{nowrap|33 Ω}} प्रतिबिंबों को कम करने के लिए या तो MII या RMII मोड के लिए [[ श्रृंखला समाप्ति ]] प्रतिरोध।{{Citation needed|date=November 2011}} राष्ट्रीय भी सुझाव देता है कि निशान के तहत रखा जाना चाहिए {{nowrap|0.15 m}} लंबा और भीतर मेल खाता है {{nowrap|0.05 m}} तिरछा कम करने के लिए लंबाई पर।<ref name="AN-1469"/>{{rp|5}}
आरएमआईआई संकेतों को पारेषण लाइनों के बजाय [[ गांठ-तत्व मॉडल ]] के रूप में माना जाता है। हालाँकि, संबंधित MII मानक का आई ई ई ई संस्करण निर्दिष्ट करता है {{nowrap|68 Ω}} ट्रेस प्रतिबाधा।<ref name="AN-1469">[http://www.ti.com/lit/an/snla079d/snla079d.pdf AN-1469 datasheet]</ref> राष्ट्रीय दौड़ने की सलाह देते हैं {{nowrap|50 Ω}} के साथ निशान {{nowrap|33 Ω}} प्रतिबिंबों को कम करने के लिए या तो MII या आरएमआईआई मोड के लिए [[ श्रृंखला समाप्ति ]] प्रतिरोध।{{Citation needed|date=November 2011}} राष्ट्रीय भी सुझाव देता है कि निशान के तहत रखा जाना चाहिए {{nowrap|0.15 m}} लंबा और भीतर मेल खाता है {{nowrap|0.05 m}} तिरछा कम करने के लिए लंबाई पर।<ref name="AN-1469"/>{{rp|5}}




==गीगाबिट मीडिया-स्वतंत्र इंटरफ़ेस ==
==गीगाबिट मीडिया-स्वतंत्र इंटरफ़ेस ==
गीगाबिट मीडिया-स्वतंत्र इंटरफ़ेस (GMII) [[ मध्यम अभिगम नियंत्रण ]] (MAC) डिवाइस और भौतिक परत ([[ PHY ]]) के बीच एक इंटरफ़ेस है। इंटरफ़ेस 1000 Mbit/s तक की गति पर संचालित होता है, जिसे प्राप्त करने और संचारित करने के लिए अलग-अलग आठ-बिट डेटा पथ के साथ 125 मेगाहर्ट्ज पर क्लॉक किए गए डेटा इंटरफ़ेस का उपयोग करके कार्यान्वित किया जाता है, और MII विनिर्देश के साथ पीछे की ओर संगत है और निम्न-बैक गति पर काम कर सकता है 10 या 100 एमबीटी/एस।
गीगाबिट मीडिया-स्वतंत्र इंटरफ़ेस (जीएमआईआई) [[ मध्यम अभिगम नियंत्रण ]] (मैक) डिवाइस और भौतिक परत ([[ PHY |  पीएचवाई]] ) के बीच एक इंटरफ़ेस है। इंटरफ़ेस 1000 मेगाबिट/सेकंड  तक की गति पर संचालित होता है, जिसे प्राप्त करने और संचारित करने के लिए अलग-अलग आठ-बिट डेटा पथ के साथ 125 मेगाहर्ट्ज पर क्लॉक किए गए डेटा इंटरफ़ेस का उपयोग करके कार्यान्वित किया जाता है, और MII विनिर्देश के साथ पीछे की ओर संगत है और निम्न-बैक गति पर काम कर सकता है 10 या 100 एमबीटी/एस।


GMII इंटरफ़ेस को पहले IEEE 802.3z-1998 में 1000BASE-X के लिए खंड 35 के रूप में परिभाषित किया गया था, और बाद में IEEE 802.3-2000 में शामिल किया गया।<ref name="802.3">{{cite book|title=ईथरनेट के लिए IEEE मानक|publisher=IEEE 802.3|date=31 August 2018|doi=10.1109/IEEESTD.2018.8457469|isbn=978-1-5044-5090-4}}</ref>{{rp|at=Clause 35}}
जीएमआईआई इंटरफ़ेस को पहले आई ई ई ई 802.3z-1998 में 1000BASE-X के लिए खंड 35 के रूप में परिभाषित किया गया था, और बाद में आई ई ई ई 802.3-2000 में शामिल किया गया।<ref name="802.3">{{cite book|title=ईथरनेट के लिए IEEE मानक|publisher=IEEE 802.3|date=31 August 2018|doi=10.1109/IEEESTD.2018.8457469|isbn=978-1-5044-5090-4}}</ref>{{rp|at=Clause 35}}




Line 275: Line 275:
! Description
! Description
|-
|-
| GTXCLK
| G टीएक्ससीएलके
| Clock signal for gigabit TX signals (125&nbsp;MHz)
| Clock signal for gigabit TX signals (125&nbsp;मेगाहर्ट्ज)
|-
|-
| TXCLK
| टीएक्ससीएलके
| Clock signal for 10/100&nbsp;Mbit/s signals
| Clock signal for 10/100&nbsp;मेगाबिट/सेकंड  signals
|-
|-
| TXD[7..0]
| टीएक्सडी[7..0]
| Data to be transmitted
| Data से be transmitted
|-
|-
| TXEN
| TXEN
Line 288: Line 288:
|-
|-
| TXER
| TXER
| Transmitter error (used to intentionally corrupt a packet, if necessary)
| Transmitter error (used से intentionally corrupt a packet, if necessary)
|}
|}
दो ट्रांसमीटर घड़ियां हैं। उपयोग की जाने वाली घड़ी इस बात पर निर्भर करती है कि PHY gigabit पर काम कर रहा है या 10/100 Mbit/s की गति पर। गीगाबिट ऑपरेशन के लिए, GTXCLK को PHY को आपूर्ति की जाती है और TXD, TXEN, TXER सिग्नल इसके लिए सिंक्रनाइज़ किए जाते हैं। 10 या 100 Mbit/s ऑपरेशन के लिए, TXCLK की आपूर्ति PHY द्वारा की जाती है और उन संकेतों को सिंक्रनाइज़ करने के लिए उपयोग किया जाता है। यह 100 Mbit/s के लिए 25 MHz या 10 Mbit/s कनेक्शन के लिए 2.5 MHz पर संचालित होता है। इसके विपरीत, रिसीवर आने वाले डेटा से पुनर्प्राप्त एकल घड़ी संकेत का उपयोग करता है।
दो ट्रांसमीटर घड़ियां हैं। उपयोग की जाने वाली घड़ी इस बात पर निर्भर करती है कि पीएचवाई gigabit पर काम कर रहा है या 10/100 मेगाबिट/सेकंड  की गति पर। गीगाबिट ऑपरेशन के लिए, G टीएक्ससीएलके को पीएचवाई को आपूर्ति की जाती है और टीएक्सडी, TXEN, TXER सिग्नल इसके लिए सिंक्रनाइज़ किए जाते हैं। 10 या 100 मेगाबिट/सेकंड  ऑपरेशन के लिए, टीएक्ससीएलके की आपूर्ति पीएचवाई द्वारा की जाती है और उन संकेतों को सिंक्रनाइज़ करने के लिए उपयोग किया जाता है। यह 100 मेगाबिट/सेकंड  के लिए 25 मेगाहर्ट्ज या 10 मेगाबिट/सेकंड  कनेक्शन के लिए 2.5 मेगाहर्ट्ज पर संचालित होता है। इसके विपरीत, रिसीवर आने वाले डेटा से पुनर्प्राप्त एकल घड़ी संकेत का उपयोग करता है।


===रिसीवर सिग्नल ===
===रिसीवर सिग्नल ===
Line 310: Line 310:
| Signifies data received has errors
| Signifies data received has errors
|-
|-
| COL
| सीओएल
| Collision detect (half-duplex connections only)
| सीओएलlision detect (half-duplex connections only)
|-
|-
| CS
| CS
Line 324: Line 324:
! Description
! Description
|-
|-
| MDC
| एमडीसी
| Management interface clock
| Management interface clock
|-
|-
| [[MDIO]]
| [[MDIO|एमडीआईओ]]
| Management interface I/O bidirectional pin.
| Management interface I/O bidirectional pin.
|}
|}
प्रबंधन इंटरफ़ेस PHY के व्यवहार को नियंत्रित करता है। इसमें MII के समान रजिस्टरों का सेट है, सिवाय इसके कि रजिस्टर #15 विस्तारित स्थिति रजिस्टर है।<ref name="802.3" />{{rp|at=Section 22.2.4 "Management functions"}}
प्रबंधन इंटरफ़ेस पीएचवाई के व्यवहार को नियंत्रित करता है। इसमें MII के समान रजिस्टरों का सेट है, सिवाय इसके कि रजिस्टर #15 विस्तारित स्थिति रजिस्टर है।<ref name="802.3" />{{rp|at=Section 22.2.4 "Management functions"}}




==कम गीगाबिट मीडिया-स्वतंत्र इंटरफ़ेस ==
==कम गीगाबिट मीडिया-स्वतंत्र इंटरफ़ेस ==
{| class="wikitable floatright"
{| class="wikitable floatright"
|+ Supported Ethernet speeds
|+ Supported ईथरनेट speeds
|-  
|-  
! &#91;Mbit/s&#93; !! &#91;[[Hertz|MHz]]&#93; !! Bits/clock cycle
! &#91;मेगाबिट/सेकंड &#93; !! &#91;[[Hertz|मेगाहर्ट्ज]]&#93; !! Bits/clock cycle
|-
|-
|align=right|  10  
|align=right|  10  
Line 353: Line 353:
कम गीगाबिट मीडिया-स्वतंत्र इंटरफ़ेस (आरजीएमआईआई) जीएमआईआई इंटरफ़ेस में उपयोग किए जाने वाले डेटा पिनों की आधी संख्या का उपयोग करता है। यह कमी दोगुनी गति, समय बहुसंकेतन संकेतों और गैर-आवश्यक वाहक-भावना और टक्कर-संकेत संकेतों को समाप्त करके आधे से अधिक डेटा लाइनों को चलाकर प्राप्त की जाती है। इस प्रकार आरजीएमआईआई में जीएमआईआई के 24 से 27 के विपरीत केवल 14 पिन होते हैं।
कम गीगाबिट मीडिया-स्वतंत्र इंटरफ़ेस (आरजीएमआईआई) जीएमआईआई इंटरफ़ेस में उपयोग किए जाने वाले डेटा पिनों की आधी संख्या का उपयोग करता है। यह कमी दोगुनी गति, समय बहुसंकेतन संकेतों और गैर-आवश्यक वाहक-भावना और टक्कर-संकेत संकेतों को समाप्त करके आधे से अधिक डेटा लाइनों को चलाकर प्राप्त की जाती है। इस प्रकार आरजीएमआईआई में जीएमआईआई के 24 से 27 के विपरीत केवल 14 पिन होते हैं।


डेटा 1000 Mbit/s के लिए बढ़ते और गिरते किनारों पर और केवल 10/100 Mbit/s के लिए बढ़ते किनारों पर देखा जाता है।<ref>{{cite web
डेटा 1000 मेगाबिट/सेकंड  के लिए बढ़ते और गिरते किनारों पर और केवल 10/100 मेगाबिट/सेकंड  के लिए बढ़ते किनारों पर देखा जाता है।<ref>{{cite web
  |title=रिड्यूस्ड गिगाबिट मीडिया इंडिपेंडेंट इंटरफेस (आरजीएमआईआई) वर्जन 2.0|date=2002-04-01  
  |title=रिड्यूस्ड गिगाबिट मीडिया इंडिपेंडेंट इंटरफेस (आरजीएमआईआई) वर्जन 2.0|date=2002-04-01  
  |url=http://www.hp.com/rnd/pdfs/RGMIIv2_0_final_hp.pdf  
  |url=http://www.hp.com/rnd/pdfs/RGMIIv2_0_final_hp.pdf  
Line 359: Line 359:
  |archive-url=https://web.archive.org/web/20160303171328/http://www.hp.com/rnd/pdfs/RGMIIv2_0_final_hp.pdf  
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  |archive-date=2016-03-03  
  |archive-date=2016-03-03  
}}</ref> RX_CTL सिग्नल बढ़ते किनारे पर RXDV (डेटा मान्य) और गिरने वाले किनारे पर (RXDV xor RXER) ले जाता है। TX_CTL सिग्नल इसी तरह TXEN को बढ़ते किनारे पर और (TXEN xor TXER) को गिरने वाले किनारे पर ले जाता है। यह मामला 1000 Mbit/s और 10/100 Mbit/s दोनों का है।<ref>{{cite web
}}</ref> RX_CTL सिग्नल बढ़ते किनारे पर RXDV (डेटा मान्य) और गिरने वाले किनारे पर (RXDV xor RXER) ले जाता है। TX_CTL सिग्नल इसी तरह TXEN को बढ़ते किनारे पर और (TXEN xor TXER) को गिरने वाले किनारे पर ले जाता है। यह मामला 1000 मेगाबिट/सेकंड  और 10/100 मेगाबिट/सेकंड  दोनों का है।<ref>{{cite web
| title=एक्सवे PHY11G| url=http://www.we-online.de/web/en/index.php/show/media/07_electronic_components/produkte_3/lantiq/Data_Sheet_XWAY_PHY11G_V15_UM_HD_Rev10_VQFN48.pdf
| title=एक्सवे PHY11G| url=http://www.we-online.de/web/en/index.php/show/media/07_electronic_components/produkte_3/lantiq/Data_Sheet_XWAY_PHY11G_V15_UM_HD_Rev10_VQFN48.pdf
| access-date=2014-04-11
| access-date=2014-04-11
Line 366: Line 366:
| url-status=dead
| url-status=dead
}}</ref>
}}</ref>
ट्रांसमिट क्लॉक सिग्नल हमेशा MAC द्वारा TXC लाइन पर प्रदान किया जाता है। प्राप्त घड़ी संकेत हमेशा PHY द्वारा RXC लाइन पर प्रदान किया जाता है।{{citation needed|date=August 2020|reason=[[Talk:Media-independent interface#Citation request for "The receive clock signal is always provided by the PHY on the RXC line."]]}} [[ स्रोत-तुल्यकालिक ]] क्लॉकिंग का उपयोग किया जाता है: क्लॉक सिग्नल जो आउटपुट होता है (या तो PHY या MAC द्वारा) डेटा सिग्नल के साथ सिंक्रोनस होता है। इसके लिए पीसीबी को इस तरह डिजाइन किया जाना चाहिए कि वह घड़ी के सिग्नल में 1.5–2 एनएस देरी जोड़ दे ताकि सिंक पर सेटअप और होल्ड समय पूरा हो सके। RGMII v2.0 एक वैकल्पिक आंतरिक विलंब निर्दिष्ट करता है, जिससे पीसीबी डिज़ाइनर को विलंब जोड़ने की आवश्यकता नहीं होती है; इसे आरजीएमआईआई-आईडी के नाम से जाना जाता है।
ट्रांसमिट क्लॉक सिग्नल हमेशा मैक द्वारा TXC लाइन पर प्रदान किया जाता है। प्राप्त घड़ी संकेत हमेशा पीएचवाई द्वारा RXC लाइन पर प्रदान किया जाता है।{{citation needed|date=August 2020|reason=[[Talk:Media-independent interface#Citation request for "The receive clock signal is always provided by the PHY on the RXC line."]]}} [[ स्रोत-तुल्यकालिक ]] क्लॉकिंग का उपयोग किया जाता है: क्लॉक सिग्नल जो आउटपुट होता है (या तो पीएचवाई या मैक द्वारा) डेटा सिग्नल के साथ सिंक्रोनस होता है। इसके लिए पीसीबी को इस तरह डिजाइन किया जाना चाहिए कि वह घड़ी के सिग्नल में 1.5–2 एनएस देरी जोड़ दे ताकि सिंक पर सेटअप और होल्ड समय पूरा हो सके। Rजीएमआईआई v2.0 एक वैकल्पिक आंतरिक विलंब निर्दिष्ट करता है, जिससे पीसीबी डिज़ाइनर को विलंब जोड़ने की आवश्यकता नहीं होती है; इसे आरजीएमआईआई-आईडी के नाम से जाना जाता है।


{| class="wikitable"
{| class="wikitable"
|+ RGMII signals
|+ Rजीएमआईआई signals
! Signal name
! Signal name
! Description
! Description
Line 376: Line 376:
| TXC
| TXC
| Clock signal
| Clock signal
| MAC to PHY
| मैक से  पीएचवाई
|-
|-
| TXD[3..0]
| टीएक्सडी[3..0]
| Data to be transmitted  
| Data से be transmitted  
| MAC to PHY
| मैक से  पीएचवाई
|-
|-
| TX_CTL
| TX_CTL
| Multiplexing of transmitter enable and transmitter error  
| Multiplexing of transmitter enable and transmitter error  
| MAC to PHY
| मैक से  पीएचवाई
|-
|-
| RXC
| RXC
| Received [[clock signal]] (recovered from incoming received data)
| Received [[clock signal]] (recovered from incoming received data)
| PHY to MAC
| पीएचवाई से मैक
|-
|-
| RXD[3..0]
| RXD[3..0]
| Received data
| Received data
| PHY to MAC
| पीएचवाई से मैक
|-
|-
| RX_CTL
| RX_CTL
| Multiplexing of data received is valid and receiver error  
| Multiplexing of data received is valid and receiver error  
| PHY to MAC
| पीएचवाई से मैक
|-
|-
| MDC
| एमडीसी
| Management interface clock
| Management interface clock
| MAC to PHY
| मैक से  पीएचवाई
|-
|-
| [[MDIO]]
| [[MDIO|एमडीआईओ]]
| Management interface I/O
| Management interface I/O
| Bidirectional
| Bidirectional
Line 415: Line 415:
| title=2.5 V ± 0.2 V (सामान्य रेंज) और 1.8 V - 2.7 V (वाइड रेंज) पावर सप्लाई वोल्टेज और नॉन-टर्मिनेटेड डिजिटल इंटीग्रेटेड सर्किट के लिए इंटरफेस स्टैंडर्ड, JESD8-5A.01| date=2006-06-01
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}}</ref> जबकि RGMII संस्करण 2 1.5V [[ उच्च गति ट्रांसीवर तर्क ]] का उपयोग करता है।<ref>{{cite web
}}</ref> जबकि Rजीएमआईआई संस्करण 2 1.5V [[ उच्च गति ट्रांसीवर तर्क ]] का उपयोग करता है।<ref>{{cite web
| title=हाई स्पीड ट्रांसीवर लॉजिक (HSTL)। डिजिटल इंटीग्रेटेड सर्किट के लिए 1.5V आउटपुट बफर सप्लाई वोल्टेज आधारित इंटरफेस मानक, JESD8-6| date=1995-08-01
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सीरियल गिगाबिट मीडिया-इंडिपेंडेंट इंटरफ़ेस (एसजीएमआईआई) [[ गीगाबिट ईथरनेट ]] के लिए उपयोग किए जाने वाले एमआईआई का एक प्रकार है, लेकिन यह 10/100 एमबीटी/एस ईथरनेट भी ले जा सकता है।
सीरियल गिगाबिट मीडिया-इंडिपेंडेंट इंटरफ़ेस (एसजीएमआईआई) [[ गीगाबिट ईथरनेट ]] के लिए उपयोग किए जाने वाले एमआईआई का एक प्रकार है, लेकिन यह 10/100 एमबीटी/एस ईथरनेट भी ले जा सकता है।


यह TX और RX डेटा और TX और RX घड़ियों के लिए 625 मेगाहर्ट्ज क्लॉक फ्रीक्वेंसी DDR पर डिफरेंशियल जोड़े का उपयोग करता है। यह [[ गीगाबिट मीडिया स्वतंत्र इंटरफ़ेस ]] से इसकी निम्न-शक्ति और निम्न पिन-काउंट 8b/10b एन्कोडिंग|8b/10b-कोडेड [[ SerDes ]] द्वारा भिन्न है। संचारित और प्राप्त पथ प्रत्येक डेटा के लिए एक अंतर जोड़ी और घड़ी के लिए एक और अंतर जोड़ी का उपयोग करता है। TX/RX घड़ियों को डिवाइस आउटपुट पर जेनरेट किया जाना चाहिए लेकिन डिवाइस इनपुट पर वैकल्पिक है (घड़ी [[ घड़ी की वसूली ]] को वैकल्पिक रूप से इस्तेमाल किया जा सकता है)। 10/100 Mbit/s ईथरनेट डेटा शब्दों को 100/10 बार डुप्लिकेट करके ले जाया जाता है, इसलिए घड़ी हमेशा 625 MHz पर होती है।
यह TX और RX डेटा और TX और RX घड़ियों के लिए 625 मेगाहर्ट्ज क्लॉक फ्रीक्वेंसी DDR पर डिफरेंशियल जोड़े का उपयोग करता है। यह [[ गीगाबिट मीडिया स्वतंत्र इंटरफ़ेस ]] से इसकी निम्न-शक्ति और निम्न पिन-काउंट 8b/10b एन्कोडिंग|8b/10b-कोडेड [[ SerDes ]] द्वारा भिन्न है। संचारित और प्राप्त पथ प्रत्येक डेटा के लिए एक अंतर जोड़ी और घड़ी के लिए एक और अंतर जोड़ी का उपयोग करता है। TX/RX घड़ियों को डिवाइस आउटपुट पर जेनरेट किया जाना चाहिए लेकिन डिवाइस इनपुट पर वैकल्पिक है (घड़ी [[ घड़ी की वसूली ]] को वैकल्पिक रूप से इस्तेमाल किया जा सकता है)। 10/100 मेगाबिट/सेकंड  ईथरनेट डेटा शब्दों को 100/10 बार डुप्लिकेट करके ले जाया जाता है, इसलिए घड़ी हमेशा 625 मेगाहर्ट्ज पर होती है।


==उच्च सीरियल गीगाबिट मीडिया स्वतंत्र इंटरफ़ेस ==
==उच्च सीरियल गीगाबिट मीडिया स्वतंत्र इंटरफ़ेस ==
उच्च सीरियल गीगाबिट मीडिया-स्वतंत्र इंटरफ़ेस (HSGMII) कार्यात्मक रूप से SGMII के समान है लेकिन 2.5 Gbit/s तक की लिंक गति का समर्थन करता है।
उच्च सीरियल गीगाबिट मीडिया-स्वतंत्र इंटरफ़ेस (एचएसजीएमआईआई) कार्यात्मक रूप से Sजीएमआईआई के समान है लेकिन 2.5 Gbit/s तक की लिंक गति का समर्थन करता है।


==क्वाड सीरियल गीगाबिट मीडिया-स्वतंत्र इंटरफ़ेस ==
==क्वाड सीरियल गीगाबिट मीडिया-स्वतंत्र इंटरफ़ेस ==
क्वाड सीरियल गीगाबिट मीडिया-स्वतंत्र इंटरफ़ेस (QSGMII) चार SGMII लाइनों को 5 Gbit/s इंटरफ़ेस में संयोजित करने की एक विधि है। QSGMII, SGMII की तरह, TX और RX डेटा के लिए [[ कम वोल्टेज अंतर सिग्नलिंग ]] (LVDS) और सिंगल LVDS क्लॉक सिग्नल का उपयोग करता है। QSGMII चार अलग SGMII कनेक्शनों की तुलना में काफी कम सिग्नल लाइनों का उपयोग करता है।
क्वाड सीरियल गीगाबिट मीडिया-स्वतंत्र इंटरफ़ेस ( क्यूएसजीएमआईआई) चार Sजीएमआईआई लाइनों को 5 Gbit/s इंटरफ़ेस में संयोजित करने की एक विधि है। क्यूएसजीएमआईआई, Sजीएमआईआई की तरह, TX और RX डेटा के लिए [[ कम वोल्टेज अंतर सिग्नलिंग ]] (LVDS) और सिंगल LVDS क्लॉक सिग्नल का उपयोग करता है। क्यूएसजीएमआईआई चार अलग Sजीएमआईआई कनेक्शनों की तुलना में काफी कम सिग्नल लाइनों का उपयोग करता है।


==10 गीगाबिट मीडिया-स्वतंत्र इंटरफ़ेस ==
==10 गीगाबिट मीडिया-स्वतंत्र इंटरफ़ेस ==
10 गीगाबिट मीडिया-स्वतंत्र इंटरफ़ेस (XGMII) IEEE 802.3 में परिभाषित एक मानक है जिसे एक मुद्रित सर्किट बोर्ड (PCB) पर पूर्ण डुप्लेक्स [[ 10 गीगाबिट ईथरनेट ]] (10GbE) पोर्ट को एक दूसरे से और अन्य इलेक्ट्रॉनिक उपकरणों से जोड़ने के लिए डिज़ाइन किया गया है। यह अब आम तौर पर ऑन-चिप कनेक्शन के लिए उपयोग किया जाता है। पीसीबी कनेक्शन अब ज्यादातर [[ XAUI ]] के साथ संपन्न होते हैं। XGMII में दो 32-बिट डेटापथ (Rx और Tx) और दो चार-बिट नियंत्रण प्रवाह (Rxc और Txc) हैं, जो 156.25 मेगाहर्ट्ज डबल डेटा दर (312.5 ट्रांसफर (कंप्यूटिंग)|MT/s) पर काम कर रहे हैं।
10 गीगाबिट मीडिया-स्वतंत्र इंटरफ़ेस (Xजीएमआईआई) आई ई ई ई 802.3 में परिभाषित एक मानक है जिसे एक मुद्रित सर्किट बोर्ड (PCB) पर पूर्ण डुप्लेक्स [[ 10 गीगाबिट ईथरनेट ]] (10GbE) पोर्ट को एक दूसरे से और अन्य इलेक्ट्रॉनिक उपकरणों से जोड़ने के लिए डिज़ाइन किया गया है। यह अब आम तौर पर ऑन-चिप कनेक्शन के लिए उपयोग किया जाता है। पीसीबी कनेक्शन अब ज्यादातर [[ XAUI ]] के साथ संपन्न होते हैं। Xजीएमआईआई में दो 32-बिट डेटापथ (Rx और Tx) और दो चार-बिट नियंत्रण प्रवाह (Rxc और Txc) हैं, जो 156.25 मेगाहर्ट्ज डबल डेटा दर (312.5 ट्रांसफर (कंप्यूटिंग)|MT/s) पर काम कर रहे हैं।


== यह भी देखें ==
== यह भी देखें ==
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==बाहरी कड़ियाँ==
==बाहरी कड़ियाँ==
* [http://www.ti.com/lit/an/snla076a/snla076a.pdf Texas Instruments{{snd}} AN-1405 DP83848 RMII]
* [http://www.ti.com/lit/an/snla076a/snla076a.pdf Texas Instruments{{snd}} AN-1405 DP83848 आरएमआईआई]
* [http://www.ti.com.cn/cn/lit/ds/symlink/dp83848c.pdf Texas Instruments{{snd}} DP83848C PHY Data Sheet]
* [http://www.ti.com.cn/cn/lit/ds/symlink/dp83848c.pdf Texas Instruments{{snd}} DP83848C पीएचवाई Data Sheet]
* [https://web.archive.org/web/20160303171328/http://www.hp.com/rnd/pdfs/RGMIIv2_0_final_hp.pdf hp.com{{snd}} RGMIIv2_0_final_hp.pdf RGMII 2002-04-01 Version 2.0 ]
* [https://web.archive.org/web/20160303171328/http://www.hp.com/rnd/pdfs/RGMIIv2_0_final_hp.pdf hp.com{{snd}} Rजीएमआईआईv2_0_final_hp.pdf Rजीएमआईआई 2002-04-01 Version 2.0]
* {{citation|url=http://www.angelfire.com/electronic2/sharads/protocols/MII_Protocols/sgmii.pdf |title=Serial-GMII Specification Revision 1.7 (ENG-46158) |archive-url=https://web.archive.org/web/20150714164353/http://www.angelfire.com/electronic2/sharads/protocols/MII_Protocols/sgmii.pdf |archive-date=2015-07-14 |url-status=dead }}
* {{citation|url=http://www.angelfire.com/electronic2/sharads/protocols/MII_Protocols/sgmii.pdf |title=Serial-GMII Specification Revision 1.7 (ENG-46158) |archive-url=https://web.archive.org/web/20150714164353/http://www.angelfire.com/electronic2/sharads/protocols/MII_Protocols/sgmii.pdf |archive-date=2015-07-14 |url-status=dead }}
* {{cite web |url=http://www.parthus.com/products/platforms/sgmii.php |title=CEVA implementation documentation |archive-url=https://web.archive.org/web/20061211171613/http://www.parthus.com/products/platforms/sgmii.php |archive-date=2006-12-11}}
* {{cite web |url=http://www.parthus.com/products/platforms/sgmii.php |title=CEVA implementation documentation |archive-url=https://web.archive.org/web/20061211171613/http://www.parthus.com/products/platforms/sgmii.php |archive-date=2006-12-11}}
* [https://web.archive.org/web/20110903061926/http://www.altera.com/support/refdesigns/ip/interface/ref-10gbe.html Altera 10Gb Ethernet IP with XGMII and XAUI interfaces ]
* [https://web.archive.org/web/20110903061926/http://www.altera.com/support/refdesigns/ip/interface/ref-10gbe.html Altera 10Gb ईथरनेट IP with Xजीएमआईआई and XAUI interfaces]
* [http://www.ieee802.org/3/z/public/presentations/nov1996/AIgmitim.pdf GMII Timing and Electrical Specification ]
* [http://www.ieee802.org/3/z/public/presentations/nov1996/AIgmitim.pdf जीएमआईआई Timing and Electrical Specification]


{{Ethernet}}
{{Ethernet}}

Revision as of 11:53, 11 January 2023

MII कनेक्टर पर a Sun Ultra 1 निर्माता कार्य केंद्र

मीडिया-स्वतंत्र इंटरफ़ेस (एमआईआई) को मूल रूप से तेज़ ईथरनेट (यानी,) को जोड़ने के लिए एक मानक इंटरफ़ेस के रूप में परिभाषित किया गया था (100 एमबीटी/एस) मीडिया अभिगम नियंत्रण (मैक) एक पीएचवाई ईथरनेट भौतिक ट्रांसीवर के लिए ब्लॉक करता है। एमआईआई को आई ई ई ई 802.3u द्वारा मानकीकृत किया गया है और विभिन्न प्रकार के पीएचवाई एस को मैको से जोड़ता है। मीडिया स्वतंत्र होने का मतलब है कि अलग-अलग मीडिया से कनेक्ट करने के लिए विभिन्न प्रकार के पीएचवाई डिवाइस (यानी मुड़ जोड़ी पर ईथरनेट , फाइबर ऑप्टिक , आदि) का उपयोग मैक हार्डवेयर को फिर से डिजाइन या बदले बिना किया जा सकता है। इस प्रकार किसी भी मैक का उपयोग किसी भी पीएचवाई के साथ किया जा सकता है, जो नेटवर्क सिग्नल ट्रांसमिशन मीडिया से स्वतंत्र है।

एमआईआई का उपयोग प्लगेबल कनेक्टर का उपयोग करके मैक को बाहरी पीएचवाई से कनेक्ट करने के लिए या सीधे उसी मुद्रित सर्किट बोर्ड पर पीएचवाई चिप से कनेक्ट करने के लिए किया जा सकता है। एक पीसी पर संचार और नेटवर्किंग राइजर टाइप बी में एमआईआई सिग्नल होते हैं।

इंटरफ़ेस पर नेटवर्क डेटा आई ई ई ई ईथरनेट मानक का उपयोग कर ईथरनेट फ्रेम है। जैसे कि इसमें एक प्रस्तावना, स्टार्ट फ्रेम डिलीमीटर, ईथरनेट हेडर, प्रोटोकॉल-विशिष्ट डेटा और चक्रीय अतिरेक की जाँच (सीआरसी) शामिल हैं। मूल एमआईआई प्रत्येक दिशा में 4-बिट कुतरना ्स का उपयोग करके नेटवर्क डेटा स्थानांतरित करता है (4 डेटा बिट्स संचारित करता है, 4 डेटा बिट्स प्राप्त करता है)। 100 एमबीटी/एस थ्रूपुट प्राप्त करने के लिए डेटा को 25 मेगाहर्ट्ज पर क्लॉक किया जाता है। कम संकेतों और बढ़ी हुई गति का समर्थन करने के लिए मूल MII डिज़ाइन को बढ़ाया गया है। वर्तमान वेरिएंट में शामिल हैं:

  • #आरएमआईआई|कम मीडिया-स्वतंत्र इंटरफ़ेस ('आरएमआईआई')
  • #जीएमआईआई|गीगाबिट मीडिया-स्वतंत्र इंटरफ़ेस ('जीएमआईआई')
  • #आरजीएमआईआई|कम गीगाबिट मीडिया-स्वतंत्र इंटरफ़ेस ('आरजीएमआईआई')
  • सीरियल मीडिया-स्वतंत्र इंटरफ़ेस ('एसएमआईआई')[1]
  • #एसजीएमआईआई|सीरियल गिगाबिट मीडिया-स्वतंत्र इंटरफ़ेस (सीरियल जीएमआईआई, एसजीएमआईआई)
  • #एचएसजीएमआईआई|उच्च सीरियल गीगाबिट मीडिया-स्वतंत्र इंटरफ़ेस (एचएसजीएमआईआई)
  • # क्यूएसजीएमआईआई क्वाड सीरियल गीगाबिट मीडिया-स्वतंत्र इंटरफ़ेस ( क्यूएसजीएमआईआई)
  • #Xजीएमआईआई|10-गीगाबिट मीडिया-स्वतंत्र इंटरफ़ेस (एक्सजीएमआईआई)

प्रबंधन डेटा इनपुट/आउटपुट (एमडीआईओ) सीरियल बस एमआईआई का एक सबसेट है जिसका उपयोग मैक और पीएचवाई के बीच प्रबंधन जानकारी स्थानांतरित करने के लिए किया जाता है। पावर अप पर, स्वतंत्र समझौता का उपयोग करते हुए, पीएचवाई आमतौर पर इससे जुड़ा होता है, जब तक कि सेटिंग्स को एमडीआईओ इंटरफ़ेस के माध्यम से बदल नहीं दिया जाता है।

मानक एमआईआई

मानक एमआईआई में रजिस्टरों का एक छोटा सा सेट है:[2]: Section 22.2.4 "Management functions" 

  • मूल मोड कॉन्फ़िगरेशन (#0)
  • स्थिति शब्द (#1)
  • पीएचवाई पहचानकर्ता (#2, #3)
  • ऑटो-बातचीत विज्ञापन (#4)
  • ऑटो-नेगोशिएशन लिंक पार्टनर बेस पेज एबिलिटी (#5)
  • ऑटो-बातचीत विस्तार (#6)
  • ऑटो-नेगोशिएशन नेक्स्ट पेज ट्रांसमिट (#7)
  • ऑटो-नेगोशिएशन लिंक पार्टनर ने अगला पेज प्राप्त किया (#8)
  • मास्टर-स्लेव कंट्रोल रजिस्टर (#9)
  • मास्टर-स्लेव स्थिति रजिस्टर (#10)
  • पीएसई कंट्रोल रजिस्टर (#11)
  • पीएसई स्थिति रजिस्टर (#12)
  • एमएमडी एक्सेस कंट्रोल रजिस्टर (#13)
  • एमएमडी एक्सेस एड्रेस डेटा रजिस्टर (#14)

रजिस्टर #15 आरक्षित है; रजिस्टर #16 से #31 विक्रेता-विशिष्ट हैं। रजिस्टरों का उपयोग डिवाइस को कॉन्फ़िगर करने और वर्तमान ऑपरेटिंग मोड को क्वेरी करने के लिए किया जाता है।[further explanation needed] एमआईआई स्टेटस वर्ड सबसे उपयोगी डाटाम है, क्योंकि इसका उपयोग यह पता लगाने के लिए किया जा सकता है कि ईथरनेट एनआईसी नेटवर्क से जुड़ा है या नहीं। इसमें निम्न जानकारी के साथ एक बिट फ़ील्ड है:[2]: Section 22.2.4.2.2 "100BASE-X full duplex ability" 

Bit value Meaning
0x8000 100 बेस-टी4 में सक्षम
0x6000 100 बेस-टेक्सास फुल/हाफ डुप्लेक्स में सक्षम
0x1800 10 बेस-टी फुल/हाफ डुप्लेक्स में सक्षम
0x0600 100 बेस-टी2 फुल/हाफ डुप्लेक्स में सक्षम
0x0100 विस्तारित स्थिति रजिस्टर मौजूद है(गीगाबिट ईथरनेट)
0x0080 यूनिडायरेक्शनल ऑपरेशन में सक्षम
0x0040 प्रबंधन फ्रेम प्रस्तावना दमन की अनुमति है
0x0020 पूर्ण ऑटोनेगोटिएशन
0x0010 दूरस्थ दोष
0x0008 ऑटोनेगोटिएशन करने में सक्षम
0x0004 लिंक स्थापित
0x0002 जैबर का पता चला
0x0001 विस्तारित एमआईआई रजिस्टर मौजूद हैं


ट्रांसमीटर सिग्नल

Signal name Description Direction
टीएक्स-सीएलके संचारित घड़ी पीएचवाई से मैक
टीएक्सडी0 संचारित डेटा बिट 0 (पहले प्रेषित) मैक से पीएचवाई
टीएक्सडी1 डेटा 1 बिट संचारित करें मैक से पीएचवाई
टीएक्सडी2 डेटा 2 बिट संचारित करें मैक से पीएचवाई
टीएक्सडी3 डेटा 3 बिट संचारित करें मैक से पीएचवाई
टीएक्स-ईएन संचारित सक्षम करें मैक से पीएचवाई
टीएक्स-ईआर प्रेषण त्रुटि (वैकल्पिक) मैक से पीएचवाई

ट्रांसमिट क्लॉक लिंक स्पीड (100 मेगाबिट/सेकंड के लिए 25 मेगाहर्ट्ज, 10 मेगाबिट/सेकंड के लिए 2.5 मेगाहर्ट्ज) के आधार पर पीएचवाई द्वारा जनरेट की गई फ्री-रनिंग क्लॉक है। शेष ट्रांसमिट सिग्नल टीएक्स_सीएल के के बढ़ते किनारे पर मैक द्वारा समकालिक रूप से संचालित होते हैं। यह व्यवस्था मैक को लिंक गति के बारे में जागरूक किए बिना संचालित करने की अनुमति देती है। ट्रांसमिट सक्षम सिग्नल फ्रेम ट्रांसमिशन के दौरान उच्च और ट्रांसमीटर के निष्क्रिय होने पर कम होता है।

फ्रेम ट्रांसमिशन के दौरान एक या एक से अधिक क्लॉक पीरियड्स के लिए ट्रांसमिट एरर उठाया जा सकता है ताकि पीएचवाई को जानबूझकर फ्रेम को कुछ दृश्यमान तरीके से भ्रष्ट करने का अनुरोध किया जा सके जो इसे वैध के रूप में प्राप्त होने से रोकता है। ट्रांसमिशन शुरू होने के बाद कुछ समस्या का पता चलने पर इसका उपयोग फ्रेम को रद्द करने के लिए किया जा सकता है। मैक सिग्नल को छोड़ सकता है अगर इसका इस कार्यक्षमता के लिए कोई उपयोग नहीं है, इस मामले में पीएचवाई के लिए सिग्नल को कम बांधा जाना चाहिए।

हाल ही में, फ्रेम ट्रांसमिशन के बाहर ट्रांसमिट एरर बढ़ाने का उपयोग यह इंगित करने के लिए किया जाता है कि ट्रांसमिट डेटा लाइन्स का उपयोग विशेष-उद्देश्य सिग्नलिंग के लिए किया जा रहा है। विशेष रूप से, डेटा मान 0b0001 ( टीएक्स_ईएन कम और टीएक्स_ईआर उच्च के साथ लगातार आयोजित) का उपयोग कम पावर मोड में प्रवेश करने के लिए ऊर्जा-कुशल ईथरनेट-सक्षम पीएचवाई का अनुरोध करने के लिए किया जाता है।

रिसीवर सिग्नल

Signal name Description Direction
RX-CLK Receive clock पीएचवाई से मैक
RXD0 Receive data bit 0 (received first) पीएचवाई से मैक
RXD1 Receive data bit 1 पीएचवाई से मैक
RXD2 Receive data bit 2 पीएचवाई से मैक
RXD3 Receive data bit 3 पीएचवाई से मैक
RXDV Receive data valid पीएचवाई से मैक
RX-ER Receive error पीएचवाई से मैक
सीआरएस Carrier sense पीएचवाई से मैक
सीओएल सीओएलlision detect पीएचवाई से मैक

पहले सात रिसीवर सिग्नल पूरी तरह से ट्रांसमीटर सिग्नल के अनुरूप हैं, टीएक्स_ईआर को छोड़कर वैकल्पिक नहीं है और प्राप्त सिग्नल को इंगित करने के लिए वैध डेटा को डीकोड नहीं किया जा सकता है। फ्रेम रिसेप्शन के दौरान इनकमिंग सिग्नल से रिसीव क्लॉक रिकवर किया जाता है। जब कोई घड़ी पुनर्प्राप्त नहीं की जा सकती है (अर्थात जब माध्यम मौन है), पीएचवाई को एक फ्री-रनिंग क्लॉक को एक विकल्प के रूप में पेश करना चाहिए।

प्राप्त डेटा मान्य सिग्नल (आरएक्स_डीवी) को फ्रेम शुरू होने पर तुरंत उच्च जाने की आवश्यकता नहीं होती है, लेकिन प्राप्त डेटा में फ्रेम सीमांकक बाइट की शुरुआत सुनिश्चित करने के लिए समय पर ऐसा करना चाहिए। प्रस्तावना के कुछ निबल्स खो सकते हैं।

ट्रांसमिट के समान, एक फ्रेम के बाहर टीएक्स_ईआर को उठाना विशेष सिग्नलिंग के लिए उपयोग किया जाता है। प्राप्त करने के लिए, दो डेटा मान परिभाषित किए गए हैं: 0b0001 यह इंगित करने के लिए कि लिंक पार्टनर ईईई लो पावर मोड में है, और 0b1110 झूठे वाहक संकेत के लिए है।

सीआरएस और सीओएल सिग्नल प्राप्त घड़ी के लिए अतुल्यकालिक हैं, और केवल आधे-द्वैध मोड में सार्थक हैं। संचारण, प्राप्त करते समय वाहक भावना अधिक होती है, या माध्यम अन्यथा उपयोग में होने के रूप में महसूस किया जाता है। यदि टक्कर का पता चलता है, तो टक्कर बनी रहने पर सीओएल भी ऊपर जाता है।

इसके अलावा, मैक कमजोर रूप से सीओएल सिग्नल को खींच सकता है, जिससे अनुपस्थित/डिस्कनेक्टेड पीएचवाई के संकेत के रूप में सेवा करने के लिए सीआरएस कम (जो पीएचवाई कभी उत्पन्न नहीं होगा) के साथ सीओएल उच्च के संयोजन की अनुमति देता है।

प्रबंधन संकेत

Main article: Management Data Input/Output
संकेत नाम विवरण दिशा
एमडीआईओ प्रबंधन डेटा द्विदिश
एमडीसी प्रबंधन डेटा घड़ी मैक से पीएचवाई

एमडीसी और एमडीआईओ I²C के समान एक तुल्यकालिक सीरियल डेटा इंटरफ़ेस का गठन करते हैं। I²C की तरह, इंटरफ़ेस एक मल्टीड्रॉप बस है इसलिए एमडीसी और एमडीआईओ को कई पीएचवाईs के बीच साझा किया जा सकता है।

सीमाएं

इंटरफ़ेस को 18 संकेतों की आवश्यकता होती है, जिनमें से केवल दो (एमडीआईओ और एमडीसी) को कई पीएचवाईs के बीच साझा किया जा सकता है। यह एक समस्या प्रस्तुत करता है, विशेष रूप से मल्टीपोर्ट उपकरणों के लिए; उदाहरण के लिए, MII का उपयोग करने वाले आठ-पोर्ट स्विच के लिए 8 × 16 + 2 = 130 सिग्नल की आवश्यकता होगी।

कम मीडिया-स्वतंत्र इंटरफ़ेस

"RMII" redirects here. Not to be confused with RM2.

रिड्यूस्ड मीडिया-स्वतंत्र इंटरफ़ेस (आरएमआईआई) एक मानक है जिसे पीएचवाई को मैक से जोड़ने के लिए आवश्यक संकेतों की संख्या को कम करने के लिए विकसित किया गया था। पिन काउंट को कम करने से नेटवर्क हार्डवेयर के लिए लागत और जटिलता कम हो जाती है, विशेष रूप से बिल्ट-इन मैक, क्षेत्र में प्रोग्राम की जा सकने वाली द्वार श्रंखला , मल्टीपोर्ट स्विच या रिपीटर्स और पीसी मदरबोर्ड चिपसेट के साथ microcontroller ्स के संदर्भ में। इसे हासिल करने के लिए एमआईआई मानक की तुलना में चार चीजें बदली गईं। इन परिवर्तनों का अर्थ है कि आरएमआईआई, MII की तुलना में लगभग आधे संकेतों का उपयोग करता है।

  • दो घड़ियों ** और RXCLK को एक घड़ी से बदल दिया गया है। यह घड़ी आउटपुट के बजाय पीएचवाई के लिए एक इनपुट है, जो एक स्विच जैसे मल्टीपोर्ट डिवाइस में सभी पीएचवाईs के बीच क्लॉक सिग्नल को साझा करने की अनुमति देता है।
  • क्लॉक फ़्रीक्वेंसी को 25 मेगाहर्ट्ज़ से दोगुना करके 50 मेगाहर्ट्ज़ कर दिया गया है, जबकि डेटा पाथ को 4 बिट से 2 बिट तक सीमित कर दिया गया है।
  • RXDV और सीआरएस सिग्नल एक सिग्नल में मल्टीप्लेक्स होते हैं।
  • सीओएल सिग्नल हटा दिया गया है।
Reduced media-independent interface (आरएमआईआई) signals
Signal name Description Direction
आर ईएफ_सीएलके लगातार 50 मेगाहर्ट्ज संदर्भ घड़ी संदर्भ घड़ी बाहरी घड़ी स्रोत से दोनों उपकरणों पर एक इनपुट हो सकती है, या मैक से मेन्हाई से संचालित हो सकती है, या मैक से मैक से संचालित हो सकती है।
टीएक्सडी0 संचारित डेटा बिट 0 (पहले प्रेषित) मैक से पीएचवाई
टीएक्सडी1 डेटा बिट 1 संचारित करें मैक से पीएचवाई
टीएक्स_ईएन उच्च होने पर, टीएक्सडी 0 और टीएक्सडी1 पर क्लॉक डेटा ट्रांसमीटर से मैक से पीएचवाई
आरएक्सडी0 डेटा प्राप्त करें बिट 0 (पहले प्राप्त) पीएचवाई से मैक
आर एक्सडी1 डेटा बिट 1 प्राप्त करें पीएचवाई से मैक
सीआरएस_डीवी कैरियर सेंस (सीआरएस) और आरएक्स_डेटा वैलिड (आरएक्स_डीवी) वैकल्पिक घड़ी चक्र पर मल्टीप्लेक्स। 10 मेगाबिट/सेकंड मोड में, यह प्रत्येक 10 घड़ी चक्रों को वैकल्पिक करता है। पीएचवाई से मैक
टीएक्स_ईआर त्रुटि प्राप्त करें (स्विच पर वैकल्पिक) पीएचवाई से मैक
एमडीआईओ प्रबंधन डेटा द्विदिश
एमडीसी प्रबंधन डेटा clock. मैक से पीएचवाई

एमडीसी और एमडीआईओ को कई पीएचवाईs के बीच साझा किया जा सकता है।

रिसीवर सिग्नल REF_CLK को संदर्भित करते हैं, ट्रांसमीटर सिग्नल के समान।

इस इंटरफ़ेस को MII के 18 की तुलना में 9 संकेतों की आवश्यकता होती है। उन 9 में से, मल्टीपोर्ट उपकरणों पर, एमडीआईओ, एमडीसी, और REF_CLK को प्रति पोर्ट 6 या 7 पिन छोड़कर साझा किया जा सकता है।

आरएमआईआई की आवश्यकता है 50 MHz घड़ी जहां एमआईआई की आवश्यकता होती है 25 MHz क्लॉक और डेटा को एक समय में दो बिट बनाम MII के लिए एक समय में 4 बिट या SNI के लिए एक बार में 1 बिट (10 मेगाबिट/सेकंड केवल) के लिए क्लॉक आउट किया जाता है। डेटा केवल राइजिंग एज पर सैंपल किया जाता है (यानी यह दोहरे पम्प नहीं है)।

REF_CLK दोनों में 50 मेगाहर्ट्ज पर संचालित होता है 100 Mbit/s मोड और 10 Mbit/s तरीका। संचारण पक्ष (पीएचवाई या मैक) को सभी संकेतों को 10 घड़ी चक्रों के लिए वैध रखना चाहिए 10 Mbit/s तरीका। रिसीवर ( पीएचवाई या मैक) केवल हर दस चक्रों में इनपुट सिग्नल का नमूना लेता है 10 Mbit/s तरीका।

सीमाएं

ऐसा कोई संकेत नहीं है जो परिभाषित करता है कि इंटरफ़ेस पूर्ण या आधा डुप्लेक्स मोड में है, लेकिन मैक और पीएचवाई दोनों को सहमत होने की आवश्यकता है। इसके बजाय इसे सीरियल एमडीआईओ/एमडीसी इंटरफ़ेस पर संप्रेषित किया जाना चाहिए। ऐसा कोई संकेत भी नहीं है जो यह परिभाषित करता हो कि इंटरफ़ेस 10 या 100 मेगाबिट/सेकंड मोड में है, इसलिए इसे भी एमडीआईओ/एमडीसी इंटरफ़ेस का उपयोग करके नियंत्रित किया जाना चाहिए। आरएमआईआई कंसोर्टियम विनिर्देश के संस्करण 1.2 में कहा गया है कि इसका एमडीआईओ/एमडीसी इंटरफ़ेस आई ई ई ई 802.3u में MII के लिए निर्दिष्ट इंटरफ़ेस के समान है। आई ई ई ई 802.3 के वर्तमान संशोधन लिंक की गति और द्वैध मोड को बातचीत और कॉन्फ़िगर करने के लिए एक मानक एमडीआईओ/एमडीसी तंत्र निर्दिष्ट करते हैं, लेकिन यह संभव है कि पुराने पीएचवाई उपकरणों को मानक के अप्रचलित संस्करणों के विरुद्ध डिज़ाइन किया गया हो, और इसलिए सेट करने के लिए मालिकाना तरीकों का उपयोग कर सकते हैं। गति और द्वैध।

टीएक्स_ईआर सिग्नल की कमी जो कुछ मैकs (जैसे मल्टीपॉर्ट स्विच) पर कनेक्ट नहीं है, कुछ पीएचवाईs पर डेटा प्रतिस्थापन द्वारा चक्रीय अतिरेक जाँच को अमान्य करने के लिए निपटाया जाता है। गायब सीओएल सिग्नल, टीएक्स_ईएन और डीकोड किए गए सीआरएस सिग्नल को मिलाकर AND-ing से हाफ डुप्लेक्स मोड में सीआरएस_DV लाइन से लिया गया है। इसका अर्थ है सीआरएस की परिभाषा में मामूली संशोधन: एमआईआई पर, आरएक्स और टीएक्स फ्रेम दोनों के लिए सीआरएस का दावा किया जाता है; आरएमआईआई पर केवल Rx फ्रेम के लिए। इसका परिणाम यह है कि आरएमआईआई पर दो त्रुटि स्थितियों में कोई वाहक और खोया वाहक नहीं पाया जा सकता है, और 10BASE2 या 10BASE5 जैसे साझा मीडिया का समर्थन करना मुश्किल या असंभव है।

चूंकि आरएमआईआई मानक यह निर्धारित करने के लिए उपेक्षित है कि टीएक्स_ईएन को केवल वैकल्पिक घड़ी चक्रों पर नमूना लिया जाना चाहिए, यह सीआरएस_DV के साथ सममित नहीं है और दो आरएमआईआई पीएचवाई उपकरणों को एक पुनरावर्तक बनाने के लिए बैक टू बैक कनेक्ट नहीं किया जा सकता है; हालांकि, यह राष्ट्रीय DP83848 के साथ संभव है, जो आरएमआईआई मोड में एक पूरक संकेत के रूप में डिकोड किए गए आरएक्स_डीवी की आपूर्ति करता है।[3]


सिग्नल स्तर

TTL तर्क स्तर ों का उपयोग किया जाता है 5 V या 3.3 V तर्क। इनपुट उच्च दहलीज है 2.0 V और कम है 0.8 V. विनिर्देश बताता है कि इनपुट होना चाहिए 5 V सहिष्णु, हालांकि, आरएमआईआई इंटरफेस वाले कुछ लोकप्रिय चिप्स नहीं हैं 5 V सहिष्णु। नए उपकरण समर्थन कर सकते हैं 2.5 V और 1.8 V तर्क।

आरएमआईआई संकेतों को पारेषण लाइनों के बजाय गांठ-तत्व मॉडल के रूप में माना जाता है। हालाँकि, संबंधित MII मानक का आई ई ई ई संस्करण निर्दिष्ट करता है 68 Ω ट्रेस प्रतिबाधा।[4] राष्ट्रीय दौड़ने की सलाह देते हैं 50 Ω के साथ निशान 33 Ω प्रतिबिंबों को कम करने के लिए या तो MII या आरएमआईआई मोड के लिए श्रृंखला समाप्ति प्रतिरोध।[citation needed] राष्ट्रीय भी सुझाव देता है कि निशान के तहत रखा जाना चाहिए 0.15 m लंबा और भीतर मेल खाता है 0.05 m तिरछा कम करने के लिए लंबाई पर।[4]: 5 


गीगाबिट मीडिया-स्वतंत्र इंटरफ़ेस

गीगाबिट मीडिया-स्वतंत्र इंटरफ़ेस (जीएमआईआई) मध्यम अभिगम नियंत्रण (मैक) डिवाइस और भौतिक परत ( पीएचवाई ) के बीच एक इंटरफ़ेस है। इंटरफ़ेस 1000 मेगाबिट/सेकंड तक की गति पर संचालित होता है, जिसे प्राप्त करने और संचारित करने के लिए अलग-अलग आठ-बिट डेटा पथ के साथ 125 मेगाहर्ट्ज पर क्लॉक किए गए डेटा इंटरफ़ेस का उपयोग करके कार्यान्वित किया जाता है, और MII विनिर्देश के साथ पीछे की ओर संगत है और निम्न-बैक गति पर काम कर सकता है 10 या 100 एमबीटी/एस।

जीएमआईआई इंटरफ़ेस को पहले आई ई ई ई 802.3z-1998 में 1000BASE-X के लिए खंड 35 के रूप में परिभाषित किया गया था, और बाद में आई ई ई ई 802.3-2000 में शामिल किया गया।[2]: Clause 35 


ट्रांसमीटर सिग्नल

Signal name Description
G टीएक्ससीएलके Clock signal for gigabit TX signals (125 मेगाहर्ट्ज)
टीएक्ससीएलके Clock signal for 10/100 मेगाबिट/सेकंड signals
टीएक्सडी[7..0] Data से be transmitted
TXEN Transmitter enable
TXER Transmitter error (used से intentionally corrupt a packet, if necessary)

दो ट्रांसमीटर घड़ियां हैं। उपयोग की जाने वाली घड़ी इस बात पर निर्भर करती है कि पीएचवाई gigabit पर काम कर रहा है या 10/100 मेगाबिट/सेकंड की गति पर। गीगाबिट ऑपरेशन के लिए, G टीएक्ससीएलके को पीएचवाई को आपूर्ति की जाती है और टीएक्सडी, TXEN, TXER सिग्नल इसके लिए सिंक्रनाइज़ किए जाते हैं। 10 या 100 मेगाबिट/सेकंड ऑपरेशन के लिए, टीएक्ससीएलके की आपूर्ति पीएचवाई द्वारा की जाती है और उन संकेतों को सिंक्रनाइज़ करने के लिए उपयोग किया जाता है। यह 100 मेगाबिट/सेकंड के लिए 25 मेगाहर्ट्ज या 10 मेगाबिट/सेकंड कनेक्शन के लिए 2.5 मेगाहर्ट्ज पर संचालित होता है। इसके विपरीत, रिसीवर आने वाले डेटा से पुनर्प्राप्त एकल घड़ी संकेत का उपयोग करता है।

रिसीवर सिग्नल

Signal name Description
RXCLK Received clock signal (recovered from incoming received data)
RXD[7..0] Received data
RXDV Signifies data received is valid
RXER Signifies data received has errors
सीओएल सीओएलlision detect (half-duplex connections only)
CS Carrier sense (half-duplex connections only)


प्रबंधन संकेत

Signal name Description
एमडीसी Management interface clock
एमडीआईओ Management interface I/O bidirectional pin.

प्रबंधन इंटरफ़ेस पीएचवाई के व्यवहार को नियंत्रित करता है। इसमें MII के समान रजिस्टरों का सेट है, सिवाय इसके कि रजिस्टर #15 विस्तारित स्थिति रजिस्टर है।[2]: Section 22.2.4 "Management functions" 


कम गीगाबिट मीडिया-स्वतंत्र इंटरफ़ेस

Supported ईथरनेट speeds
[मेगाबिट/सेकंड ] [मेगाहर्ट्ज] Bits/clock cycle
10 2.5 4
100 25  4
1000 125  8

कम गीगाबिट मीडिया-स्वतंत्र इंटरफ़ेस (आरजीएमआईआई) जीएमआईआई इंटरफ़ेस में उपयोग किए जाने वाले डेटा पिनों की आधी संख्या का उपयोग करता है। यह कमी दोगुनी गति, समय बहुसंकेतन संकेतों और गैर-आवश्यक वाहक-भावना और टक्कर-संकेत संकेतों को समाप्त करके आधे से अधिक डेटा लाइनों को चलाकर प्राप्त की जाती है। इस प्रकार आरजीएमआईआई में जीएमआईआई के 24 से 27 के विपरीत केवल 14 पिन होते हैं।

डेटा 1000 मेगाबिट/सेकंड के लिए बढ़ते और गिरते किनारों पर और केवल 10/100 मेगाबिट/सेकंड के लिए बढ़ते किनारों पर देखा जाता है।[5] RX_CTL सिग्नल बढ़ते किनारे पर RXDV (डेटा मान्य) और गिरने वाले किनारे पर (RXDV xor RXER) ले जाता है। TX_CTL सिग्नल इसी तरह TXEN को बढ़ते किनारे पर और (TXEN xor TXER) को गिरने वाले किनारे पर ले जाता है। यह मामला 1000 मेगाबिट/सेकंड और 10/100 मेगाबिट/सेकंड दोनों का है।[6] ट्रांसमिट क्लॉक सिग्नल हमेशा मैक द्वारा TXC लाइन पर प्रदान किया जाता है। प्राप्त घड़ी संकेत हमेशा पीएचवाई द्वारा RXC लाइन पर प्रदान किया जाता है।[citation needed] स्रोत-तुल्यकालिक क्लॉकिंग का उपयोग किया जाता है: क्लॉक सिग्नल जो आउटपुट होता है (या तो पीएचवाई या मैक द्वारा) डेटा सिग्नल के साथ सिंक्रोनस होता है। इसके लिए पीसीबी को इस तरह डिजाइन किया जाना चाहिए कि वह घड़ी के सिग्नल में 1.5–2 एनएस देरी जोड़ दे ताकि सिंक पर सेटअप और होल्ड समय पूरा हो सके। Rजीएमआईआई v2.0 एक वैकल्पिक आंतरिक विलंब निर्दिष्ट करता है, जिससे पीसीबी डिज़ाइनर को विलंब जोड़ने की आवश्यकता नहीं होती है; इसे आरजीएमआईआई-आईडी के नाम से जाना जाता है।

Rजीएमआईआई signals
Signal name Description Direction
TXC Clock signal मैक से पीएचवाई
टीएक्सडी[3..0] Data से be transmitted मैक से पीएचवाई
TX_CTL Multiplexing of transmitter enable and transmitter error मैक से पीएचवाई
RXC Received clock signal (recovered from incoming received data) पीएचवाई से मैक
RXD[3..0] Received data पीएचवाई से मैक
RX_CTL Multiplexing of data received is valid and receiver error पीएचवाई से मैक
एमडीसी Management interface clock मैक से पीएचवाई
एमडीआईओ Management interface I/O Bidirectional

आरजीएमआईआई संस्करण 1.3[7] 2.5V CMOS का उपयोग करता है,[8] जबकि Rजीएमआईआई संस्करण 2 1.5V उच्च गति ट्रांसीवर तर्क का उपयोग करता है।[9]


सीरियल गीगाबिट मीडिया-स्वतंत्र इंटरफ़ेस

सीरियल गिगाबिट मीडिया-इंडिपेंडेंट इंटरफ़ेस (एसजीएमआईआई) गीगाबिट ईथरनेट के लिए उपयोग किए जाने वाले एमआईआई का एक प्रकार है, लेकिन यह 10/100 एमबीटी/एस ईथरनेट भी ले जा सकता है।

यह TX और RX डेटा और TX और RX घड़ियों के लिए 625 मेगाहर्ट्ज क्लॉक फ्रीक्वेंसी DDR पर डिफरेंशियल जोड़े का उपयोग करता है। यह गीगाबिट मीडिया स्वतंत्र इंटरफ़ेस से इसकी निम्न-शक्ति और निम्न पिन-काउंट 8b/10b एन्कोडिंग|8b/10b-कोडेड SerDes द्वारा भिन्न है। संचारित और प्राप्त पथ प्रत्येक डेटा के लिए एक अंतर जोड़ी और घड़ी के लिए एक और अंतर जोड़ी का उपयोग करता है। TX/RX घड़ियों को डिवाइस आउटपुट पर जेनरेट किया जाना चाहिए लेकिन डिवाइस इनपुट पर वैकल्पिक है (घड़ी घड़ी की वसूली को वैकल्पिक रूप से इस्तेमाल किया जा सकता है)। 10/100 मेगाबिट/सेकंड ईथरनेट डेटा शब्दों को 100/10 बार डुप्लिकेट करके ले जाया जाता है, इसलिए घड़ी हमेशा 625 मेगाहर्ट्ज पर होती है।

उच्च सीरियल गीगाबिट मीडिया स्वतंत्र इंटरफ़ेस

उच्च सीरियल गीगाबिट मीडिया-स्वतंत्र इंटरफ़ेस (एचएसजीएमआईआई) कार्यात्मक रूप से Sजीएमआईआई के समान है लेकिन 2.5 Gbit/s तक की लिंक गति का समर्थन करता है।

क्वाड सीरियल गीगाबिट मीडिया-स्वतंत्र इंटरफ़ेस

क्वाड सीरियल गीगाबिट मीडिया-स्वतंत्र इंटरफ़ेस ( क्यूएसजीएमआईआई) चार Sजीएमआईआई लाइनों को 5 Gbit/s इंटरफ़ेस में संयोजित करने की एक विधि है। क्यूएसजीएमआईआई, Sजीएमआईआई की तरह, TX और RX डेटा के लिए कम वोल्टेज अंतर सिग्नलिंग (LVDS) और सिंगल LVDS क्लॉक सिग्नल का उपयोग करता है। क्यूएसजीएमआईआई चार अलग Sजीएमआईआई कनेक्शनों की तुलना में काफी कम सिग्नल लाइनों का उपयोग करता है।

10 गीगाबिट मीडिया-स्वतंत्र इंटरफ़ेस

10 गीगाबिट मीडिया-स्वतंत्र इंटरफ़ेस (Xजीएमआईआई) आई ई ई ई 802.3 में परिभाषित एक मानक है जिसे एक मुद्रित सर्किट बोर्ड (PCB) पर पूर्ण डुप्लेक्स 10 गीगाबिट ईथरनेट (10GbE) पोर्ट को एक दूसरे से और अन्य इलेक्ट्रॉनिक उपकरणों से जोड़ने के लिए डिज़ाइन किया गया है। यह अब आम तौर पर ऑन-चिप कनेक्शन के लिए उपयोग किया जाता है। पीसीबी कनेक्शन अब ज्यादातर XAUI के साथ संपन्न होते हैं। Xजीएमआईआई में दो 32-बिट डेटापथ (Rx और Tx) और दो चार-बिट नियंत्रण प्रवाह (Rxc और Txc) हैं, जो 156.25 मेगाहर्ट्ज डबल डेटा दर (312.5 ट्रांसफर (कंप्यूटिंग)|MT/s) पर काम कर रहे हैं।

यह भी देखें

संदर्भ

  1. ↑ "KSZ8001L/S 1.8V, 3.3V 10/100BASE-T/TX/FX भौतिक परत ट्रांसीवर" (PDF).
  2. ↑ 2.0 2.1 2.2 2.3 ईथरनेट के लिए IEEE मानक. IEEE 802.3. 31 August 2018. doi:10.1109/IEEESTD.2018.8457469. ISBN 978-1-5044-5090-4.
  3. ↑ AN-1405 schematic
  4. ↑ 4.0 4.1 AN-1469 datasheet
  5. ↑ "रिड्यूस्ड गिगाबिट मीडिया इंडिपेंडेंट इंटरफेस (आरजीएमआईआई) वर्जन 2.0" (PDF). 2002-04-01. Archived from the original on 2016-03-03.{{cite web}}: CS1 maint: bot: original URL status unknown (link)
  6. ↑ "एक्सवे PHY11G" (PDF). Archived from the original (PDF) on 2014-04-13. Retrieved 2014-04-11.
  7. ↑ "रिड्यूस्ड गिगाबिट मीडिया इंडिपेंडेंट इंटरफेस (आरजीएमआईआई) वर्जन 1.3" (PDF). 2000-12-10. Archived from the original (PDF) on 2016-03-03.
  8. ↑ "2.5 V ± 0.2 V (सामान्य रेंज) और 1.8 V - 2.7 V (वाइड रेंज) पावर सप्लाई वोल्टेज और नॉन-टर्मिनेटेड डिजिटल इंटीग्रेटेड सर्किट के लिए इंटरफेस स्टैंडर्ड, JESD8-5A.01" (PDF). 2006-06-01.
  9. ↑ "हाई स्पीड ट्रांसीवर लॉजिक (HSTL)। डिजिटल इंटीग्रेटेड सर्किट के लिए 1.5V आउटपुट बफर सप्लाई वोल्टेज आधारित इंटरफेस मानक, JESD8-6" (PDF). 1995-08-01.


बाहरी कड़ियाँ

श्रेणी:ईथरनेट श्रेणी:कंप्यूटर बसें श्रेणी:सीरियल बसें

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