साउथब्रिज (कंप्यूटिंग)
साउथब्रिज पर्सनल कंप्यूटर (पीसी) मदरबोर्ड पर कोर लॉजिक चिपसेट में दो चिप्स में से एक है, दूसरा नॉर्थब्रिज (कंप्यूटिंग) है। साउथब्रिज सामान्यतः नॉर्थब्रिज/साउथब्रिज चिपसेट कंप्यूटर आर्किटेक्चर में मदरबोर्ड की धीमी क्षमताओं को इम्प्लीमेंट करता है। इंटेल चिपसेट वाले सिस्टम में, साउथब्रिज को आउटपुट/इनपुट कंट्रोलर हब (ICH) नाम दिया गया है, जबकि AMD ने अपने फ़्यूज़न एक्सेलेरेटेड प्रोसेसिंग यूनिट (APU) के कार्यों को आगे बढ़ाते हुए इसके प्रारम्भ के पश्चात से इसे साउथब्रिज फ्यूजन कंट्रोलर हब (FCH) नाम दिया है। सीपीयू डाई पर, इस प्रकार यह प्लेटफ़ॉर्म हब कंट्रोलर के कार्य के समान हो जाता है।
सेंट्रल प्रोसेसिंग यूनिट से सम्बंधित न होने के कारण साउथब्रिज को सामान्यतः नॉर्थब्रिज से भिन्न किया जा सकता है। अपितु, नॉर्थब्रिज साउथब्रिज को सीपीयू से जोड़ता है। कंट्रोलर इंटीग्रेटेड चैनल सर्किटरी के उपयोग के माध्यम से, नॉर्थब्रिज डेटा कंट्रोल और एक्सेस के लिए आउटपुट/इनपुट इकाइयों से सिग्नल को सीधे सीपीयू से जोड़ सकता है।
वर्तमान स्थिति
सिस्टम-ऑन-चिप (एसओसी) प्रोसेसर के लिए पुश के कारण, आधुनिक डिवाइस में तीव्रता से नॉर्थब्रिज को सीपीयू डाई (इंटीग्रेटेड सर्किट) में इंटीग्रेट किया जा रहा है; उदाहरण इंटेल के सैंडी ब्रिज[1] और एएमडी के एएमडी फ्यूजन प्रोसेसर हैं,[2] दोनों को 2011 में रिलीज़ किया गया है। साउथब्रिज अनावश्यक हो गया और इसे 2008 में इंटेल 5 सीरीज चिपसेट के साथ प्रस्तुत किए गए प्लेटफार्म कंट्रोलर हब (पीसीएच) आर्किटेक्चर द्वारा प्रतिस्थापित किया गया, जबकि एएमडी ने 2011 में अपने प्रथम एपीयू की रिलीज़ के साथ पीसीएच को फ्यूजन नाम दिया। फ़्यूज़न कंट्रोलर हब (FCH), जिसका उपयोग 2017 तक केवल AMD के APUs पर किया जाता था, जब FCH नाम को हटाते हुए इसे AMD के ज़ेन आर्किटेक्चर पर उपयोग किया जाने लगा। इंटेल प्लेटफ़ॉर्म पर, सभी साउथब्रिज सुविधाओं और शेष आउटपुट/इनपुट फ़ंक्शंस को PCH द्वारा प्रबंधित किया जाता है जो डायरेक्ट मीडिया इंटरफ़ेस (डीएमआई) के माध्यम से सीपीयू से जुड़ा होता है।[3] इंटेल लो पावर प्रोसेसर (हैसवेल-यू और आगे) और अल्ट्रा लो पावर प्रोसेसर (हैसवेल-वाई और आगे) ने ऑन-पैकेज पीसीएच भी इंटीग्रेट किया है। अपने चिपलेट डिज़ाइन के आधार पर, AMD Ryzen प्रोसेसर ने कुछ साउथब्रिज फ़ंक्शंस को भी इंटीग्रेट किया, जैसे कुछ USB इंटरफ़ेस और कुछ SATA/NVMe इंटरफ़ेस भी इंटीग्रेट किया है।[4]
ओवरव्यू
साउथब्रिज चिपसेट कंप्यूटर के कई आउटपुट/इनपुट कार्यों को संभालता है, जैसे USB, ऑडियो, सिस्टम BIOS, ISA बस या LPC बस, कम गति वाली PCI/PCIe बस, IOAPIC इंटरप्ट कंट्रोलर, SATA स्टोरेज, ऐतिहासिक PATA स्टोरेज, और NVMe स्टोरेज।[5][6] साउथब्रिज और नॉर्थब्रिज चिप्स के विभिन्न संयोजन संभव हैं,[7] लेकिन इन दो प्रकार के चिप्स को साथ काम करने के लिए डिज़ाइन किया जाना चाहिए;[8][9] विभिन्न कोर लॉजिक चिपसेट डिज़ाइनों के बीच अंतरसंचालनीयता के लिए कोई उद्योग-व्यापी मानक नहीं है। 1990 और 2000 के दशक की प्रारम्भ में, नॉर्थब्रिज और साउथब्रिज के बीच का इंटरफ़ेस पीसीआई बस था। 2023 तक, उपयोग किए जाने वाले मुख्य ब्रिजिंग इंटरफेस इंटेल अल्ट्रा पाथ इंटरकनेक्ट (इंटेल) और पीसीआई ्सप्रेस (एएमडी) हैं।
व्युत्पत्ति
यह नाम मानचित्र के रूप में वास्तुकला का प्रतिनिधित्व करने से लिया गया है और इसे पहली बार 1991 में पारंपरिक पीसीआई वास्तुकला की प्रारम्भ के साथ वर्णित किया गया था। इंटेल में, पीसीआई विनिर्देश के लेखकों ने पीसीआई स्थानीय बस को बिल्कुल सही माना। पीसी प्लेटफ़ॉर्म आर्किटेक्चर का केंद्र (यानी, भूमध्य रेखा पर)।
नॉर्थब्रिज (कंप्यूटिंग) सीपीयू, मेमोरी/सीपीयू कैश और अन्य प्रदर्शन-महत्वपूर्ण क्षमताओं के समर्थन में पीसीआई बस बैकबोन के उत्तर तक फैला हुआ है। इसी तरह साउथब्रिज पीसीआई बस बैकबोन के दक्षिण तक फैला हुआ है और कम प्रदर्शन-महत्वपूर्ण आउटपुट/इनपुट क्षमताओं जैसे डिस्क इंटरफ़ेस, ऑडियो इत्यादि को जोड़ता है।
सीपीयू मानचित्र के शीर्ष पर उत्तर की ओर स्थित है। सीपीयू अन्य सिस्टम डिवाइस के उत्तर में स्थित फास्ट ब्रिज (नॉर्थब्रिज) के माध्यम से चिपसेट से जुड़ा हुआ है। नॉर्थब्रिज, खींचे गए अन्य सिस्टम डिवाइस के दक्षिण में स्थित धीमे ब्रिज (साउथब्रिज) के माध्यम से शेष चिपसेट से जुड़ा हुआ है।
हालाँकि वर्तमान पीसी प्लेटफ़ॉर्म आर्किटेक्चर ने पीसीआई बस बैकबोन को तेज़ आउटपुट/इनपुट बैकबोन से बदल दिया है, ब्रिज नामकरण परंपरा बनी हुई है।
कार्यक्षमता
समकालीन साउथब्रिज में पाई जाने वाली कार्यक्षमता में शामिल हैं:[9][6]* पीसीआई बस. दक्षिणी पुल में PCI-X के लिए समर्थन भी शामिल हो सकता है।
- कम गति पीसीआई ्सप्रेस (पीसीआईई) इंटरफेस सामान्यतः ईथरनेट और एनवीएमई के लिए।
- उद्योग मानक वास्तुकला या कम पिन गणना। नवीनतम मदरबोर्ड पर अब ISA स्लॉट प्रदान नहीं किए जाते हैं। एलपीसी ब्रिज सुपर आई/ओ (पीएस/2 पोर्ट|पीएस/2 कीबोर्ड और माउस, समानांतर पोर्ट, सीरियल पोर्ट, आईआर पोर्ट और फ्लॉपी कंट्रोलर के लिए सामान्य लगाव) के लिए डेटा और कंट्रोल पथ प्रदान करता है।
- क्रमानुसार बाह्य इंटरफ़ेस। एसपीआई बस साधारण सीरियल बस है जिसका उपयोग ज्यादातर फर्मवेयर (जैसे, BIOS/UEFI) फ्लैश मेमोरी स्टोरेज ्सेस के लिए किया जाता है।
- एसएमबस कंट्रोलर।
- डायरेक्ट मेमोरी ्सेस कंट्रोलर। 8237 डीएमए कंट्रोलर आईएसए या एलपीसी डिवाइस को सीपीयू की मदद के बिना मुख्य मेमोरी तक सीधे एक्सेस की अनुमति देता है।
प्रोग्राम करने योग्य अंतराल टाइमर कंट्रोलर और आउटपुट/इनपुट APIC।
- विपुल भंडारण इंटरफेस जैसे सीरियल एटीए, एम.2 और ऐतिहासिक पैरेलल एटीए। यह सामान्यतः हार्ड ड्राइव्ज़ या एसएसडी को जोड़ने की अनुमति देता है।
- वास्तविक समय घड़ी।
- प्रोग्रामयोग्य अंतराल टाइमर।
- उच्च परिशुद्धता इवेंट टाइमर।
- उन्नत कॉन्फ़िगरेशन और पावर इंटरफ़ेस कंट्रोलर या उन्नत पावर प्रबंधन कंट्रोलर।
- गैर-वाष्पशील BIOS मेमोरी। सिस्टम गैर-वाष्पशील BIOS मेमोरी (BIOS कॉन्फ़िगरेशन मेमोरी), बैटरी पूरक शक्ति द्वारा सहायता प्राप्त, BIOS कॉन्फ़िगरेशन डेटा के लिए सीमित गैर-वाष्पशील भंडारण क्षेत्र बनाता है।
- Intel HD ऑडियो या AC'97 ध्वनि इंटरफ़ेस।
- यूएसबी इंटरफेस।
वैकल्पिक रूप से, साउथब्रिज में ईथरनेट, वाई-फाई, RAID, थंडरबोल्ट (इंटरफ़ेस), और आउट-ऑफ़-बैंड प्रबंधन के लिए समर्थन (ऑनबोर्ड असतत चिप या साउथब्रिज-ीकृत) भी शामिल है।
यह भी देखें
- मेमोरी कंट्रोलर
- नॉर्थब्रिज (कंप्यूटिंग)
संदर्भ
- ↑ Vatto, Kristian. "Why Ivy Bridge is still Quad-core?". Anandtech. Retrieved September 27, 2015.
- ↑ Stokes, Jon (11 November 2010). "फ़्यूज़न के साथ, एएमडी की शैतानियाँ विवरण में हैं". Arstechnica. Retrieved September 27, 2015.
- ↑ "Mobile Intel HM57 Express Chipset". Intel. Retrieved 2014-04-21.
- ↑ Hagedoorn, Hilbert. "AMD Ryzen 3000: New Block diagram about PCIe 4.0 on Matisse and X570 chipset". Guru3D.com (in English). Retrieved 2020-06-12.
- ↑ "What is Southbridge?", Webopedia Computer Dictionary (word definition), 4 November 2002.
- ↑ 6.0 6.1 Mujtaba, Hassan (2019-09-13). "Intel Z490, H470 Motherboards For 10th Gen Comet Lake-S CPUs Leaked". Wccftech (in English). Retrieved 2020-10-30.
- ↑ Chipset: Northbridge and Southbridge, Rigacci.
- ↑ What is northbridge, southbridge, how northbridge, southbridge works, Edu soft max.
- ↑ 9.0 9.1 What is a chipset?, UK: Misco.
बाहरी संबंध
- "Motherboards & Core-Logic Chipsets: The Deep Stuff > What the North Bridge and South Bridge Do". InformIT. Retrieved November 18, 2010.
