मेमोरी कंट्रोलर: Difference between revisions
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मेमोरी कंट्रोलर एक डिजिटल परिपथ होता है जो कंप्यूटर की मुख्य मेमोरी में जाने और जाने वाले डेटा के प्रवाह का प्रबंधन करता है। एक मेमोरी कंट्रोलर एक अलग चिप हो सकता है या किसी अन्य चिप में एकीकृत हो सकता है, जैसे कि उसी [[डाई (एकीकृत सर्किट)|डाई (एकीकृत परिपथ)]] पर रखा जा सकता है या बाद की स्थिति में [[माइक्रोप्रोसेसर]] के अभिन्न अंग के रूप में इसे सामान्यतः एक एकीकृत मेमोरी कंट्रोलर (आईएमसी) कहा जाता है। [[मुख्य स्मृति|मेमोरी]] कंट्रोलर को कभी-कभी मेमोरी चिप कंट्रोलर (एमसीसी)<ref>Comptia A+ Certification Exam Guide, Seventh Edition, by Mike Meyers, in the glossary, bottom of page 1278: "Chip that handles memory requests from the CPU."</ref> या एक मेमोरी कंट्रोलर यूनिट (एमसीयू) भी कहा जाता है।।<ref>{{cite book|url=https://books.google.com/books?id=PJ49xcoRb1QC&q=%22memory+controller+unit%22&pg=PA100|title=Maximizing Performance and Scalability with IBM WebSphere|access-date=6 February 2015|isbn=9781590591307|last1=Neat|first1=Adam G.|date=2003-12-04}}</ref> | मेमोरी कंट्रोलर एक डिजिटल परिपथ होता है जो कंप्यूटर की मुख्य मेमोरी में जाने और जाने वाले डेटा के प्रवाह का प्रबंधन करता है। एक मेमोरी कंट्रोलर एक अलग चिप हो सकता है या किसी अन्य चिप में एकीकृत हो सकता है, जैसे कि उसी [[डाई (एकीकृत सर्किट)|डाई (एकीकृत परिपथ)]] पर रखा जा सकता है या बाद की स्थिति में [[माइक्रोप्रोसेसर]] के अभिन्न अंग के रूप में इसे सामान्यतः एक एकीकृत मेमोरी कंट्रोलर (आईएमसी) कहा जाता है। [[मुख्य स्मृति|मेमोरी]] कंट्रोलर को कभी-कभी मेमोरी चिप कंट्रोलर (एमसीसी)<ref>Comptia A+ Certification Exam Guide, Seventh Edition, by Mike Meyers, in the glossary, bottom of page 1278: "Chip that handles memory requests from the CPU."</ref> या एक मेमोरी कंट्रोलर यूनिट (एमसीयू) भी कहा जाता है।।<ref>{{cite book|url=https://books.google.com/books?id=PJ49xcoRb1QC&q=%22memory+controller+unit%22&pg=PA100|title=Maximizing Performance and Scalability with IBM WebSphere|access-date=6 February 2015|isbn=9781590591307|last1=Neat|first1=Adam G.|date=2003-12-04}}</ref> | ||
मेमोरी कंट्रोलर का एक सामान्य रूप [[स्मृति प्रबंधन इकाई]] (एमएमयू) है जो कई [[ऑपरेटिंग सिस्टम|ऑपरेटिंग प्रणाली]] में [[वर्चुअल एड्रेसिंग|आभासी पता]] को प्रायुक्त करता है। | मेमोरी कंट्रोलर का एक सामान्य रूप [[स्मृति प्रबंधन इकाई|मेमोरी प्रबंधन इकाई]] (एमएमयू) है जो कई [[ऑपरेटिंग सिस्टम|ऑपरेटिंग प्रणाली]] में [[वर्चुअल एड्रेसिंग|आभासी पता]] को प्रायुक्त करता है। | ||
== इतिहास == | == इतिहास == | ||
अधिकांश आधुनिक डेस्कटॉप या वर्कस्टेशन माइक्रोप्रोसेसर एक एकीकृत मेमोरी कंट्रोलर (आईएमसी) का उपयोग करते हैं, जिसमें [[Intel]], [[AMD]] के माइक्रोप्रोसेसर और [[एआरएम वास्तुकला]] के आसपास निर्मित माइक्रोप्रोसेसर | अधिकांश आधुनिक डेस्कटॉप या वर्कस्टेशन माइक्रोप्रोसेसर एक एकीकृत मेमोरी कंट्रोलर (आईएमसी) का उपयोग करते हैं, जिसमें [[Intel|इंटेल]], [[AMD|एएमडी]] के माइक्रोप्रोसेसर और [[एआरएम वास्तुकला]] के आसपास निर्मित माइक्रोप्रोसेसर सम्मिलित हैं। | ||
[[AMD K8]] (लगभग 2003) से पहले, उन्नत माइक्रो डिवाइसेस माइक्रोप्रोसेसरों के पास उनके मदरबोर्ड के | [[AMD K8|के8]] (लगभग 2003) से पहले, उन्नत माइक्रो डिवाइसेस ( [[AMD K8|एएमडी]]) माइक्रोप्रोसेसरों के पास उनके मदरबोर्ड के नॉर्थब्रिज (कंप्यूटिंग) पर मेमोरी कंट्रोलर प्रायुक्त था। के8 और बाद में, एएमडी ने एक एकीकृत मेमोरी नियंत्रक नियोजित किया था।<ref>{{Cite web|url=http://www.chip-architect.com/news/2001_10_02_Hammer_microarchitecture.html|title=Chip Architect: AMD's Next Generation Micro Processor's Architecture|last=Vries|first=Hans de|website=www.chip-architect.com|access-date=2018-03-17}}</ref> इसी प्रकार, [[नेहलेम (माइक्रोआर्किटेक्चर)]] (लगभग 2008) तक, इंटेल माइक्रोप्रोसेसरों ने मदरबोर्ड के नॉर्थब्रिज पर कार्यान्वित मेमोरी नियंत्रकों का उपयोग किया था। नेहलेम और बाद में एक एकीकृत मेमोरी नियंत्रक में बदल गया था।<ref>{{cite web|last1=Torres|first1=Gabriel|title=Inside Intel Nehalem Microarchitecture|url=http://www.hardwaresecrets.com/inside-intel-nehalem-microarchitecture/|website=Hardware Secrets|access-date=7 September 2017|page=2|date=2008-08-26}}</ref> | ||
एकीकृत मेमोरी नियंत्रकों का उपयोग करने वाले [[माइक्रोप्रोसेसरों]] के अन्य उदाहरणों में [[NVIDIA|एनवीडिया]] का [[फर्मी (माइक्रोआर्किटेक्चर)]], [[IBM|आईबीएम]] का [[POWER5|पॉवर5]] और [[सन माइक्रोसिस्टम्स|सन माइक्रोप्रणाली्स]] का [[UltraSPARC T1|अल्ट्रास्पार्क टी1]] सम्मिलित हैं। | |||
1990 के दशक में कुछ माइक्रोप्रोसेसर, जैसे कि | जबकि एक एकीकृत मेमोरी कंट्रोलर में प्रणाली के प्रदर्शन को बढ़ाने की क्षमता होती है, जैसे कि [[स्मृति विलंबता|मेमोरी विलंबता]] को कम करके, यह माइक्रोप्रोसेसर को एक विशिष्ट प्रकार (या प्रकार) की मेमोरी में बंद कर देता है, जिससे नई मेमोरी तकनीकों का समर्थन करने के लिए एक रीडिज़ाइन को विवश किया जाता है। जब [[DDR2 SDRAM|डीडीआर2 एसडीआरएएम]] प्रस्तुत किया गया था, और एएमडी ने नए एथलॉन 64 सीपीयू जारी किए। डीडीआर2 नियंत्रक के साथ ये नए मॉडल, एक अलग भौतिक सॉकेट ([[सॉकेट AM2|सॉकेट एएम2]] के रूप में जाना जाता है) का उपयोग करते हैं, ताकि वे केवल नए प्रकार के रैम के लिए डिज़ाइन किए गए मदरबोर्ड में उपयुक्त हो सकें। जब मेमोरी कंट्रोलर ऑन-डाई नहीं होता है, तो उसी सीपीयू को अपडेटेड [[नॉर्थब्रिज (कंप्यूटिंग)]] के साथ नए मदरबोर्ड पर स्थापित किया जा सकता है। | ||
1990 के दशक में कुछ माइक्रोप्रोसेसर, जैसे कि डेक [[Alpha 21066|अल्फा 21066]] और एचपी [[PA-7300LC|पीए-7300एलसी]], में एकीकृत मेमोरी नियंत्रक थे; चूँकि, प्रदर्शन लाभ के अतिरिक्त, इसे बाहरी मेमोरी नियंत्रक की आवश्यकता को समाप्त करके प्रणाली की लागत को कम करने के लिए प्रायुक्त किया गया था। | |||
कुछ सीपीयू को उनके मेमोरी नियंत्रकों को समर्पित बाहरी घटकों के रूप में डिज़ाइन किया गया है जो चिपसेट का हिस्सा नहीं हैं। एक उदाहरण आईबीएम [[POWER8|पॉवर8]] है, जो बाहरी सेंटूर (कंप्यूटिंग) चिप्स का उपयोग करता है जो [[DIMM|डीआईएमएम]] मॉड्यूल पर लगाए जाते हैं और मेमोरी बफ़र्स, एल4 कैश चिप्स और वास्तविक मेमोरी कंट्रोलर के रूप में कार्य करते हैं। सेंटूर चिप के पहले संस्करण में डीडीआर3 मेमोरी का उपयोग किया गया था किन्तु एक अद्यतन संस्करण बाद में जारी किया गया था जो डीडीआर4 का उपयोग कर सकता है।<ref>{{cite web|url=https://www.itjungle.com/2016/10/17/tfh101716-story02/|title=IBM Brings DDR4 Memory To Bear On Power Systems|last=Prickett Morgan|first=Timothy|date=2016-10-17|website=IT Jungle|pages=1|access-date=2017-09-07}}</ref> | |||
== उद्देश्य == | == उद्देश्य == | ||
मेमोरी नियंत्रकों में [[डायनेमिक रैंडम एक्सेस मेमोरी]] को पढ़ने और लिखने के लिए और मेमोरी रिफ्रेश करने के लिए आवश्यक तर्क होते हैं | मेमोरी नियंत्रकों में [[डायनेमिक रैंडम एक्सेस मेमोरी]] को पढ़ने और लिखने के लिए और मेमोरी रिफ्रेश करने के लिए आवश्यक तर्क होते हैं डीआरएएम को रिफ्रेश करें। निरंतर रिफ्रेश के बिना, डीआरएएम उस पर लिखे गए डेटा को खो देगा क्योंकि [[संधारित्र]] एक सेकंड के एक अंश के भीतर अपना [[बिजली का आवेश]] लीक करते हैं ([[JEDEC]] मानकों के अनुसार 64 मिलीसेकंड से अधिक नहीं)। | ||
डीआरएएम को पढ़ना और लिखना डीआरएएम के पंक्ति और स्तंभ डेटा पतों को [[बहुसंकेतक]] परिपथ के इनपुट के रूप में चुनकर किया जाता है, जहां डीआरएएम पर [[demultiplexer]] सही | डीआरएएम को पढ़ना और लिखना डीआरएएम के पंक्ति और स्तंभ डेटा पतों को [[बहुसंकेतक]] परिपथ के इनपुट के रूप में चुनकर किया जाता है, जहां डीआरएएम पर [[demultiplexer]] सही मेमोरी स्थान का चयन करने और डेटा वापस करने के लिए परिवर्तित इनपुट का उपयोग करता है, जो तब होता है ऑपरेशन के लिए आवश्यक बस चौड़ाई को कम करने के लिए डेटा को समेकित करने के लिए एक मल्टीप्लेक्सर के माध्यम से वापस पारित किया गया। | ||
बस की चौड़ाई मेमोरी सेल के साथ संचार करने के लिए उपलब्ध समांतर रेखाओं की संख्या है। अधिक जटिल प्रणालियों और वीडियो कार्डों में मेमोरी नियंत्रकों की बस की चौड़ाई [[8 बिट]] से लेकर 512-बिट तक होती है (सामान्यतः समानांतर में संचालित चार [[64-बिट]] एक साथ | बस की चौड़ाई मेमोरी सेल के साथ संचार करने के लिए उपलब्ध समांतर रेखाओं की संख्या है। अधिक जटिल प्रणालियों और वीडियो कार्डों में मेमोरी नियंत्रकों की बस की चौड़ाई [[8 बिट]] से लेकर 512-बिट तक होती है (सामान्यतः समानांतर में संचालित चार [[64-बिट]] एक साथ मेमोरी नियंत्रकों के रूप में प्रायुक्त किया जाता है, हालांकि कुछ को गैंग मोड में संचालित करने के लिए डिज़ाइन किया गया है जहां 128-बिट मेमोरी डिवाइस तक पहुंचने के लिए दो 64-बिट मेमोरी कंट्रोलर का उपयोग किया जा सकता है)। | ||
कुछ मेमोरी कंट्रोलर, जैसे कि [[PowerQUICC]] II प्रोसेसर में एकीकृत, त्रुटि का पता लगाने और सुधार हार्डवेयर | कुछ मेमोरी कंट्रोलर, जैसे कि [[PowerQUICC|पॉवरQUICC]] II प्रोसेसर में एकीकृत, त्रुटि का पता लगाने और सुधार हार्डवेयर सम्मिलित हैं।<ref>[http://www.freescale.com/files/training_pdf/24815_PQ2_MEM_CONTROL_WBT.pdf "Memory Controller"]</ref> | ||
== सुरक्षा == | == सुरक्षा == | ||
कुछ प्रयोगात्मक | कुछ प्रयोगात्मक मेमोरी नियंत्रक (ज्यादातर सर्वर बाजार के उद्देश्य से जहां डेटा सुरक्षा कानूनी रूप से आवश्यक है) में सीपीयू की मेमोरी प्रबंधन इकाई द्वारा किए गए पहले स्तर के पते के अनुवाद के अलावा दूसरे स्तर का पता अनुवाद होता है।<ref> This is a security feature in that it allows the Operating System to provide better protection separate from using a bit to deny arbitrary code execution in (System and/or User) RAM memory areas. | ||
John Carter, Wilson Hsieh, Leigh Stoller, Mark Swansony, Lixin Zhang, et al. | John Carter, Wilson Hsieh, Leigh Stoller, Mark Swansony, Lixin Zhang, et al. | ||
[http://www.cs.utah.edu/~ald/pubs/hpca99.pdf "Impulse: Building a Smarter Memory Controller"]. | [http://www.cs.utah.edu/~ald/pubs/hpca99.pdf "Impulse: Building a Smarter Memory Controller"]. | ||
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मेमोरी स्क्रैम्बलिंग (क्रिप्टोग्राफ़िक थ्योरी में) [[कंप्यूटर फोरेंसिक्स]] और [[रिवर्स इंजीनियरिंग]] विश्लेषण को | मेमोरी स्क्रैम्बलिंग (क्रिप्टोग्राफ़िक थ्योरी में) [[कंप्यूटर फोरेंसिक्स]] और [[रिवर्स इंजीनियरिंग]] विश्लेषण को डीआरएएम डेटा रिमेनेंस पर आधारित विभिन्न प्रकार के कोल्ड बूट हमलों को अप्रभावी रूप से प्रस्तुत करने से रोकने वाला माना जाता है। वर्तमान अभ्यास में यह हासिल नहीं किया गया है। | ||
चूँकि मेमोरी स्क्रैम्बलिंग को केवल डीआरएएम से संबंधित विद्युत समस्याओं के समाधान के लिए डिज़ाइन किया गया है। 2010 के बाद के मेमोरी स्क्रैम्बलिंग मानक सुरक्षा मुद्दों या समस्याओं को ठीक नहीं करते हैं या उन्हें रोकते नहीं हैं। 2010 के मेमोरी स्क्रैम्बलिंग मानक क्रिप्टोग्राफिक रूप से सुरक्षित नहीं हैं, या आवश्यक रूप से खुले स्रोत या सार्वजनिक संशोधन या विश्लेषण के लिए खुले हैं।<ref>{{cite web | |||
| url = http://www.slideshare.net/codeblue_jp/igor-skochinsky-enpub | | url = http://www.slideshare.net/codeblue_jp/igor-skochinsky-enpub | ||
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ASUS और | ASUS और इंटेल के अपने मेमोरी स्क्रैम्बलिंग मानक हैं। वर्तमान में ASUS मदरबोर्ड ने उपयोगकर्ता को यह चुनने की अनुमति दी है कि [ASUS या इंटेल] का उपयोग करने के लिए कौन से मेमोरी स्क्रैम्बलिंग मानक हैं या सुविधा को पूरी तरह से बंद करना है या नहीं। | ||
== वेरिएंट == | == वेरिएंट == | ||
=== डबल डेटा दर मेमोरी === | === डबल डेटा दर मेमोरी === | ||
[[DDR SDRAM]] को चलाने के लिए [[दुगनी डाटा दर]] ( | [[DDR SDRAM|डीडीआर Sडीआरएएम]] को चलाने के लिए [[दुगनी डाटा दर]] (डीडीआर) मेमोरी कंट्रोलर का उपयोग किया जाता है, जहाँ प्रणाली की मेमोरी क्लॉक के बढ़ते और गिरते दोनों किनारों पर डेटा ट्रांसफर किया जाता है। एकल डेटा दर नियंत्रकों की तुलना में डीडीआर मेमोरी नियंत्रक उल्लेखनीय रूप से अधिक जटिल होते हैं {{Citation needed| reason= Why would it be significantly more complicated - provide reliable source if possible | date=April 2018}}, किन्तु वे मेमोरी सेल की घड़ी की दर या बस की चौड़ाई को बढ़ाए बिना दो बार डेटा स्थानांतरित करने की अनुमति देते हैं। | ||
=== मल्टीचैनल मेमोरी === | === मल्टीचैनल मेमोरी === | ||
{{Main|Multi-channel memory architecture}} | {{Main|Multi-channel memory architecture}} | ||
मल्टीचैनल मेमोरी मेमोरी कंट्रोलर मेमोरी कंट्रोलर होते हैं जहां | मल्टीचैनल मेमोरी मेमोरी कंट्रोलर मेमोरी कंट्रोलर होते हैं जहां डीआरएएम डिवाइस को मेमोरी कंट्रोलर (एस) को समानांतर में एक्सेस करने की अनुमति देने के लिए कई अलग-अलग बसों पर अलग किया जाता है। यह चैनलों की संख्या के एक कारक द्वारा बस की बैंडविड्थ की सैद्धांतिक मात्रा को बढ़ाता है। जबकि प्रत्येक डीआरएएम सेल के लिए एक चैनल आदर्श समाधान होगा, वायर काउंट, [[रेखा समाई]] और समान लंबाई के समानांतर एक्सेस लाइनों की आवश्यकता के कारण अधिक चैनल जोड़ना बहुत मुश्किल है। | ||
=== पूरी तरह से बफ़र्ड मेमोरी === | === पूरी तरह से बफ़र्ड मेमोरी === | ||
{{Main|Fully Buffered DIMM}} | {{Main|Fully Buffered DIMM}} | ||
पूरी तरह से बफ़र्ड मेमोरी प्रणाली प्रत्येक | पूरी तरह से बफ़र्ड मेमोरी प्रणाली प्रत्येक डीआईएमएम पर एक मेमोरी बफ़र डिवाइस रखता है (जिसे [[FB-DIMM|FB-डीआईएमएम]] कहा जाता है जब पूरी तरह से बफ़र्ड रैम का उपयोग किया जाता है), जो पारंपरिक मेमोरी कंट्रोलर डिवाइस के विपरीत, मेमोरी कंट्रोलर के लिए एक सीरियल डेटा लिंक का उपयोग करता है, जो पिछले में उपयोग किए गए समानांतर लिंक के अतिरिक्त होता है। रैम डिजाइन। यह मेमोरी उपकरणों को मदरबोर्ड पर रखने के लिए आवश्यक तारों की संख्या को कम करता है (कम संख्या में परतों का उपयोग करने की अनुमति देता है, जिसका अर्थ है कि अधिक मेमोरी उपकरणों को एक ही बोर्ड पर रखा जा सकता है), बढ़ती विलंबता (समय) की कीमत पर मेमोरी स्थान तक पहुँचने के लिए आवश्यक)। यह वृद्धि डीआरएएम सेल से पढ़ी जाने वाली समानांतर जानकारी को FB-डीआईएमएम कंट्रोलर द्वारा उपयोग किए जाने वाले सीरियल फॉर्मेट में बदलने और मदरबोर्ड पर मेमोरी कंट्रोलर में समानांतर रूप में वापस करने के लिए आवश्यक समय के कारण है। | ||
सिद्धांत रूप में, एफबी-डीआईएमएम के मेमोरी बफर डिवाइस को किसी भी डीआरएएम सेल तक पहुंचने के लिए बनाया जा सकता है, जो मेमोरी सेल एग्नॉस्टिक मेमोरी कंट्रोलर डिज़ाइन की अनुमति देता है, | सिद्धांत रूप में, एफबी-डीआईएमएम के मेमोरी बफर डिवाइस को किसी भी डीआरएएम सेल तक पहुंचने के लिए बनाया जा सकता है, जो मेमोरी सेल एग्नॉस्टिक मेमोरी कंट्रोलर डिज़ाइन की अनुमति देता है, किन्तु यह प्रदर्शित नहीं किया गया है, क्योंकि तकनीक अपनी प्रारंभिक अवस्था में है। | ||
=== फ्लैश मेमोरी नियंत्रक === | === फ्लैश मेमोरी नियंत्रक === | ||
{{Main|Flash memory controller}} | {{Main|Flash memory controller}} | ||
कई [[फ्लैश मेमोरी]] डिवाइस, जैसे [[उ स बी फ्लैश ड्राइव]] और [[ठोस राज्य ड्राइव]], में [[फ्लैश मेमोरी नियंत्रक]] | कई [[फ्लैश मेमोरी]] डिवाइस, जैसे [[उ स बी फ्लैश ड्राइव]] और [[ठोस राज्य ड्राइव]], में [[फ्लैश मेमोरी नियंत्रक]] सम्मिलित होता है। फ्लैश मेमोरी स्वाभाविक रूप से रैम की तुलना में धीमी है और अक्सर कुछ मिलियन लिखने के चक्र के बाद अनुपयोगी हो जाती है, जो सामान्यतः इसे रैम अनुप्रयोगों के लिए अनुपयुक्त बनाती है। | ||
== यह भी देखें == | == यह भी देखें == | ||
Revision as of 08:25, 27 February 2023
मेमोरी कंट्रोलर एक डिजिटल परिपथ होता है जो कंप्यूटर की मुख्य मेमोरी में जाने और जाने वाले डेटा के प्रवाह का प्रबंधन करता है। एक मेमोरी कंट्रोलर एक अलग चिप हो सकता है या किसी अन्य चिप में एकीकृत हो सकता है, जैसे कि उसी डाई (एकीकृत परिपथ) पर रखा जा सकता है या बाद की स्थिति में माइक्रोप्रोसेसर के अभिन्न अंग के रूप में इसे सामान्यतः एक एकीकृत मेमोरी कंट्रोलर (आईएमसी) कहा जाता है। मेमोरी कंट्रोलर को कभी-कभी मेमोरी चिप कंट्रोलर (एमसीसी)[1] या एक मेमोरी कंट्रोलर यूनिट (एमसीयू) भी कहा जाता है।।[2]
मेमोरी कंट्रोलर का एक सामान्य रूप मेमोरी प्रबंधन इकाई (एमएमयू) है जो कई ऑपरेटिंग प्रणाली में आभासी पता को प्रायुक्त करता है।
इतिहास
अधिकांश आधुनिक डेस्कटॉप या वर्कस्टेशन माइक्रोप्रोसेसर एक एकीकृत मेमोरी कंट्रोलर (आईएमसी) का उपयोग करते हैं, जिसमें इंटेल, एएमडी के माइक्रोप्रोसेसर और एआरएम वास्तुकला के आसपास निर्मित माइक्रोप्रोसेसर सम्मिलित हैं।
के8 (लगभग 2003) से पहले, उन्नत माइक्रो डिवाइसेस ( एएमडी) माइक्रोप्रोसेसरों के पास उनके मदरबोर्ड के नॉर्थब्रिज (कंप्यूटिंग) पर मेमोरी कंट्रोलर प्रायुक्त था। के8 और बाद में, एएमडी ने एक एकीकृत मेमोरी नियंत्रक नियोजित किया था।[3] इसी प्रकार, नेहलेम (माइक्रोआर्किटेक्चर) (लगभग 2008) तक, इंटेल माइक्रोप्रोसेसरों ने मदरबोर्ड के नॉर्थब्रिज पर कार्यान्वित मेमोरी नियंत्रकों का उपयोग किया था। नेहलेम और बाद में एक एकीकृत मेमोरी नियंत्रक में बदल गया था।[4]
एकीकृत मेमोरी नियंत्रकों का उपयोग करने वाले माइक्रोप्रोसेसरों के अन्य उदाहरणों में एनवीडिया का फर्मी (माइक्रोआर्किटेक्चर), आईबीएम का पॉवर5 और सन माइक्रोप्रणाली्स का अल्ट्रास्पार्क टी1 सम्मिलित हैं।
जबकि एक एकीकृत मेमोरी कंट्रोलर में प्रणाली के प्रदर्शन को बढ़ाने की क्षमता होती है, जैसे कि मेमोरी विलंबता को कम करके, यह माइक्रोप्रोसेसर को एक विशिष्ट प्रकार (या प्रकार) की मेमोरी में बंद कर देता है, जिससे नई मेमोरी तकनीकों का समर्थन करने के लिए एक रीडिज़ाइन को विवश किया जाता है। जब डीडीआर2 एसडीआरएएम प्रस्तुत किया गया था, और एएमडी ने नए एथलॉन 64 सीपीयू जारी किए। डीडीआर2 नियंत्रक के साथ ये नए मॉडल, एक अलग भौतिक सॉकेट (सॉकेट एएम2 के रूप में जाना जाता है) का उपयोग करते हैं, ताकि वे केवल नए प्रकार के रैम के लिए डिज़ाइन किए गए मदरबोर्ड में उपयुक्त हो सकें। जब मेमोरी कंट्रोलर ऑन-डाई नहीं होता है, तो उसी सीपीयू को अपडेटेड नॉर्थब्रिज (कंप्यूटिंग) के साथ नए मदरबोर्ड पर स्थापित किया जा सकता है।
1990 के दशक में कुछ माइक्रोप्रोसेसर, जैसे कि डेक अल्फा 21066 और एचपी पीए-7300एलसी, में एकीकृत मेमोरी नियंत्रक थे; चूँकि, प्रदर्शन लाभ के अतिरिक्त, इसे बाहरी मेमोरी नियंत्रक की आवश्यकता को समाप्त करके प्रणाली की लागत को कम करने के लिए प्रायुक्त किया गया था।
कुछ सीपीयू को उनके मेमोरी नियंत्रकों को समर्पित बाहरी घटकों के रूप में डिज़ाइन किया गया है जो चिपसेट का हिस्सा नहीं हैं। एक उदाहरण आईबीएम पॉवर8 है, जो बाहरी सेंटूर (कंप्यूटिंग) चिप्स का उपयोग करता है जो डीआईएमएम मॉड्यूल पर लगाए जाते हैं और मेमोरी बफ़र्स, एल4 कैश चिप्स और वास्तविक मेमोरी कंट्रोलर के रूप में कार्य करते हैं। सेंटूर चिप के पहले संस्करण में डीडीआर3 मेमोरी का उपयोग किया गया था किन्तु एक अद्यतन संस्करण बाद में जारी किया गया था जो डीडीआर4 का उपयोग कर सकता है।[5]
उद्देश्य
मेमोरी नियंत्रकों में डायनेमिक रैंडम एक्सेस मेमोरी को पढ़ने और लिखने के लिए और मेमोरी रिफ्रेश करने के लिए आवश्यक तर्क होते हैं डीआरएएम को रिफ्रेश करें। निरंतर रिफ्रेश के बिना, डीआरएएम उस पर लिखे गए डेटा को खो देगा क्योंकि संधारित्र एक सेकंड के एक अंश के भीतर अपना बिजली का आवेश लीक करते हैं (JEDEC मानकों के अनुसार 64 मिलीसेकंड से अधिक नहीं)।
डीआरएएम को पढ़ना और लिखना डीआरएएम के पंक्ति और स्तंभ डेटा पतों को बहुसंकेतक परिपथ के इनपुट के रूप में चुनकर किया जाता है, जहां डीआरएएम पर demultiplexer सही मेमोरी स्थान का चयन करने और डेटा वापस करने के लिए परिवर्तित इनपुट का उपयोग करता है, जो तब होता है ऑपरेशन के लिए आवश्यक बस चौड़ाई को कम करने के लिए डेटा को समेकित करने के लिए एक मल्टीप्लेक्सर के माध्यम से वापस पारित किया गया।
बस की चौड़ाई मेमोरी सेल के साथ संचार करने के लिए उपलब्ध समांतर रेखाओं की संख्या है। अधिक जटिल प्रणालियों और वीडियो कार्डों में मेमोरी नियंत्रकों की बस की चौड़ाई 8 बिट से लेकर 512-बिट तक होती है (सामान्यतः समानांतर में संचालित चार 64-बिट एक साथ मेमोरी नियंत्रकों के रूप में प्रायुक्त किया जाता है, हालांकि कुछ को गैंग मोड में संचालित करने के लिए डिज़ाइन किया गया है जहां 128-बिट मेमोरी डिवाइस तक पहुंचने के लिए दो 64-बिट मेमोरी कंट्रोलर का उपयोग किया जा सकता है)।
कुछ मेमोरी कंट्रोलर, जैसे कि पॉवरQUICC II प्रोसेसर में एकीकृत, त्रुटि का पता लगाने और सुधार हार्डवेयर सम्मिलित हैं।[6]
सुरक्षा
कुछ प्रयोगात्मक मेमोरी नियंत्रक (ज्यादातर सर्वर बाजार के उद्देश्य से जहां डेटा सुरक्षा कानूनी रूप से आवश्यक है) में सीपीयू की मेमोरी प्रबंधन इकाई द्वारा किए गए पहले स्तर के पते के अनुवाद के अलावा दूसरे स्तर का पता अनुवाद होता है।[7] कुछ इण्टेल कोर प्रोसेसर में एकीकृत मेमोरी नियंत्रक भी एक विशेषता के रूप में मेमोरी स्क्रैम्बलिंग प्रदान करते हैं जो मुख्य मेमोरी में लिखे गए उपयोगकर्ता डेटा को छद्म-यादृच्छिक पैटर्न में बदल देता है।[8][9] मेमोरी स्क्रैम्बलिंग (क्रिप्टोग्राफ़िक थ्योरी में) कंप्यूटर फोरेंसिक्स और रिवर्स इंजीनियरिंग विश्लेषण को डीआरएएम डेटा रिमेनेंस पर आधारित विभिन्न प्रकार के कोल्ड बूट हमलों को अप्रभावी रूप से प्रस्तुत करने से रोकने वाला माना जाता है। वर्तमान अभ्यास में यह हासिल नहीं किया गया है।
चूँकि मेमोरी स्क्रैम्बलिंग को केवल डीआरएएम से संबंधित विद्युत समस्याओं के समाधान के लिए डिज़ाइन किया गया है। 2010 के बाद के मेमोरी स्क्रैम्बलिंग मानक सुरक्षा मुद्दों या समस्याओं को ठीक नहीं करते हैं या उन्हें रोकते नहीं हैं। 2010 के मेमोरी स्क्रैम्बलिंग मानक क्रिप्टोग्राफिक रूप से सुरक्षित नहीं हैं, या आवश्यक रूप से खुले स्रोत या सार्वजनिक संशोधन या विश्लेषण के लिए खुले हैं।[10] ASUS और इंटेल के अपने मेमोरी स्क्रैम्बलिंग मानक हैं। वर्तमान में ASUS मदरबोर्ड ने उपयोगकर्ता को यह चुनने की अनुमति दी है कि [ASUS या इंटेल] का उपयोग करने के लिए कौन से मेमोरी स्क्रैम्बलिंग मानक हैं या सुविधा को पूरी तरह से बंद करना है या नहीं।
वेरिएंट
डबल डेटा दर मेमोरी
डीडीआर Sडीआरएएम को चलाने के लिए दुगनी डाटा दर (डीडीआर) मेमोरी कंट्रोलर का उपयोग किया जाता है, जहाँ प्रणाली की मेमोरी क्लॉक के बढ़ते और गिरते दोनों किनारों पर डेटा ट्रांसफर किया जाता है। एकल डेटा दर नियंत्रकों की तुलना में डीडीआर मेमोरी नियंत्रक उल्लेखनीय रूप से अधिक जटिल होते हैं[citation needed], किन्तु वे मेमोरी सेल की घड़ी की दर या बस की चौड़ाई को बढ़ाए बिना दो बार डेटा स्थानांतरित करने की अनुमति देते हैं।
मल्टीचैनल मेमोरी
मल्टीचैनल मेमोरी मेमोरी कंट्रोलर मेमोरी कंट्रोलर होते हैं जहां डीआरएएम डिवाइस को मेमोरी कंट्रोलर (एस) को समानांतर में एक्सेस करने की अनुमति देने के लिए कई अलग-अलग बसों पर अलग किया जाता है। यह चैनलों की संख्या के एक कारक द्वारा बस की बैंडविड्थ की सैद्धांतिक मात्रा को बढ़ाता है। जबकि प्रत्येक डीआरएएम सेल के लिए एक चैनल आदर्श समाधान होगा, वायर काउंट, रेखा समाई और समान लंबाई के समानांतर एक्सेस लाइनों की आवश्यकता के कारण अधिक चैनल जोड़ना बहुत मुश्किल है।
पूरी तरह से बफ़र्ड मेमोरी
पूरी तरह से बफ़र्ड मेमोरी प्रणाली प्रत्येक डीआईएमएम पर एक मेमोरी बफ़र डिवाइस रखता है (जिसे FB-डीआईएमएम कहा जाता है जब पूरी तरह से बफ़र्ड रैम का उपयोग किया जाता है), जो पारंपरिक मेमोरी कंट्रोलर डिवाइस के विपरीत, मेमोरी कंट्रोलर के लिए एक सीरियल डेटा लिंक का उपयोग करता है, जो पिछले में उपयोग किए गए समानांतर लिंक के अतिरिक्त होता है। रैम डिजाइन। यह मेमोरी उपकरणों को मदरबोर्ड पर रखने के लिए आवश्यक तारों की संख्या को कम करता है (कम संख्या में परतों का उपयोग करने की अनुमति देता है, जिसका अर्थ है कि अधिक मेमोरी उपकरणों को एक ही बोर्ड पर रखा जा सकता है), बढ़ती विलंबता (समय) की कीमत पर मेमोरी स्थान तक पहुँचने के लिए आवश्यक)। यह वृद्धि डीआरएएम सेल से पढ़ी जाने वाली समानांतर जानकारी को FB-डीआईएमएम कंट्रोलर द्वारा उपयोग किए जाने वाले सीरियल फॉर्मेट में बदलने और मदरबोर्ड पर मेमोरी कंट्रोलर में समानांतर रूप में वापस करने के लिए आवश्यक समय के कारण है।
सिद्धांत रूप में, एफबी-डीआईएमएम के मेमोरी बफर डिवाइस को किसी भी डीआरएएम सेल तक पहुंचने के लिए बनाया जा सकता है, जो मेमोरी सेल एग्नॉस्टिक मेमोरी कंट्रोलर डिज़ाइन की अनुमति देता है, किन्तु यह प्रदर्शित नहीं किया गया है, क्योंकि तकनीक अपनी प्रारंभिक अवस्था में है।
फ्लैश मेमोरी नियंत्रक
कई फ्लैश मेमोरी डिवाइस, जैसे उ स बी फ्लैश ड्राइव और ठोस राज्य ड्राइव, में फ्लैश मेमोरी नियंत्रक सम्मिलित होता है। फ्लैश मेमोरी स्वाभाविक रूप से रैम की तुलना में धीमी है और अक्सर कुछ मिलियन लिखने के चक्र के बाद अनुपयोगी हो जाती है, जो सामान्यतः इसे रैम अनुप्रयोगों के लिए अनुपयुक्त बनाती है।
यह भी देखें
- मेमोरी स्क्रबिंग
- मेमोरी प्रबंधन इकाई
- पता निर्माण इकाई
- मल्टी-चैनल मेमोरी आर्किटेक्चर
संदर्भ
- ↑ Comptia A+ Certification Exam Guide, Seventh Edition, by Mike Meyers, in the glossary, bottom of page 1278: "Chip that handles memory requests from the CPU."
- ↑ Neat, Adam G. (2003-12-04). Maximizing Performance and Scalability with IBM WebSphere. ISBN 9781590591307. Retrieved 6 February 2015.
- ↑ Vries, Hans de. "Chip Architect: AMD's Next Generation Micro Processor's Architecture". www.chip-architect.com. Retrieved 2018-03-17.
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- ↑ Prickett Morgan, Timothy (2016-10-17). "IBM Brings DDR4 Memory To Bear On Power Systems". IT Jungle. p. 1. Retrieved 2017-09-07.
- ↑ "Memory Controller"
- ↑ This is a security feature in that it allows the Operating System to provide better protection separate from using a bit to deny arbitrary code execution in (System and/or User) RAM memory areas. John Carter, Wilson Hsieh, Leigh Stoller, Mark Swansony, Lixin Zhang, et al. "Impulse: Building a Smarter Memory Controller".
- ↑ "2nd Generation Intel Core Processor Family Desktop, Intel Pentium Processor Family Desktop, and Intel Celeron Processor Family Desktop" (PDF). June 2013. p. 23. Retrieved 2015-11-03.
- ↑ "2nd Generation Intel Core Processor Family Mobile and Intel Celeron Processor Family Mobile" (PDF). September 2012. p. 24. Retrieved 2015-11-03.
- ↑ Igor Skochinsky (2014-03-12). "Secret of Intel Management Engine". SlideShare. pp. 26–29. Retrieved 2014-07-13.
बाहरी संबंध
- Infineon/Kingston (a memory vendor) Dual Channel DDR Memory Whitepaper – explains dual channel memory controllers, and how to use them
- Introduction to Memory Controller
- Intel guide on Single- and Multichannel Memory Modes
- What is a Memory Controller and How Does it Work
- What is Memory Controller?
